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IEEE 1149.1标准与边界扫描技术 被引量:19

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摘要 本文首先分析了集成电路可测性设计的必要性,接着介绍了边界扫描的基本结构、IEEE1149.1标准及指令寄存器、数据寄存器,分析了边界扫描的工作过程,介绍了基本的扫描寄存器结构,最后给出了系统集成可测性设计的策略。
作者 于宗光
出处 《电子与封装》 2003年第5期40-47,共8页 Electronics & Packaging
  • 相关文献

参考文献4

  • 1[1]Igor Mohor, Boundry-Scan Architecture and compliance to IEEE Std 1149.1, www.opencore.org
  • 2[2]TI 公司 IEEE Std. 1149.1 ( JTAG ) Testability 手册 1997
  • 3[3]Michael Keating, Pierre Bricaud, Reuse Methodology Manual foe on-chip designs, second edition, Kluwer Academic publishers, Boston,Dordrecht, London, 1999;第3章:49~50
  • 4[4]www.ti.com/sc/jtag/jtaghome.htm

同被引文献76

引证文献19

二级引证文献47

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