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新一代RISC微处理器的结构特征 被引量:6
1
作者 郑飞 《微处理机》 1995年第4期1-4,共4页
本文简要介绍在全球范围内最具影响的五大RISC集团于1994年底宣布的,1995年陆续上市的五个最新的高性能RISC微处理器(即IBM-Apple-Motorola的PowerPC620、SUN的UltraSPARC、HP的PA-RISC7200、MIPS的R10000和DEC的AlPha21164)的结... 本文简要介绍在全球范围内最具影响的五大RISC集团于1994年底宣布的,1995年陆续上市的五个最新的高性能RISC微处理器(即IBM-Apple-Motorola的PowerPC620、SUN的UltraSPARC、HP的PA-RISC7200、MIPS的R10000和DEC的AlPha21164)的结构特征,并据此对新一代RISC微处理器的结构设计思想进行分析。 展开更多
关键词 微处理器 risc 系统结构
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新一代RISC微处理器的技术特征与趋向 被引量:1
2
作者 郑飞 陆鑫达 《小型微型计算机系统》 CSCD 北大核心 1995年第9期56-60,共5页
从流水线技术、指令调度技术、Cache设计技术及多媒体支持等方面详细讨论新一代RISC微处理器的技术特征,并简要论述RISC微处理器的发展趋向。
关键词 微处理器 超级标量 多媒体
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基于RISC-V的SOPC电子系统设计实验研究 被引量:1
3
作者 叶朝辉 张仁刚 +1 位作者 赵腾浩 程雪珂 《实验技术与管理》 CAS 北大核心 2023年第11期71-75,共5页
该实验设计在电子系统设计相关教学中引入嵌入开源软核微处理器的片上可编程系统SOPC(system on programmable chip)技术,不仅能够让更多学生学习集成电路初步设计方法,而且能够通过自主设计SOPC系统培养其创新能力。该文首先对SOPC电... 该实验设计在电子系统设计相关教学中引入嵌入开源软核微处理器的片上可编程系统SOPC(system on programmable chip)技术,不仅能够让更多学生学习集成电路初步设计方法,而且能够通过自主设计SOPC系统培养其创新能力。该文首先对SOPC电子系统设计的现状进行了分析,提出了基于RISC(reduced instruction set computer)-V开放指令集架构的微处理器进行SOPC系统设计教学,之后介绍了RISC-V微处理器的选择和移植方法,最后介绍了基于RISC-V微处理器的四个层次的实验设计原则和设计出的具体实验项目。 展开更多
关键词 电子技术 risc-V微处理器 SOPC电子系统设计 实验项目
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基于FPGA的RISC微处理器的设计与实现 被引量:2
4
作者 李强 潘明 许勇 《广西科学院学报》 2005年第4期294-297,共4页
基于FPGA和电子设计自动化技术,采用模块化设计的方法和VHDL语言,设计一个基于FPGA的R ISC微处理器。该微处理器主要由控制器、运算器和寄存器组成,具有指令控制、操作控制、时间控制和数据加工等基本功能,其指令长度为16位定长,采用立... 基于FPGA和电子设计自动化技术,采用模块化设计的方法和VHDL语言,设计一个基于FPGA的R ISC微处理器。该微处理器主要由控制器、运算器和寄存器组成,具有指令控制、操作控制、时间控制和数据加工等基本功能,其指令长度为16位定长,采用立即寻址和直接寻址两种方式。仿真结果表明,基于FPGA的R ISC微处理器的时钟频率为23.02MH z,且功能完全达到设计要求。 展开更多
关键词 risc微处理器 电子设计自动化 现场可编程门阵列 VHDL语言
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基于FPGA的32位整数微处理器的设计与实现 被引量:3
5
作者 冯海涛 王永纲 +2 位作者 石江涛 颜天信 王砚方 《小型微型计算机系统》 CSCD 北大核心 2005年第6期1113-1117,共5页
CPU“软核”可以根据实际应用需要进行剪裁,因而CPU软核设计是SoC设计实现的重要部分.在FPGA内部设计和调试完全嵌入式的整数微处理器软核,不仅涉及到通常CPU必需的算术逻辑累加器、寄存器堆、指令缓冲、跳转计数、指令集及指令编译等... CPU“软核”可以根据实际应用需要进行剪裁,因而CPU软核设计是SoC设计实现的重要部分.在FPGA内部设计和调试完全嵌入式的整数微处理器软核,不仅涉及到通常CPU必需的算术逻辑累加器、寄存器堆、指令缓冲、跳转计数、指令集及指令编译等方面的设计实现,还要针对FPGA内部的结构特点对设计进行分析优化,例如流水线结构的选择、关键路径延迟的折衷平衡以及整体调试等.在Virtex1000FG680-4FPGA上设计实现的32位RISC整数微处理器,运行时钟频率可达30MHz,实现150条指令,占用FPGA逻辑资源7%. 展开更多
关键词 risc微处理器设计 指令集 调试
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银河TS-1微处理器的流水线
6
作者 赵学秘 陆洪毅 +2 位作者 王蕾 戴葵 王志英 《计算机工程》 CAS CSCD 北大核心 2003年第5期142-143,F003,共3页
银河TS-1微处理器是国防科技大学计算机学院自行设计的具有自主版权的32位嵌入式微处理器。参考标准DLX5级流水线设计了银河TS-1流水线核基本的指令处理通路和数据通路,并以此为基础提出了一种更为高效的6级流水线:取指,译码,操作... 银河TS-1微处理器是国防科技大学计算机学院自行设计的具有自主版权的32位嵌入式微处理器。参考标准DLX5级流水线设计了银河TS-1流水线核基本的指令处理通路和数据通路,并以此为基础提出了一种更为高效的6级流水线:取指,译码,操作数准备,ALU执行,数据获取,写回。此6级流水线与5级流水线相比,硬件开销增加很少,但加速比大于1.54。 展开更多
关键词 银河TS-1 微处理器 流水线 指令处理通路 数据通路 嵌入式微处理器 risc
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