基于IPCore的FFT处理器的设计与实现 被引量：2

1

作者 李旭 蒲昱初 徐火生 《舰船电子工程》 2007年第2期121-123,149,共4页

在数据通信和图像处理应用中,需要强大的数字信号处理能力。然而,当最快的数字信号处理器仍然无法满足速度要求时,传统的方法是采用多处理器并行处理,或是使用定制的ASIC产品。现在开发者有了更新的选择就是使用现场可编程门阵列来快速... 在数据通信和图像处理应用中,需要强大的数字信号处理能力。然而,当最快的数字信号处理器仍然无法满足速度要求时,传统的方法是采用多处理器并行处理,或是使用定制的ASIC产品。现在开发者有了更新的选择就是使用现场可编程门阵列来快速、经济地完成设计,大大缩短了产品的研发周期和成本。FFT作为一种数字信号处理的算法,被广泛的应用在了各种通信、测试、图像处理等领域。提出一种基于IP核(IPCore)在FPGA上实现FFT/IFFT的方法。 展开更多

关键词 FFT IFFT FPGA ipcore

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一种基于FFT IPcore的实时频谱处理方案 被引量：1

2

作者 吴韬 王健 严俊 《航空电子技术》 2013年第3期39-42,共4页

本文针对飞机地面电源车的电源品质中畸变频谱的大数据量和实时性特点提出了一种基于FFT IPcore的实时频谱处理方案。本方案以DFT蝶形变换为理论基础,在FPGA上通过对FFT IPcore的配置和配套逻辑的编写,实现了大数据量的实时频谱处理,并... 本文针对飞机地面电源车的电源品质中畸变频谱的大数据量和实时性特点提出了一种基于FFT IPcore的实时频谱处理方案。本方案以DFT蝶形变换为理论基础,在FPGA上通过对FFT IPcore的配置和配套逻辑的编写,实现了大数据量的实时频谱处理,并最终以Matlab仿真、XST仿真以及Chipscope实时数据对比验证了方案的正确性和实时性。 展开更多

关键词 实时频谱 DFT蝶形变换 FFT ipcore

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视频压缩IPcore设计

3

作者 傅伟煌 孟利民 徐林静 《电子技术应用》 北大核心 2004年第6期61-63,共3页

介绍了一种基于FPGA技术的视频压缩IPcore(IntellectualPropertycore,智力产权)设计。设计中综合运用了分布式算法、并行运算和流水线单元,通过VerilogHDL(VerilogHardwareDescriptionLanguage)硬件描述语言描述运算单元及其结构配置。... 介绍了一种基于FPGA技术的视频压缩IPcore(IntellectualPropertycore,智力产权)设计。设计中综合运用了分布式算法、并行运算和流水线单元,通过VerilogHDL(VerilogHardwareDescriptionLanguage)硬件描述语言描述运算单元及其结构配置。整个系统能在27MHz系统时钟下工作。 展开更多

关键词 视频压缩 ipcore FPGA 智力产权 并行运算 硬件描述语言

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基于IPCore的FFT仿真与硬件实现 被引量：3

4

作者 董志 左震 +3 位作者 黄芝平 唐贵林 张羿猛 刘纯武 《通信技术》 2010年第7期165-167,170,共4页

由于目前CDMA快速码捕获系统对捕获速度的要求越来越高,而目前使用比较普遍的码捕获方法是基于FFT的快速码捕获。因此开发出一种快速简单实用的FFT计算方法势在必行。基于Cooley-Tukey提出的算法,实现了一种基-4FFT的FPGA设计方法。利用... 由于目前CDMA快速码捕获系统对捕获速度的要求越来越高,而目前使用比较普遍的码捕获方法是基于FFT的快速码捕获。因此开发出一种快速简单实用的FFT计算方法势在必行。基于Cooley-Tukey提出的算法,实现了一种基-4FFT的FPGA设计方法。利用FPGA的丰富资源以及灵活的IPCore功能,使设计流程大大简化,为实现FFT算法提供了一种方便快捷的方法。仿真和实验结果证明,该方法准确可靠,计算速度快,相比于以前的算法,该方法提高了至少一倍的运算速度。 展开更多

关键词 快速傅立叶变换(FFT) FPGA ipcore

原文传递

基于SOPC技术的战车综合显控终端设计 被引量：1

5

作者 张新喜 许军 +1 位作者 杨雨迎 孙进 《火力与指挥控制》 CSCD 北大核心 2008年第S2期108-109,112,共3页

通过战车乘员综合显控终端,战车成员可以快速准确地获取战车的各种状态信息,从而大大提高指挥员的判断能力。基于SOPC技术的战车综合显控终端,在单片FPGA内部集成了微理器系统、各种接口控制器、DSP协处理器以及用于液晶显示控制的液晶... 通过战车乘员综合显控终端,战车成员可以快速准确地获取战车的各种状态信息,从而大大提高指挥员的判断能力。基于SOPC技术的战车综合显控终端,在单片FPGA内部集成了微理器系统、各种接口控制器、DSP协处理器以及用于液晶显示控制的液晶屏硬件控制器等,具有集成度高、处理能力强、可靠性高、设计灵活、硬件可在系统升级等众多优点。 展开更多

关键词 显控终端 SOPC ipcore NIOSII 嵌入式实时操作系统 GUI

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基于FPGA的Serial RapidIO协议的设计与实现 被引量：10

6

作者 许树军 黄镠 +1 位作者 牛戴楠 王锐 《雷达与对抗》 2015年第4期36-38,49,共4页

在对RapidIO协议和Serial RapidIO(SRIO,下同)IPcore用户接口介绍的基础上,详细描述了Serial RapidIO交换架构在FPGA上的编程方法,并采用双缓存机制实现了位宽、数据流速的转换,完成了多SRIO节点间的高速数据通信,具有较强的通用性和可... 在对RapidIO协议和Serial RapidIO(SRIO,下同)IPcore用户接口介绍的基础上,详细描述了Serial RapidIO交换架构在FPGA上的编程方法,并采用双缓存机制实现了位宽、数据流速的转换,完成了多SRIO节点间的高速数据通信,具有较强的通用性和可移植性。 展开更多

关键词 FPGA SRIO ipcore RAPIDIO 高速通信 串行接口

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3DES密码卡的设计与实现

7

作者 邹候文 刘磊 唐屹 《计算机工程》 CAS CSCD 北大核心 2006年第11期253-255,共3页

以EP1S20F672C7为核心，利用PLX9054作为密码卡与主机交换数据的接口芯片，采用多个硬件线程并行处理实现3DES算法，设计了3DES密码卡。介绍了硬件的构成、原理图的设计、底层软件的编程以及密码算法IP核的开发。所设计的IP核具有很高... 以EP1S20F672C7为核心，利用PLX9054作为密码卡与主机交换数据的接口芯片，采用多个硬件线程并行处理实现3DES算法，设计了3DES密码卡。介绍了硬件的构成、原理图的设计、底层软件的编程以及密码算法IP核的开发。所设计的IP核具有很高的灵活性，可同时处理1～53个任务。 展开更多

关键词 密码卡 3DES算法 ipcore

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基于FPGA的电网实时数据采集与控制

8

作者 葛远香 胡开明 《电子元器件应用》 2010年第3期14-16,19,共4页

为了消除FFT频谱泄漏和栅栏效应,提高谐波分析精度,文中给出了用高速A/D采集IPcore来实现电网数据实时采集的设计方法,同时采用数字锁相倍频同步方法进行了误差修正。其中全数字锁相倍频电路和A/D采集控制电路均采用VHDL语言和可编程逻... 为了消除FFT频谱泄漏和栅栏效应,提高谐波分析精度,文中给出了用高速A/D采集IPcore来实现电网数据实时采集的设计方法,同时采用数字锁相倍频同步方法进行了误差修正。其中全数字锁相倍频电路和A/D采集控制电路均采用VHDL语言和可编程逻辑器件设计实现,并用quartusII软件进行了仿真。 展开更多

关键词 FPGA 高速A/D采集 ipcore 数字锁相倍频

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关于Turbo code解码器实现的几种方案 被引量：1

9

作者 李景玉 贺秀峰 王华 《煤矿机械》 北大核心 2003年第8期61-64,共4页

介绍了Turbo码的基本结构 ,并从工程实现的角度提出了实现Turbo码解码器的几种方案 ,从DSP和FPGA实现以及使用专用芯片 (ASIC)几个方面进行了分析和比较 ,得出了随着Tur bo码应用的逐渐升温 。

关键词 Turbo码解码器 DSP FPGA ipcore

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基于IP Core的RS编译码器的设计与实现 被引量：1

10

作者 张琼 杜祖升 陈敬东 《舰船电子工程》 2008年第5期135-138,共4页

里德-索罗蒙码(Reed-Solomon,简称RS码)以其纠错能力强且实现简单的特点广泛应用于现代通信及计算机领域。在讨论RS码的编译码原理基础上,采用基于IP Core的方法,设计了RS(31,15)编译码器,并通过仿真及测试验证了设计的正确性。

关键词 RS码 ipcore Atlantic接口

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PicoBlaze处理器IP Core的原理与应用 被引量：7

11

作者 温广翔 徐欣 《单片机与嵌入式系统应用》 2003年第12期37-39,共3页

详细分析8位微处理器IPcorePicoBlaze的结构、原理与设计方法;介绍PicoBlaze的指令集和调试工具pblazeIDE,讨论PicoBlaze的编程方法和应用设计实例;列举几种PicoBlaze的应用方案。

关键词 8位微处理器 存储指令 算术逻辑单元 PicoBlaze处理器 ipcore

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基于FPGA中DDS IP核的设计应用 被引量：2

12

作者 苟玉玲 曾湘洪 《软件》 2021年第1期101-103,共3页

随着数字信号处理高速发展,直接数字频率合成(DDS)IP核在FPGA中应用越来越广,通过调用Vivado中IP核实现任意频率波形信号输出,集成度高且灵活性好。本文简要介绍DDS基本原理,设计DDS常用计算公式,描述了FPGA中DDSIP核使用,搭建测试环境,... 随着数字信号处理高速发展,直接数字频率合成(DDS)IP核在FPGA中应用越来越广,通过调用Vivado中IP核实现任意频率波形信号输出,集成度高且灵活性好。本文简要介绍DDS基本原理,设计DDS常用计算公式,描述了FPGA中DDSIP核使用,搭建测试环境,在Vivado环境下仿真测试,并验证产生波形信号的正确性。 展开更多

关键词 DDS FPGA VIVADO ipcore

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一种基于真随机序列和安全散列算法可靠加密FPGA设计的方法 被引量：1

13

作者 朱宇 《现代电子技术》 北大核心 2017年第7期78-80,84,共4页

FPGA在定制项目和具有设计重构需求的项目开发中广泛应用,随着硬件设计集成度不断提高,在一个FPGA设计中往往集成多个厂商提供的软核设计(IPCore),IPCore知识产权保护显得尤为重要。提出一种真随机序列与密钥结合,并通过安全散列算法加... FPGA在定制项目和具有设计重构需求的项目开发中广泛应用,随着硬件设计集成度不断提高,在一个FPGA设计中往往集成多个厂商提供的软核设计(IPCore),IPCore知识产权保护显得尤为重要。提出一种真随机序列与密钥结合,并通过安全散列算法加密验证,实现对FPGA设计中商用IPCore知识产权保护的方法。 展开更多

关键词 FPGA ipcore 真随机序列 安全散列算法

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基于FPGA的验证开发系统 被引量：2

14

作者 郑健 戎蒙恬 《集成电路应用》 2004年第4期62-64,共3页

本文介绍一种用于实现测试和验证的FPGA新的应用。利用FPGA可配置的传统优点,在同一个系统上完成各种电路板级功能验证,这是一个有效、简洁、低成本的开发工具。

关键词 FPGA 现场可编程门阵列 功能验证 ASIC SOC ipcore

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基于IP集成的RS码+DQPSK系统设计

15

作者 王亮 凌康 +2 位作者 张海亮 赵行波 周祖成 《微计算机信息》 北大核心 2007年第17期3-5,共3页

本文利用Altera公司开发的RS、NCO和FIR IP core以及Simulink、DSP_Builder中的模块快速搭建了一个RS(204,188)+DQPSK的低中频调制解调系统。分别在Simulink、Modelsim中验证了系统的功能,最后在Altera公司的Stratix II EP2S60DSP开发... 本文利用Altera公司开发的RS、NCO和FIR IP core以及Simulink、DSP_Builder中的模块快速搭建了一个RS(204,188)+DQPSK的低中频调制解调系统。分别在Simulink、Modelsim中验证了系统的功能,最后在Altera公司的Stratix II EP2S60DSP开发板中实现了该系统,并对系统进行了测试。试验结果表明DQPSK系统加入RS码后,在Pe=1e-3时,RS(204,188)编码可以带来3￣4dB的增益。 展开更多

关键词 ipcore 系统集成 FPGA 仿真测试

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基于SOPC的通用型JTAG调试器的设计

16

作者 马俊 雷航 《单片机与嵌入式系统应用》 2008年第7期25-28,共4页

设计并实现了一种基于SOPC的通用型JTAG调试器。在FPGA中加入特定CPU的JTAG调试IP-core,利用SOPC易于下载更新和可重用的特性,实现对多种嵌入式CPU的调试。采用了Altera公司的NiosII开发套件,并开发了针对ARM7TDMI的调试IPcore。

关键词 SOPC JTAG ipcore 通用型调试器

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基于SOPC处理器的嵌入式生物医学测量系统设计

17

作者 马国光 凌朝东 +1 位作者 李国刚 刘一平 《福建电脑》 2006年第12期24-25,共2页

本文介绍了以Nios II处理器为基础的SOPC设计,并通过以一个应用实例--Nios II软核处理器在生物医学测量系统中的应用来介绍IP Core的设计和Nios II硬件平台的定制、uClinux系统的移植、驱动程序和应用程序的设计,着重分析了Nios II系统... 本文介绍了以Nios II处理器为基础的SOPC设计,并通过以一个应用实例--Nios II软核处理器在生物医学测量系统中的应用来介绍IP Core的设计和Nios II硬件平台的定制、uClinux系统的移植、驱动程序和应用程序的设计,着重分析了Nios II系统下用户自定义逻辑的设计和DMA流传输在设计中的应用。 展开更多

关键词 SOPC ipcore UCLINUX DMA 生物医学测量系统

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基于FPGA的CCD相机的图像采集

18

作者 刘建基 杨德贵 《电脑知识与技术》 2008年第6期1335-1336,1367,共3页

介绍在特定环境下CCD相机图像数据的采集背景下的一种基于FPGA的高速图像数据采集板卡设计方法，详细讨论了其系统结构和核心部分的内部功能模块，并给出了其核心：PCI IPcore的具体仿真结果。同时探讨了此板卡和外部的接口实现问题。

关键词 CAMERA Link 双端口 RAM PCI ipcore DMA

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TCP/IP通信技术在Xilinx FPGA上的实现 被引量：4

19

作者 鲍兴川 《水利水文自动化》 2007年第2期20-22,46,共4页

研究了TCP/IP通信协议栈在Xilinx公司现场可编程门阵列FPGA上的实现,介绍了其软硬件的系统组成和原理,提出一种不需操作系统的TCP/IP协议栈的高效工作模式,并在Spartan 3 FPGA上移植成功,通过建立测试平台进行测试,证明其工作方式具有... 研究了TCP/IP通信协议栈在Xilinx公司现场可编程门阵列FPGA上的实现,介绍了其软硬件的系统组成和原理,提出一种不需操作系统的TCP/IP协议栈的高效工作模式,并在Spartan 3 FPGA上移植成功,通过建立测试平台进行测试,证明其工作方式具有更高的通信性能,为水利水电自动化系统设备开发提供新的思路。 展开更多

关键词 TCP/IP 通信技术 FPGA SPARTAN 3E ipcore MICROBLAZE

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基于改进小波变换的信号符号率估计的FPGA硬件实现

20

作者 郭晶 《兰州教育学院学报》 2013年第6期107-109,共3页

连续小波变换由于具有良好的时频分析能力而广泛应用于信号特征分析,同时也由于较大的运算量而影响了其在工程上的运用。FPGA每个IPCore在硬件运算的时候,都必须要考虑其流水时的延时问题,必须相应地在信号输出端加入高倍时钟。这样在... 连续小波变换由于具有良好的时频分析能力而广泛应用于信号特征分析,同时也由于较大的运算量而影响了其在工程上的运用。FPGA每个IPCore在硬件运算的时候,都必须要考虑其流水时的延时问题,必须相应地在信号输出端加入高倍时钟。这样在设计中就采用了两个时钟,这会影响系统的时钟同步,而且也会增加时钟分频的复杂度,并占用大量的芯片资源。针对以上问题,对Morlet小波函数和FPGA系统进行了相应的更改,采用FIR滤波器结构实现小波变换。仿真结果表明,采用改进小波变换的FPGA系统实际占用芯片资源量有所减少,在信号符号率估计性能方面并没有下降,并且运算效率大大提高了。 展开更多

关键词 MORLET小波 FPGA ipcore 符号率估计

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