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基于ASIC的H.264编码器设计及其ADSP验证策略
1
作者
汪毅
林祖伦
《中国集成电路》
2007年第11期55-59,共5页
提出了H.264/AVC硬件编码器的一种3级流水结构,以此来提高硬件加速电路的处理能力和利用效率。鉴于H.264编码芯片验证的复杂性,还提出了一种基于ADSP-BF537的新型多媒体SoC验证平台,并讨论了如何利用BF537,对H.264编码芯片进行全面、高...
提出了H.264/AVC硬件编码器的一种3级流水结构,以此来提高硬件加速电路的处理能力和利用效率。鉴于H.264编码芯片验证的复杂性,还提出了一种基于ADSP-BF537的新型多媒体SoC验证平台,并讨论了如何利用BF537,对H.264编码芯片进行全面、高效的软硬件协同验证。
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关键词
H.264编码器
硬件加速器
adsp-bf5
37
软硬件协同验证
SoC
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职称材料
题名
基于ASIC的H.264编码器设计及其ADSP验证策略
1
作者
汪毅
林祖伦
机构
电子科技大学光电信息学院
出处
《中国集成电路》
2007年第11期55-59,共5页
文摘
提出了H.264/AVC硬件编码器的一种3级流水结构,以此来提高硬件加速电路的处理能力和利用效率。鉴于H.264编码芯片验证的复杂性,还提出了一种基于ADSP-BF537的新型多媒体SoC验证平台,并讨论了如何利用BF537,对H.264编码芯片进行全面、高效的软硬件协同验证。
关键词
H.264编码器
硬件加速器
adsp-bf5
37
软硬件协同验证
SoC
Keywords
H.264 video encoder
Hardware accelerator
adsp-bf5
37
Software/hardware co-verification
SoC
分类号
TN762 [电子电信—电路与系统]
TN492 [电子电信—微电子学与固体电子学]
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职称材料
题名
作者
出处
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1
基于ASIC的H.264编码器设计及其ADSP验证策略
汪毅
林祖伦
《中国集成电路》
2007
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