基于时序电路的移位相加型8位硬件乘法器设计被引量：1

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摘要由八位加法器构成的以时序逻辑方式设计的八位乘法器,具有一定的实用价值,而且由FPGA构成实验系统后,可以很容易的用ASIC大型集成芯片来完成,性价比高,可操作性强。

作者吴桂军雷勇

机构地区重庆工程职业技术学院电子工程与自动化系

出处《科技信息》 2011年第31期81-81,共1页 Science & Technology Information

关键词时序电路移位乘法器

同被引文献2

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科技信息

2011年第31期

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