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基于RISC-V嵌入式指令集的处理器核实现与仿真实验设计
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作者 李秀滢 鄂佳言 武秀云 《北京电子科技学院学报》 2025年第4期147-158,共12页
面向国家集成电路产业的战略需求与新工科的人才培养目标,传统EDA实践教学在培养学生系统级设计与验证能力方面暴露了诸多局限。为解决传统EDA教学中处理器核设计实践缺失、项目工程复杂度不足、学生系统级设计与验证能力培养欠缺等问题... 面向国家集成电路产业的战略需求与新工科的人才培养目标,传统EDA实践教学在培养学生系统级设计与验证能力方面暴露了诸多局限。为解决传统EDA教学中处理器核设计实践缺失、项目工程复杂度不足、学生系统级设计与验证能力培养欠缺等问题,本文设计并实践了一套基于开源RISC-V指令集的处理器核的硬件实现与仿真实验案例。通过将开源指令集架构与前沿仿真技术引入实验教学,设计了贯穿微架构实现到全流程验证的综合性项目,并搭建了基于Verilator的仿真平台。该案例旨在激发学生对处理器底层工作原理的探索兴趣,提升其系统建模、工程实现与调试分析的综合能力,对于为我国集成电路产业培养具备核心设计能力的创新型人才具有重要的实践意义。 展开更多
关键词 RISC-V 处理器核设计 实验教学案例
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智能应用处理器SoC芯片的多核架构协同设计与性能分析
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作者 丁然 《软件》 2025年第8期155-157,共3页
随着智能应用对处理器性能需求的快速提升,传统单核处理器已无法满足大规模并行计算与实时响应的需求。本文聚焦智能应用处理器SoC芯片的多核架构设计,探讨硬件与软件的协同优化策略,涵盖多核互联、缓存管理、任务调度及功耗控制等方面... 随着智能应用对处理器性能需求的快速提升,传统单核处理器已无法满足大规模并行计算与实时响应的需求。本文聚焦智能应用处理器SoC芯片的多核架构设计,探讨硬件与软件的协同优化策略,涵盖多核互联、缓存管理、任务调度及功耗控制等方面。通过引入动态负载均衡、缓存一致性优化、核间通信协议改进和动态电压频率调节等技术手段,实现了多核架构下性能显著提升和能效优化。 展开更多
关键词 智能应用处理器 SOC芯片 多核架构 协同设计 优化
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基于STM32的机载燃油计算机设计与实现 被引量:3
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作者 茹常剑 景博 吴桂胜 《计算机工程与科学》 CSCD 北大核心 2012年第1期154-158,共5页
针对我国现役战机电容式燃油测量系统测量精度低、维护保障问题突出、故障率较高的缺点以及对新型战机发展的需要,采用嵌入式设计理念构建基于STM32微处理器的燃油计算机,实现对燃油系统的综合管理。首先提出了核心处理板+外围电路的燃... 针对我国现役战机电容式燃油测量系统测量精度低、维护保障问题突出、故障率较高的缺点以及对新型战机发展的需要,采用嵌入式设计理念构建基于STM32微处理器的燃油计算机,实现对燃油系统的综合管理。首先提出了核心处理板+外围电路的燃油计算机的总体设计方案,然后重点阐述了基于STM32微处理器的核心处理板和基于CPLD的信号转换板、继电器控制信号输出板的外围电路的硬件设计,编写了自动液面控制、CPLD串口通信和429总线数据收发的应用程序;最后给出了系统的实物图并对其进行了测试。测试结果表明,燃油计算机设计是可行的,该燃油计算机的构建将对提高燃油测量精度和系统维护保障性具有十分重要的现实意义。 展开更多
关键词 燃油测量系统 STM32微处理器 硬件设计 核心处理板 外围电路 软件设计
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基于动态优先级的核心处理安全分区优化设计 被引量:3
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作者 何锋 顾健 熊华钢 《北京航空航天大学学报》 EI CAS CSCD 北大核心 2011年第10期1282-1287,共6页
在分区管理模型应用于航空电子核心处理系统的研究中,合理的分区参数设计是保障航空电子系统任务关键和安全关键的一个重要因素.在标准模型的基础上,建立了上层调度器采用动态优先级调度策略的分区管理模型;通过对处理器忙周期进行考察... 在分区管理模型应用于航空电子核心处理系统的研究中,合理的分区参数设计是保障航空电子系统任务关键和安全关键的一个重要因素.在标准模型的基础上,建立了上层调度器采用动态优先级调度策略的分区管理模型;通过对处理器忙周期进行考察,提出了给定请求时间长度下分区最大抢占影响的计算算法,能从微观的角度解释动态优先级下原子时间抢占行为的影响;通过对分区内任务集的计算负载进行计算,并考虑到计算负载在分区最后一次执行时间内的请求执行时间长度带来的抢占影响,得到了下层调度器采用固定优先级和动态优先级策略下的分区安全设计方法;通过计算仿真评估,结果表明提出的安全分区设计方法比基于虚拟处理资源方法具有更优的设计结果. 展开更多
关键词 航空系统工程 核心处理 安全关键 分区设计 动态优先级
原文传递
一种多核处理器直连接口QoS的设计与验证 被引量:4
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作者 罗莉 周宏伟 +3 位作者 周理 潘国腾 周海亮 刘彬 《计算机工程与科学》 CSCD 北大核心 2021年第4期620-627,共8页
多核处理器直接互连构建多路并行系统,一直是提高高性能计算机并行性的主要方式。主要研究多核处理器直连接口的QoS设计,通过直连接口完成跨芯片的Cache一致性报文有效、可靠传输,实现共享主存的SMP系统。详细阐述了直连接口各个协议层... 多核处理器直接互连构建多路并行系统,一直是提高高性能计算机并行性的主要方式。主要研究多核处理器直连接口的QoS设计,通过直连接口完成跨芯片的Cache一致性报文有效、可靠传输,实现共享主存的SMP系统。详细阐述了直连接口各个协议层的QoS设计的关键技术,基于UVM方法学构建了可重用验证平台,模拟验证了QoS设计的正确性,移植到FPGA原型验证平台,顺利通过了测试。深入研究和实现处理器芯片直连技术,是提升高性能多路服务器的主流方向,具有良好的应用和研究前景。 展开更多
关键词 多核处理器直连接口 SMP系统 QoS设计 UVM验证
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SystemC建模在多核处理器设计中的应用 被引量:3
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作者 许汉荆 陈杰 +2 位作者 刘建 敖天勇 奚杰 《国外电子测量技术》 2009年第6期75-78,共4页
"同芯Ⅳ"是中国科学院微电子研究所通信与多媒体SOC实验室设计的一款多核异构处理器。本文将电子系统级(Electronic System Level,ESL)设计方法成功应用于该处理器SOC设计,通过SystemC对系统关键单元MIPS处理器建模,利用Visua... "同芯Ⅳ"是中国科学院微电子研究所通信与多媒体SOC实验室设计的一款多核异构处理器。本文将电子系统级(Electronic System Level,ESL)设计方法成功应用于该处理器SOC设计,通过SystemC对系统关键单元MIPS处理器建模,利用Visual Studio和Modelsim等工具进行软硬件协同设计、验证。实践证明利用SystemC模型进行软硬件协同设计有效提高了开发并行度,缩短开发周期,为验证和性能优化提供了详尽的参考数据,简化了调试。 展开更多
关键词 SystemC建模 多核处理器 软硬件协同设计
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多边形填充硬件算法的研究与实现 被引量:5
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作者 刘洋 李庆诚 白振轩 《天津师范大学学报(自然科学版)》 CAS 北大核心 2010年第1期19-22,共4页
提出一种多边形填充的硬件算法,并通过在Xilinx公司生产的Vertex2 Pro实验板上进行验证,证明该算法的可行性及其良好高效性.
关键词 多边形填充算法 硬件加速算法 协处理IP核 VERILOG语言 嵌入式开发套件(EDK)
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面向大数据应用的众核处理器缓存结构设计 被引量:3
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作者 万虎 徐远超 +1 位作者 孙凤芸 闫俊峰 《计算机工程与科学》 CSCD 北大核心 2015年第1期28-35,共8页
大规模数据排序、搜索引擎、流媒体等大数据应用在面向延迟的多核/众核处理器上运行时资源利用率低下,一级缓存命中率高,二级/三级缓存命中率低,LLC容量的增加对IPC的提升并不明显。针对缓存资源利用率低的问题,分析了大数据应用的访存... 大规模数据排序、搜索引擎、流媒体等大数据应用在面向延迟的多核/众核处理器上运行时资源利用率低下,一级缓存命中率高,二级/三级缓存命中率低,LLC容量的增加对IPC的提升并不明显。针对缓存资源利用率低的问题,分析了大数据应用的访存行为特点,提出了针对大数据应用的两种众核处理器缓存结构设计方案,两种结构均只有一级缓存,Share结构为完全共享缓存,Partition结构为部分共享缓存。评估结果表明,两种方案在访存延迟增加不多的前提下能大幅节省芯片面积,其中缓存容量较低时,Partition结构优于Share结构,缓存容量较高时,Share结构要逐渐优于Partition结构。由于众核处理器中分配到每个处理器核的容量有限,因此Partition结构有一定的优势。 展开更多
关键词 众核处理器 大数据应用 缓存设计 访存行为 数据中心
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DE1-SoC开发平台上的图像采集系统设计 被引量:3
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作者 邓海涛 吴捷 +2 位作者 李建辉 潘国成 陈耀文 《单片机与嵌入式系统应用》 2017年第1期44-46,共3页
本文详细介绍了基于Altera片上系统FPGA的嵌入式系统的设计方法,包括基于Qsys的系统硬件设计和基于片上系统EDS嵌入式软件设计。该设计采用Altera公司提供的soc_training image镜像内核文件,写入外存SD卡中,进行启动Linux操作系统,在QSY... 本文详细介绍了基于Altera片上系统FPGA的嵌入式系统的设计方法,包括基于Qsys的系统硬件设计和基于片上系统EDS嵌入式软件设计。该设计采用Altera公司提供的soc_training image镜像内核文件,写入外存SD卡中,进行启动Linux操作系统,在QSYS中构建所需的硬件模块,在EDS开发套件平台上编写应用软件程序,最后通过板级验证实现系统功能。该系统通过FPGA的Video-in接口,实现了图像的捕捉功能,并存入到外设SD卡。 展开更多
关键词 嵌入式设计 FPGA 硬核处理器 图像采集
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基于模型树的多核设计空间探索技术 被引量:2
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作者 郭崎 陈天石 陈云霁 《计算机辅助设计与图形学学报》 EI CSCD 北大核心 2012年第6期710-720,共11页
处理器设计面临的重要挑战是如何在庞大的设计空间中高效地找到满足约束的设计结构,而预测模型方法是探索复杂设计空间的重要方法.为了提高预测模型的实用性,提出一种基于模型树的多核设计空间探索技术.首先对整个设计空间中部分设计结... 处理器设计面临的重要挑战是如何在庞大的设计空间中高效地找到满足约束的设计结构,而预测模型方法是探索复杂设计空间的重要方法.为了提高预测模型的实用性,提出一种基于模型树的多核设计空间探索技术.首先对整个设计空间中部分设计结构进行采样模拟,然后通过模型树算法构建设计参数与处理器响应之间的预测模型,最后通过该模型预测出其他设计结构的响应以找到满足约束的最优设计.实验结果表明,与现有的基于支持向量机和人工神经网络的预测模型技术相比,针对性能预测,采用文中技术能够提高74.87%和38.87%的准确度;针对能耗预测,能够提高2.66%和16.82%的准确度. 展开更多
关键词 设计空间探索 多核处理器 预测模型 模型树
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同步语言的时间可预测多线程代码生成方法 被引量:9
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作者 杨志斌 赵永望 +4 位作者 黄志球 胡凯 马殿富 Jean-Paul BODEVEIX Mamoun FILALI 《软件学报》 EI CSCD 北大核心 2016年第3期611-632,共22页
能够提供更强计算能力的多核处理器将在安全关键系统中得到广泛应用,但是由于现代处理器所使用的流水线、乱序执行、动态分支预测、Cache等性能提高机制以及多核之间的资源共享,使得系统的最坏执行时间分析变得非常困难.为此,国际学术... 能够提供更强计算能力的多核处理器将在安全关键系统中得到广泛应用,但是由于现代处理器所使用的流水线、乱序执行、动态分支预测、Cache等性能提高机制以及多核之间的资源共享,使得系统的最坏执行时间分析变得非常困难.为此,国际学术界提出时间可预测系统设计的思想,以降低系统的最坏执行时间分析难度.已有研究主要关注硬件层次及其编译方法的调整和优化,而较少关注软件层次,即,时间可预测多线程代码的构造方法以及到多核硬件平台的映射.提出一种基于同步语言模型驱动的时间可预测多线程代码生成方法,并对代码生成器的语义保持进行证明;提出一种基于AADL(architecture analysis and design language)的时间可预测多核体系结构模型,作为研究的目标平台;最后,给出多线程代码到多核体系结构模型的映射方法,并给出系统性质的分析框架. 展开更多
关键词 安全关键系统 多核处理器 时间可预测 同步语言 AADL(architecture analysis and design language)
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用于三维堆叠芯片的通用网络服务片设计
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作者 吴际 谢冬青 唐琳 《系统仿真学报》 CAS CSCD 北大核心 2014年第11期2727-2733,共7页
在三维集成技术中,让制造检测好的已知合格片在不同的三维芯片设计中复用可有效降低成本。设计了一种采用通用网络服务片(GNSD)来构建三维片上网络的通用网络(GNet),并以一个64核处理器为实验对象,分别采用传统的三维片上网络设计中成... 在三维集成技术中,让制造检测好的已知合格片在不同的三维芯片设计中复用可有效降低成本。设计了一种采用通用网络服务片(GNSD)来构建三维片上网络的通用网络(GNet),并以一个64核处理器为实验对象,分别采用传统的三维片上网络设计中成本驱动的设计和性能驱动的设计,和采用GNet的设计来实现该处理器。对3种设计进行仿真,对比其吞吐率、时延、功耗及成本,证明GNet不仅仅在成本上有突出的优势,在性能上也优于传统的三维设计。 展开更多
关键词 三维芯片 三维片上网络 网络性能分析 众核处理器设计
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基于Altera SoC FPGA的图像采集系统设计 被引量:6
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作者 聂永军 徐光辉 郑国建 《单片机与嵌入式系统应用》 2016年第4期56-59,共4页
该设计利用Altera公司的DE1-SoC开发板和友晶科技的D5M模块实现了基于SoC FPGA的图像采集系统。详细介绍了基于Altera SoC FPGA的嵌入式系统设计方法,包括基于Qsys的系统硬件设计和基于SoC EDS开发套件的ARM硬核处理器软件设计。该设计... 该设计利用Altera公司的DE1-SoC开发板和友晶科技的D5M模块实现了基于SoC FPGA的图像采集系统。详细介绍了基于Altera SoC FPGA的嵌入式系统设计方法,包括基于Qsys的系统硬件设计和基于SoC EDS开发套件的ARM硬核处理器软件设计。该设计在Altera公司提供的可以正常运行Linux操作系统的参考设计的基础上,添加了所需要的硬件模块和应用软件,最后通过板级验证实现了系统功能。 展开更多
关键词 嵌入式设计 图像采集 SoCFPGA 硬核处理器 操作系统
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多核处理器功耗优化与评估技术发展综述 被引量:1
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作者 邢立冬 《电子设计工程》 2014年第12期100-103,共4页
多核处理器已经成为当前处理器设计的主流,其并行处理能力显著提高了处理器的性能,同时,多核处理器本身的高度集成度也使其功耗显著上升,从而在一定程度上限制了多核处理器的发展。本文描述了低功耗设计的基本理论、常用的低功耗设计技... 多核处理器已经成为当前处理器设计的主流,其并行处理能力显著提高了处理器的性能,同时,多核处理器本身的高度集成度也使其功耗显著上升,从而在一定程度上限制了多核处理器的发展。本文描述了低功耗设计的基本理论、常用的低功耗设计技术和多核处理器中的功耗评估技术,并分析和总结了低功耗多核处理器研究的最新进展,可为多核处理器的设计提供有益的参考。 展开更多
关键词 多核处理器 并行处理 低功耗设计 功耗评估
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基于事件驱动的新型处理器的研究与应用 被引量:1
15
作者 韩琳 潘登 《现代电子技术》 2012年第8期5-7,共3页
针对现代电子设计低成本、高效率、高灵活性的特点,研究了一种新型的处理器:事件驱动多核心处理器。通过对这种处理器基本构架的研究,以及采用新型处理器与采用传统控制器设计差异的对比,分析出该处理器具有性能高、实时性强、易编程等... 针对现代电子设计低成本、高效率、高灵活性的特点,研究了一种新型的处理器:事件驱动多核心处理器。通过对这种处理器基本构架的研究,以及采用新型处理器与采用传统控制器设计差异的对比,分析出该处理器具有性能高、实时性强、易编程等优点。最后,提出了一种新的设计方法:硬件设计软件化,给众多电子系统设计提供新的思路和参考。 展开更多
关键词 XMOS 事件驱动多核心处理器 硬件线程 硬件设计软件化
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弹载小型化高速信号处理机设计方案 被引量:1
16
作者 庄跃迁 《电讯技术》 北大核心 2015年第3期286-290,共5页
弹载处理机受特殊的平台功能、环境条件等因素制约,具有高性能、小型化等特点。弹载小型化高速信号处理机采用基于多通道宽带采样技术和多核心高速并行处理技术的设计方案,解决了高速高密度小型化电路设计和高速浮点数字信号处理器(DSP... 弹载处理机受特殊的平台功能、环境条件等因素制约,具有高性能、小型化等特点。弹载小型化高速信号处理机采用基于多通道宽带采样技术和多核心高速并行处理技术的设计方案,解决了高速高密度小型化电路设计和高速浮点数字信号处理器(DSP)多核心协同工作两大关键技术,并在不影响处理机实时性的前提下,设计出了一种基于嵌入式操作系统设计理念的多核心协同工作框架软件。弹载处理机可满足弹载多领域的功能和指标需求。 展开更多
关键词 弹载处理机 小型化设计 数字信号处理器 多核心协同
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基于MicroBlaze软核处理器的Bootloader设计 被引量:5
17
作者 戴岳 苗长云 荣锋 《工矿自动化》 2009年第11期20-23,共4页
文章介绍了基于MicroBlaze软核处理器的Bootloader程序的设计,详细介绍了适用该程序的FPGA嵌入式系统的硬件配置及Bootloader程序设计的硬件逻辑设计流程和软件设计流程。该程序是在FPGA硬件配置完毕之后,在内部处理器上运行的一段启动... 文章介绍了基于MicroBlaze软核处理器的Bootloader程序的设计,详细介绍了适用该程序的FPGA嵌入式系统的硬件配置及Bootloader程序设计的硬件逻辑设计流程和软件设计流程。该程序是在FPGA硬件配置完毕之后,在内部处理器上运行的一段启动代码,用来将FLASH中的用户程序传输至外部RAM,并引导嵌入式系统从用户程序中开始运行。它解决了使用大规模复杂应用程序的嵌入式系统的引导问题,已在实际中应用,具有良好的适应性。 展开更多
关键词 嵌入式系统 BOOTLOADER程序 MicroBlaze软核处理器 硬件逻辑设计 软件设计 FPGA SPI FLASH
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高性能嵌入式处理器技术 被引量:3
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作者 赖铭强 聂新义 段国东 《计算机工程》 CAS CSCD 北大核心 2009年第14期280-282,共3页
介绍面向分布式集群计算机的高性能嵌入式处理器产业链,分析该产业链中CPU核提供商、处理器芯片开发商、系统软件提供商、嵌入式计算机制造商等各个环节的技术特点,并在高性能嵌入式处理器开发上做了有益的探索。提出要积极与系统软件... 介绍面向分布式集群计算机的高性能嵌入式处理器产业链,分析该产业链中CPU核提供商、处理器芯片开发商、系统软件提供商、嵌入式计算机制造商等各个环节的技术特点,并在高性能嵌入式处理器开发上做了有益的探索。提出要积极与系统软件、嵌入式计算机制造商协作,充分发挥软硬件协同设计能力,以开发出面向分布式集群计算机的高性能嵌入式处理器。进一步指出多核设计与高速总线电路是高性能嵌入式处理器发展的未来之路。 展开更多
关键词 分布式集群计算机 高性能嵌入式处理器 多核设计 高速总线电路
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基于S12X系列双核单片机的Flexray-CAN总线网关的设计与实现 被引量:16
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作者 豆海利 陈晓飞 +1 位作者 杨寒 冯源 《现代电子技术》 北大核心 2019年第18期22-26,31,共6页
采用集成外设协处理器XGATE内核的16位双核单片机MC9S12XEP100作为主控制器,设计并实现了可以连接2路CAN总线和1路双通道Flexray总线的Flexray-CAN网关.采用ADI公司的信号和电源隔离集成器件,在满足产品小型化、低功耗、低成本的基础上... 采用集成外设协处理器XGATE内核的16位双核单片机MC9S12XEP100作为主控制器,设计并实现了可以连接2路CAN总线和1路双通道Flexray总线的Flexray-CAN网关.采用ADI公司的信号和电源隔离集成器件,在满足产品小型化、低功耗、低成本的基础上,实现了CAN和Flexray总线接口的电气隔离,增强了通信接口的抗干扰能力.通过双核处理技术来优化网关的处理流程,从而避免了各种外设中断与网关的协议处理和消息转发间的冲突.实际应用表明,系统运行稳定可靠,与传统的采用单处理器实现的网关相比,网关的数据吞吐能力和实时性得到了明显改善. 展开更多
关键词 无人机 Flexray-CAN网关 协处理器XGATE 双核单片机 网关硬件设计 电气隔离 中断处理
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航空电子核心处理分区优化设计及仿真研究
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作者 宋丽茹 谷晓燕 +1 位作者 陈沫 董智明 《电光与控制》 北大核心 2011年第12期25-30,共6页
具有严格实时保障和安全保障的航空电子核心处理系统广泛采用分区管理技术,通过分层调度结构,满足任务时空隔离运行。通过将分区抢占行为看作是一个虚拟周期任务,针对下层调度器分别采用固定优先级和动态优先级两种调度策略,讨论了分区... 具有严格实时保障和安全保障的航空电子核心处理系统广泛采用分区管理技术,通过分层调度结构,满足任务时空隔离运行。通过将分区抢占行为看作是一个虚拟周期任务,针对下层调度器分别采用固定优先级和动态优先级两种调度策略,讨论了分区调度设计问题;利用分区任务调度的空闲时间构建分区调度保障条件,给出了满足任务可调度性的分区参数求解表达式;在利用任务最大响应时间延迟率和分区切换开销的基础上,给出了分区参数优化设计方法;最后讨论了核心处理系统仿真方法,给出了仿真引擎设计模型。 展开更多
关键词 航空电子 核心处理 分区设计 仿真模型
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