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面向卷积神经网络权重量化的并行Huffman解码硬件优化研究
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作者 王少军 蔡权雄 +1 位作者 李远超 牛昕宇 《信息与电脑》 2025年第23期39-41,共3页
为解决卷积神经网络推理过程中权重数据带宽占用高、解码延迟大的问题,文章提出了一种面向权重量化的并行哈夫曼(Huffman)解码硬件优化方法,设计了可插入分隔符的变长编码格式,构建了支持并行解码的改进型Huffman二叉树,并引入了查找表... 为解决卷积神经网络推理过程中权重数据带宽占用高、解码延迟大的问题,文章提出了一种面向权重量化的并行哈夫曼(Huffman)解码硬件优化方法,设计了可插入分隔符的变长编码格式,构建了支持并行解码的改进型Huffman二叉树,并引入了查找表机制。硬件结构采用多点并行解码单元与乒乓缓冲架构,满足了每周期64点的输出要求。实验结果表明,该方案在保证压缩率的同时,显著提升了解码吞吐量,降低了系统延迟与面积资源消耗。 展开更多
关键词 卷积神经网络 权重量化 HUFFMAN编码 并行解码 乒乓缓冲架构
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基于整型提升小波变换的图像处理及DSP实现 被引量:25
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作者 陈升来 黄廉卿 郭静寰 《光学精密工程》 EI CAS CSCD 北大核心 2006年第3期498-502,共5页
针对数字信号处理器(DSP)的并行特性,提出了一种二维整型提升小波的并行体系结构。该结构采用乒乓缓存策略,使得数据的传输和小波变换能够同时进行;用基于行的列变换方法使得列变换只需少量行变换结果就能进行列变换;用移位操作代替乘... 针对数字信号处理器(DSP)的并行特性,提出了一种二维整型提升小波的并行体系结构。该结构采用乒乓缓存策略,使得数据的传输和小波变换能够同时进行;用基于行的列变换方法使得列变换只需少量行变换结果就能进行列变换;用移位操作代替乘法操作,大大减少了算法的运算量。整个结构采用流水线设计,提高了硬件资源的利用率和降低了算法的中间存储量,实现了图像的实时小波变换。实验证明,该算法与原算法相比,速度提高了15倍,达到了每秒85帧;重构图像的峰值信噪比(PSNR)虽然比离散小波变换要低一些,但仍达到了42 dB以上,因此该算法具有广阔的应用前景。 展开更多
关键词 DSP 提升小波 乒乓缓存 小波变换 图像处理
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NSRL电子储存环新RFKO系统 被引量:4
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作者 阴泽杰 李为民 +1 位作者 吴孝义 钱卫明 《核电子学与探测技术》 CAS CSCD 北大核心 2001年第3期173-175,192,共4页
介绍了合肥国家同步辐射室 ( NSRL )最新研制的电子储存环高频剔除 ( RFKO)系统的原理、结构和实验结果。利用 RFKO系统能够对 NSRL电子储存环的填充模式进行远程数控调节 。
关键词 高频剔除 乒乓缓冲 高速模拟开关 合肥国家同步辐射室 电子储存环 RFKO系统
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基于DSP和ADS8509的煤矸石振动信号实时采集 被引量:6
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作者 刘伟 王汝琳 +2 位作者 张守祥 闫玉华 张岩 《煤矿机械》 北大核心 2009年第7期197-199,共3页
以实际项目研究为背景,介绍了一种基于新型串行A/D转换芯片ADS8509与DSP的振动信号采集方案。ADS8509输出数据采用与SPI总线协议兼容的工作模式,能与DSP的片上外设McBSP串口直接相连,避免了并行总线冲突。采用DMA和乒乓缓冲机制实现McBS... 以实际项目研究为背景,介绍了一种基于新型串行A/D转换芯片ADS8509与DSP的振动信号采集方案。ADS8509输出数据采用与SPI总线协议兼容的工作模式,能与DSP的片上外设McBSP串口直接相连,避免了并行总线冲突。采用DMA和乒乓缓冲机制实现McBSP与内存之间的数据块传输。现场测试表明,该方案实现了高速振动信号采集与传输,运行稳定可靠,具备较强通用性。 展开更多
关键词 A/D转换 数据采集 乒乓缓冲
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基于FPGA和USB接口的内燃机数据采集系统设计 被引量:4
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作者 汤东 张明 《仪表技术与传感器》 CSCD 北大核心 2015年第3期53-55,共3页
针对传统内燃机数据采集系统采用ISA、PCI卡插卡等固定方式对内燃机工作过程进行数据采集和分析,提出一种即插即用便携式的内燃机测量系统。系统使用FPGA作为主控芯片,实现对A/D转换芯片的控制,双SRAM构成乒乓缓存器的控制以及对USB芯... 针对传统内燃机数据采集系统采用ISA、PCI卡插卡等固定方式对内燃机工作过程进行数据采集和分析,提出一种即插即用便携式的内燃机测量系统。系统使用FPGA作为主控芯片,实现对A/D转换芯片的控制,双SRAM构成乒乓缓存器的控制以及对USB芯片读写控制。通过USB驱动程序和VB6.0实现上位机数据处理与储存的功能。 展开更多
关键词 ADS8364 USB接口 FPGA 内燃机数据采集 双SRAM乒乓缓存器
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嵌入式Linux系统下音频驱动程序的设计 被引量:2
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作者 孟祥岳 孔令通 +2 位作者 张文明 李明娟 钱紫娟 《电视技术》 北大核心 2013年第S2期480-481,484,共3页
设计实现了嵌入式Linux系统下的音频驱动程序,该驱动程序采用多通道DMA传输以及乒乓缓冲区的传输模式,支持音频的播放和录音功能。同时,该驱动程序能够根据采样频率自动调整缓冲区的大小和数量,从而提高了音频处理的实时性能。
关键词 LINUX DMA传输 乒乓缓冲区 音频驱动 实时性
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高光谱红外成像系统的乒乓缓存设计 被引量:2
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作者 周阳 杨宏海 +1 位作者 刘勇 傅强 《宇航计测技术》 CSCD 2017年第2期1-4,共4页
通过比较三种常用缓存方式的异同,介绍了高光谱成像系统中一种协调数据传输与处理速度的乒乓缓存结构,讨论了乒乓缓冲结构的运行和控制原理。以高速大容量的SRAM以及高性能FPGA器件为平台,设计了一种适应于高光谱成像数据处理系统的乒... 通过比较三种常用缓存方式的异同,介绍了高光谱成像系统中一种协调数据传输与处理速度的乒乓缓存结构,讨论了乒乓缓冲结构的运行和控制原理。以高速大容量的SRAM以及高性能FPGA器件为平台,设计了一种适应于高光谱成像数据处理系统的乒乓缓存结构,并进行RTL仿真和板级验证。实验表明,该方案可以高效完成大量实时视频数据的缓冲和处理,有效提高了系统工作效率,且稳定可靠。 展开更多
关键词 高光谱成像 乒乓 缓冲存储器 FPGA
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基于DDR2SDRAM乒乓双缓冲的高速数据收发系统设计 被引量:7
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作者 刘杰 赛景波 《电子器件》 CAS 北大核心 2015年第3期650-654,共5页
在高速数据收发系统设计中,首先需要解决的问题是实时数据的高速缓存,然而FPGA内部有限的存储资源无法满足海量数据缓存的要求。为了解决系统中海量数据的缓存问题,系统创新提出了一种基于DDR2 SDRAM的乒乓双缓冲设计方案。方案设计了... 在高速数据收发系统设计中,首先需要解决的问题是实时数据的高速缓存,然而FPGA内部有限的存储资源无法满足海量数据缓存的要求。为了解决系统中海量数据的缓存问题,系统创新提出了一种基于DDR2 SDRAM的乒乓双缓冲设计方案。方案设计了两路基于DDR2 SDRAM的大容量异步FIFO,通过FPGA内部选择逻辑实现两条通路间的乒乓操作,从而实现数据的高速缓存。实验结果表明,基于DDR2 SDRAM的数据收发系统实现了每路512 Mbit的缓存空间和200 MHz的总线速率,解决了海量数据的高速缓存问题。 展开更多
关键词 高速数据收发 乒乓双缓冲 DDR2 SDRAM技术 异步FIFO
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一种多路车载信息传感器数据的传输设计 被引量:1
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作者 李圣昆 郑永秋 +1 位作者 史赟 刘东海 《计算机测量与控制》 CSCD 北大核心 2012年第3期856-858,861,共4页
为实时接收和记录多路车载信息传感器的数据,设计了以C8051F060单片机为核心控制器,TJA1050为外围CAN驱动器的多路CAN总线数据(包括温度、湿度、压力)接收电路,并通过SPI接口将数据传输到上位机;在程序设计上,给出了在开辟二级缓存下的... 为实时接收和记录多路车载信息传感器的数据,设计了以C8051F060单片机为核心控制器,TJA1050为外围CAN驱动器的多路CAN总线数据(包括温度、湿度、压力)接收电路,并通过SPI接口将数据传输到上位机;在程序设计上,给出了在开辟二级缓存下的可变长度帧结构的传输设计;测试表明,该设计对10路CAN总线数据以500k的速率进行传输,工作稳定、可靠,数据接收正确,可变长度帧结构编码无误,实现了多路CAN总线数据的接收、编帧和传输。 展开更多
关键词 CAN总线 C8051F060 SPI接口 数据编帧 乒乓缓存
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H.264/AVC编码器在TMS320DM6437上的EDMA优化 被引量:1
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作者 崔遥 赵锴 +1 位作者 崔慧娟 唐昆 《电视技术》 北大核心 2010年第9期38-40,共3页
分析了基于TMS320DM6437平台的H.264/AVC编码器,对H.264/AVC编码器结构进行了适当的调整,对代码中大数据量搬移部分进行EDMA优化。使编码器的高速缓冲存储器(cache)命中率提高了20%~30%,编码速率提高了3~4f/s(帧/秒)。
关键词 TMS320DM6437 EDMA 乒乓缓存 编码器 缓冲存储器
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基于DSP和FPGA的实时图像压缩系统设计 被引量:5
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作者 彭旭锋 刘文怡 李金力 《微型机与应用》 2010年第11期17-20,共4页
提出了一种基于高频帧摄像头的高频帧实时图像压缩技术,以此技术为基础,使用TMS320CDM642和EP2C35FPGA相结合,设计了一种高频帧实时图像处理器硬件系统。该系统采用2片SRAM乒乓结构,以及基于TI公司DSP/BIOS和支持XDAIS的JPEG2000压缩算... 提出了一种基于高频帧摄像头的高频帧实时图像压缩技术,以此技术为基础,使用TMS320CDM642和EP2C35FPGA相结合,设计了一种高频帧实时图像处理器硬件系统。该系统采用2片SRAM乒乓结构,以及基于TI公司DSP/BIOS和支持XDAIS的JPEG2000压缩算法,实现了100帧/s的压缩速度,系统同时解决了图像压缩中容量和速度的问题,实验了采集和压缩过程的同步进行,大大提高了图像压缩速度。 展开更多
关键词 DM642 乒乓缓存 XDAIS
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DSP/BIOS环境下视频图像火焰检测算法实现 被引量:1
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作者 周一君 马莉 《机电工程》 CAS 2009年第12期34-37,61,共5页
针对DSP/BIOS环境下在线视频图像火焰检测算法实现中存在的巨量数据运算和提高CPU利用率之间的矛盾,提出了以TMS320DM642为处理器的视频图像处理硬件系统构建,并在DSP/BIOS下设计了基于任务通信的实时视频图像火焰检测系统。此外,给出... 针对DSP/BIOS环境下在线视频图像火焰检测算法实现中存在的巨量数据运算和提高CPU利用率之间的矛盾,提出了以TMS320DM642为处理器的视频图像处理硬件系统构建,并在DSP/BIOS下设计了基于任务通信的实时视频图像火焰检测系统。此外,给出了基于颜色和火焰蔓延动态特性的检测规则,利用Ping-pong缓存技术实现了EDMA数据传输和CPU处理的并行操作,大大提高了CPU的利用率。试验结果表明,该算法不仅能有效地提取火焰区域,而且能使单帧图像的处理速度较无缓存技术和缓存技术分别提高60倍和1.55倍。 展开更多
关键词 TMS320DM642 DSP/BIOS 火焰检测 pingpong缓存
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新型高速大容量雷达数据记录器设计 被引量:1
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作者 雷超群 苏淑靖 《电子器件》 CAS 北大核心 2016年第3期634-638,共5页
设计了一种新型高速大容量雷达数据记录器的设计。为了将有效速度为59 Mbyte/s的雷达回波数据流及时、可靠的存储到记录器中,系统逻辑使用了乒乓缓存技术将其分解为两路速度为29.5 Mbyte/s的数据流并分别交叉写入两片FLASH,这样大大减... 设计了一种新型高速大容量雷达数据记录器的设计。为了将有效速度为59 Mbyte/s的雷达回波数据流及时、可靠的存储到记录器中,系统逻辑使用了乒乓缓存技术将其分解为两路速度为29.5 Mbyte/s的数据流并分别交叉写入两片FLASH,这样大大减轻了单片FLASH操作时序的压力。同时单片FLASH运用了交错式双平面编程和高效的无效块管理,极大的提高了芯片的写入速度。此数据记录器已经通过了振动、高低温、电磁兼容和冲击等实验,运行可靠稳定,同时已经交付部队使用。 展开更多
关键词 高速存储 MT29F16G08AJADAWP 乒乓缓存 交错式双平面编程
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EDMA传输机制与系统实时性的教学设计 被引量:2
14
作者 江汉 程云鹏 沈良 《电气电子教学学报》 2015年第3期63-67,共5页
针对研究生课程"实时数字信号处理"教学中存在的难题,本文讨论了增强型直接内存访问(EDMA)传输机制对于系统实时性的影响,提出了一种基于乒乓双缓存的数据流结构。为方便开展课堂教学,本文以DSK6416硬件实验板为平台,提出了... 针对研究生课程"实时数字信号处理"教学中存在的难题,本文讨论了增强型直接内存访问(EDMA)传输机制对于系统实时性的影响,提出了一种基于乒乓双缓存的数据流结构。为方便开展课堂教学,本文以DSK6416硬件实验板为平台,提出了一种系统实时性定量测量方法,通过测量结果给出了满足实时性的最佳参数组合,有效弥补了理论教学在阐述EDMA机制流程方面的不足。 展开更多
关键词 EDMA 乒乓缓冲 实时信号处理
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EDMA数据传输方式在视频图像处理系统中的应用 被引量:3
15
作者 陈振娇 徐新宇 张猛华 《电子与封装》 2015年第4期28-31,共4页
为解决视频图像处理系统中图像数据量大且对实时性要求高的问题,设计以TMS320C6713为核心的实时视频图像处理系统,利用EDMA控制器实现图像数据的高速传输。着重阐述了EDMA的实现方法及其软件的设计,采用乒乓缓冲技术协调数据搬移与CPU... 为解决视频图像处理系统中图像数据量大且对实时性要求高的问题,设计以TMS320C6713为核心的实时视频图像处理系统,利用EDMA控制器实现图像数据的高速传输。着重阐述了EDMA的实现方法及其软件的设计,采用乒乓缓冲技术协调数据搬移与CPU数据处理的节奏,从而满足了视频图像处理系统的高速实时性要求。 展开更多
关键词 TMS320C6713 EDMA 乒乓缓冲
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DRA音频解码算法及其DSP实现 被引量:1
16
作者 马文华 许晶晶 沈映娜 《电视技术》 北大核心 2011年第16期33-36,共4页
在研究DRA多声道数字音频解码算法的基础上,设计了基于飞思卡尔公司DSPB56367的DRA多声道数字音频解码器,给出了软硬件设计方案并讨论了其关键技术。音频主观听音测试结果表明:所设计的解码器在128 kbit/s的立体声音质总体优于4.7分,在3... 在研究DRA多声道数字音频解码算法的基础上,设计了基于飞思卡尔公司DSPB56367的DRA多声道数字音频解码器,给出了软硬件设计方案并讨论了其关键技术。音频主观听音测试结果表明:所设计的解码器在128 kbit/s的立体声音质总体优于4.7分,在384 kbit/s的5.1环绕声音质总体优于4.5分,达到了实际应用的需求。 展开更多
关键词 DRA 多声道数字音频编解码 DSPB56367 乒乓缓冲
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无人机载数据记录仪软件的实时性分析与优化
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作者 高思远 王延东 张宏巍 《吉林大学学报(信息科学版)》 CAS 2015年第3期286-291,共6页
为了给飞行安全、维护管理以及训练提供重要数据保障,设计了无人机载数据记录仪,对该记录仪软件的实时性进行了研究。对影响数据记录仪软件实时性的因素进行分析,根据所需记录数据的帧长度及中断频率得到数据记录仪对中断响应延时的要求... 为了给飞行安全、维护管理以及训练提供重要数据保障,设计了无人机载数据记录仪,对该记录仪软件的实时性进行了研究。对影响数据记录仪软件实时性的因素进行分析,根据所需记录数据的帧长度及中断频率得到数据记录仪对中断响应延时的要求;利用软件设置GPO(General Purpose Output)翻转,结合示波器测得存储单元在不同寻址方式下的响应时间延时;再根据寻址响应延时及乒乓缓存深度关系得到最优记录模式。通过搭建测试平台对优化前后的数据记录仪软件进行测试。结果表明,优化后的数据记录仪最短中断响应时间间隔为56μs。该数据记录仪能实时记录所有中断源数据,丢帧率为0,满足无人机对数据记录仪的高实时性要求。 展开更多
关键词 数据记录仪 中断响应延时 实时性 乒乓缓存
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适合DSP处理的低内存并行SPIHT算法
18
作者 陈升来 黄廉卿 《光学技术》 EI CAS CSCD 北大核心 2006年第4期587-590,共4页
针对SPIHT(set partitioning in hierarchical trees)算法的编码过程具有重复运算、存储量大等问题,提出了一种适合于DSP(digital signal processors)处理的低内存并行SPIHT算法。该算法采用乒乓缓存策略,使得数据的传输和编码能够同时... 针对SPIHT(set partitioning in hierarchical trees)算法的编码过程具有重复运算、存储量大等问题,提出了一种适合于DSP(digital signal processors)处理的低内存并行SPIHT算法。该算法采用乒乓缓存策略,使得数据的传输和编码能够同时进行。通过引入基于行的整型提升方案,使得只需经少量行变换就能进行列变换,提高了小波的变换速度。根据DSP的并行特性和SPIHT算法的缺点,采用“改进的最大幅值求取方法”、“误差位数以及绝对零值和绝对零集合”、“最大值与零值图”和“单棵零树编码”等多种方法对其进行了改进,大大缓解了对内存的压力,减少了算法的运算量。该算法与LZC(listless zerotree coding)算法相比,重构图像的峰值信噪比相当,但速度提高了2倍,能满足一般的实时压缩要求。 展开更多
关键词 图像压缩 DSP 提升方案 SPIHT LZC 乒乓缓存
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大容量音频实时录放系统的设计研究
19
作者 丁继成 贾春 《应用科技》 CAS 2015年第1期45-48,共4页
为满足大容量实时录放音频需求,同时保证音质和信息完整性,设计了基于DSP、音频编解码芯片、存储介质SD卡的大容量音频实时录放系统软硬件方案。通过通用IO口模拟SPI协议实现了无集成SPI接口环境下的SD卡实时读写,解决了系统的大容量问... 为满足大容量实时录放音频需求,同时保证音质和信息完整性,设计了基于DSP、音频编解码芯片、存储介质SD卡的大容量音频实时录放系统软硬件方案。通过通用IO口模拟SPI协议实现了无集成SPI接口环境下的SD卡实时读写,解决了系统的大容量问题。重点在详细测试分析单缓冲录放方案的基础上,提出采用乒乓缓冲和定时中断技术解决音频录放实时性问题。实际测试表明,由该方案形成的系统录放音质良好,实时性高,能够满足大容量存储应用需求。 展开更多
关键词 音频录放 DSP FAT Fs文件系统 乒乓缓冲技术
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基于EDMA实现TMS320C64X与FPGA的数据传输 被引量:2
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作者 顾永红 《信息化研究》 2012年第4期61-63,74,共4页
结合TMS320C64XDSP+FPGA信号处理平台,简述了TMS320C64XDSP的硬件结构,重点介绍直接存储器访问(EDMA)的硬件结构和配置方法。数据经现场可编程门阵列(Field-Programmable Gate Array,FPGA)及DSP外部存储器接口(EMIF)由EDMA传输到数字信... 结合TMS320C64XDSP+FPGA信号处理平台,简述了TMS320C64XDSP的硬件结构,重点介绍直接存储器访问(EDMA)的硬件结构和配置方法。数据经现场可编程门阵列(Field-Programmable Gate Array,FPGA)及DSP外部存储器接口(EMIF)由EDMA传输到数字信号处理器(DSP)片内,传输过程不需要CPU干预,并且采用乒乓缓冲结构,CPU同时可以进行数据处理,提高了数据传输、处理的速度,保证了实时性。 展开更多
关键词 数字信号处理器(TMS320C64X DSP) 增强型直接存储器访问 外部存储器接口 现场可编程门阵列 乒乓缓冲
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