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Single-Bit Comparator in Quantum-Dot Cellular Automata (QCA) Technology Using Novel QCAXNOR Gates
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作者 Ali Hussien Majeed Mohd Shamian Zainal +1 位作者 Esam Alkaldy Danial Md.NorNor 《Journal of Electronic Science and Technology》 CAS CSCD 2021年第3期263-273,共11页
To fill the continuous needs for faster processing elements with less power consumption causes large pressure on the complementary metal oxide semiconductor(CMOS)technology developers.The scaling scenario is not an op... To fill the continuous needs for faster processing elements with less power consumption causes large pressure on the complementary metal oxide semiconductor(CMOS)technology developers.The scaling scenario is not an option nowadays and other technologies need to be investigated.The quantum-dot cellular automata(QCA)technology is one of the important emerging nanotechnologies that have attracted much researchers’attention in recent years.This technology has many interesting features,such as high speed,low power consumption,and small size.These features make it an appropriate alternative to the CMOS technique.This paper suggests three novel structures of XNOR gates in the QCA technology.The presented structures do not follow the conventional approaches to the logic gates design but depend on the inherent capabilities of the new technology.The proposed structures are used as the main building blocks for a single-bit comparator.The resulted circuits are simulated for the verification purpose and then compared with existing counterparts in the literature.The comparison results are encouraging to append the proposed structures to the library of QCA gates. 展开更多
关键词 NANOTECHNOLOGY quantum-dot cellular automata(QCA) QCA comparator xnor gate XOR gate
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Voltage Controlled Ring Oscillator Design with Novel 3 Transistors XNOR/XOR Gates
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作者 Manoj Kumar Sandeep Kumar Arya Sujata Pandey 《Circuits and Systems》 2011年第3期190-195,共6页
In present work, improved designs for voltage controlled ring oscillators (VCO) using three transistors XNOR/XOR gates have been presented. Supply voltage has been varied from [1.8 - 1.2] V in proposed designs. In fir... In present work, improved designs for voltage controlled ring oscillators (VCO) using three transistors XNOR/XOR gates have been presented. Supply voltage has been varied from [1.8 - 1.2] V in proposed designs. In first method, the VCO design using three XNOR delay cells shows frequency variation of [1.900 - 0.964] GHz with [279.429 - 16.515] μW power consumption variation. VCO designed with five XNOR delay cells shows frequency variation of [1.152 - 0.575] GHz with varying power consumption of [465.715 - 27.526] μW. In the second method VCO having three XOR stages shows frequency variation [1.9176 - 1.029] GHz with power consumption variation from [296.393 - 19.051] μW. A five stage XOR based VCO design shows frequency variation [1.049 - 0.565] GHz with power consumption variation from [493.989 - 31.753] μW. Simulations have been performed by using SPICE based on TSMC 0.18μm CMOS technology. Power consumption and output frequency range of proposed VCOs have been compared with earlier reported circuits and proposed circuit’s shows improved performance. 展开更多
关键词 CMOS DELAY CELL Low Power VCO XOR and xnor gateS
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基于弱晶体管的低功耗XNOR门设计
3
作者 叶锡恩 毛科益 夏银水 《电路与系统学报》 CSCD 北大核心 2007年第2期101-105,共5页
XNOR门是构成Reed-Muller逻辑的基本门电路,现有的XNOR门电路由于信号摆幅的不完全性而导致后级亚阈功耗的存在。本文通过在信号非全摆幅的节点上增加弱晶体管来实现信号的全摆幅,达到消除亚阈功耗,实现低功耗设计的目的。所提出的方法... XNOR门是构成Reed-Muller逻辑的基本门电路,现有的XNOR门电路由于信号摆幅的不完全性而导致后级亚阈功耗的存在。本文通过在信号非全摆幅的节点上增加弱晶体管来实现信号的全摆幅,达到消除亚阈功耗,实现低功耗设计的目的。所提出的方法应用于两个典型的XNOR门电路的改进设计中,经PSpice模拟,其功耗改进超过20%。进一步应用到全加器的设计中,结果也证实了此方法的有效性。 展开更多
关键词 弱晶体管 低功耗 xnor 全加器
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具有双括号栅的XNOR神经元突触研究 被引量:2
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作者 孙晓彤 靳晓诗 《微处理机》 2021年第4期25-28,共4页
为了对传统MOSFET晶体管做出优化以减小其短沟道效应和源漏穿通效应,基于肖特基势垒隧穿效应,提出一种具有记忆功能的高集成双括号栅与双栅共同控制型场效应晶体管。器件通过增大金属与体硅面积实现肖特基隧穿效应,具有集成度高、导通... 为了对传统MOSFET晶体管做出优化以减小其短沟道效应和源漏穿通效应,基于肖特基势垒隧穿效应,提出一种具有记忆功能的高集成双括号栅与双栅共同控制型场效应晶体管。器件通过增大金属与体硅面积实现肖特基隧穿效应,具有集成度高、导通电流更高、亚阈值摆幅更低、漏电流更小等优点。通过分析器件结构原理与关键参数,对单个晶体管的转移特性曲线进行仿真,结果表明,通过改变两个控制栅极栅压可以实现异或非门逻辑功能。该器件可以作为高密度神经元突触器件应用在二进制神经网络中。 展开更多
关键词 双括号形栅 隧穿效应 高集成 xnor逻辑功能
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利用单硬币量子博弈实现量子同或门的研究 被引量:3
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作者 王清亮 任恒峰 黎梓浩 《量子光学学报》 北大核心 2019年第1期36-39,共4页
首先以单硬币量子博弈理论为基础,结合经典同或门的逻辑关系,研究并给出量子同或门的定义;据此进一步利用单硬币量子博弈模型,提出了实现量子同或逻辑关系的理论方案,并将量子的逻辑位与经典逻辑位进行对比,从而给出了具体操作方法:两... 首先以单硬币量子博弈理论为基础,结合经典同或门的逻辑关系,研究并给出量子同或门的定义;据此进一步利用单硬币量子博弈模型,提出了实现量子同或逻辑关系的理论方案,并将量子的逻辑位与经典逻辑位进行对比,从而给出了具体操作方法:两相互独立的单硬币量子博弈过程可用作量子同或逻辑功能。 展开更多
关键词 经典同或门 量子同或门 量子博弈
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基于生物燃料电池智能逻辑生物传感器的研究进展
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作者 赵灵芝 张小清 +2 位作者 苗延青 邓文婷 胡颢 《应用化工》 CAS CSCD 2014年第6期1120-1124,共5页
基于生物燃料电池技术发展的智能逻辑生物传感器,具有智能化、装置一体化、不需外接电源即可反映多种目标物存在以及复杂样品中各种物质间关系等优点,可作为智能化装置应用于医学检测、诊断以及药物控释。重点综述了基于生物燃料电池发... 基于生物燃料电池技术发展的智能逻辑生物传感器,具有智能化、装置一体化、不需外接电源即可反映多种目标物存在以及复杂样品中各种物质间关系等优点,可作为智能化装置应用于医学检测、诊断以及药物控释。重点综述了基于生物燃料电池发展的自供电式逻辑生物传感器的工作原理,及其近五年应用于体内环境生理活性物质复杂关系分析等方面的研究进展,并对今后的研究趋势进行了展望。 展开更多
关键词 生物燃料电池 自供电 逻辑生物传感器 “与”门 “非”门
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高性能异或门电路的设计
7
作者 董艳燕 韦一 陈君 《中国计量学院学报》 2012年第4期383-387,共5页
在分析已发表的典型异或门电路的基础上,提出一种新型高性能的异或门电路,其电路核心部分仅3个晶体管,包括一个改进型互补CMOS反相器和一个NMOS传输门.在TSMC0.18μm CMOS工艺下经HSPICE模拟.结果表明,与已有的异或门电路相比,新设计在... 在分析已发表的典型异或门电路的基础上,提出一种新型高性能的异或门电路,其电路核心部分仅3个晶体管,包括一个改进型互补CMOS反相器和一个NMOS传输门.在TSMC0.18μm CMOS工艺下经HSPICE模拟.结果表明,与已有的异或门电路相比,新设计在速度和功耗延迟积上具有较大的优势. 展开更多
关键词 异或门 CMOS反相器 传输门
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基于量子元胞自动机的新型同或门结构设计
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作者 余宸 解光军 +2 位作者 邓凤斌 张永强 吕洪君 《微纳电子技术》 北大核心 2018年第1期6-12,共7页
由于互补金属氧化物半导体(CMOS)器件尺寸的限制,量子元胞自动机(QCA)成为有望替代CMOS的新兴纳米器件。量子元胞自动机具有超低功耗、超高速度和高密度结构的潜在优势。提出了一种新型的同或门结构,在面积、延迟、复杂度及功耗方... 由于互补金属氧化物半导体(CMOS)器件尺寸的限制,量子元胞自动机(QCA)成为有望替代CMOS的新兴纳米器件。量子元胞自动机具有超低功耗、超高速度和高密度结构的潜在优势。提出了一种新型的同或门结构,在面积、延迟、复杂度及功耗方面相较于之前的结构均存在优势。所提出的新型同或门结构仅使用28个面积为0.02μm^2的QCA元胞,延迟仅为0.75个时钟周期。为了检验提出的设计在大型复杂QCA电路中的性能,实现了4,8和16位的奇偶校验器电路。模拟结果表明,所设计的电路性能各方面均优于先前的设计。 展开更多
关键词 量子元胞自动机(QCA) 五输入择多门 同或门 异或门 奇偶校验器 性能分析
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基于正反馈异或/同或门的低延时混合逻辑加法器设计
9
作者 叶顺心 汪鹏君 +2 位作者 温亮 张跃军 张笑天 《宁波大学学报(理工版)》 CAS 2020年第2期28-34,共7页
针对采用传输管逻辑设计的加法器存在阈值损失以及延时过高等问题,结合正反馈原理,提出无阈值损失的低延时正反馈混合逻辑加法器设计方案.该方案首先分析传输管异或门阈值损失机理,利用正反馈环电平锁定特性,设计无阈值损失的正反馈异或... 针对采用传输管逻辑设计的加法器存在阈值损失以及延时过高等问题,结合正反馈原理,提出无阈值损失的低延时正反馈混合逻辑加法器设计方案.该方案首先分析传输管异或门阈值损失机理,利用正反馈环电平锁定特性,设计无阈值损失的正反馈异或/同或门;然后利用有比逻辑特定晶体管的尺寸差,以减少正反馈异或/同或门输出延时;最后融合传输管逻辑、传输门逻辑和静态互补CMOS逻辑等的优点,实现无阈值损失且低延时的混合逻辑加法器.在TSMC 65 nm CMOS工艺下,HSPICE仿真结果表明,所设计电路与传输门加法器相比延时和功耗延时积分别降低12.75%和10.88%. 展开更多
关键词 正反馈 异或/同或门 低延时 阈值损失 混合逻辑加法器
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基于石墨烯表面等离子激元波导的同或/异或门
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作者 周利强 张杰 +1 位作者 丁健 陈伟伟 《光学学报》 EI CAS CSCD 北大核心 2018年第2期197-203,共7页
设计了一种基于石墨烯表面等离子激元波导的同或/异或逻辑门,其采用了上下话路型微环谐振器为基本单元。通过调节石墨烯化学势来控制石墨烯表面等离子激元的传输状态,器件的两个不同输出端口同时获得同或和异或逻辑运算结果。仿真分析... 设计了一种基于石墨烯表面等离子激元波导的同或/异或逻辑门,其采用了上下话路型微环谐振器为基本单元。通过调节石墨烯化学势来控制石墨烯表面等离子激元的传输状态,器件的两个不同输出端口同时获得同或和异或逻辑运算结果。仿真分析结果表明:当工作频率为30THz,石墨烯化学势为0.677eV和0.95eV时,基于石墨烯表面等离子激元波导的上下话路型微环谐振器可实现开启与关闭;所构建的同或/异或逻辑门在‘00’、‘01’、‘10’、‘11’四组逻辑操作数下的最差串扰为-10.60dB。 展开更多
关键词 集成光学 同或/异或门 微环谐振器 石墨烯 表面等离子激元 波导
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