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基于FPGA的万兆以太网接口的设计与实现 被引量:4
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作者 李伟 窦衡 周宇 《光通信技术》 CSCD 北大核心 2009年第11期6-8,共3页
介绍了IEEE 802.3ae标准中万兆以太网物理层及媒质接入控制子层的相关协议。以10GBASE-R应用物理环境为例,阐述了万兆以太网接口各个单元模块的功能和设计实现方法。FPGA仿真结果表明,该万兆以太网接口可以实现以太网之间的万兆接入,对... 介绍了IEEE 802.3ae标准中万兆以太网物理层及媒质接入控制子层的相关协议。以10GBASE-R应用物理环境为例,阐述了万兆以太网接口各个单元模块的功能和设计实现方法。FPGA仿真结果表明,该万兆以太网接口可以实现以太网之间的万兆接入,对以太网的应用空间和性能提升有着重大的意义。 展开更多
关键词 万兆以太网 物理编码子层 xgmii XSBI FPGA
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10Gbit/s并行光收发模块在万兆以太网的应用
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作者 周毅 陈弘达 +2 位作者 左超 贾久春 申荣铉 《Journal of Semiconductors》 EI CAS CSCD 北大核心 2005年第z1期233-237,共5页
介绍了万兆以太网技术(10 gigabit ethernet technology).万兆以太网使用以太网结构实现10Gbit/s点对点传输,距离可达到40km,使以太网的应用从局域网扩展到城域网和广域网.重点介绍了万兆以太网的功能结构、分层结构、物理传输介质和甚... 介绍了万兆以太网技术(10 gigabit ethernet technology).万兆以太网使用以太网结构实现10Gbit/s点对点传输,距离可达到40km,使以太网的应用从局域网扩展到城域网和广域网.重点介绍了万兆以太网的功能结构、分层结构、物理传输介质和甚短距离(very short reach)网络传输的并行光传输系统在万兆以太网方面的应用. 展开更多
关键词 10G ETHERNET XAUI xgmii VSR VCSEL
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10GBASE-X物理层并行光传输研究 被引量:1
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作者 苗澎 王志功 《高技术通讯》 CAS CSCD 北大核心 2007年第7期661-666,共6页
研究了符合IEEE802.3ae标准的万兆以太网10GBASE-X物理层技术,建立了万兆以太网10GBASE-X物理层点到点并行光传输系统.该系统由10GE连接单元接口(XAUI)与10Gb介质无关接口(XGMII)转换芯片、4×3.125Gbit/s 850nm自制垂直腔面发... 研究了符合IEEE802.3ae标准的万兆以太网10GBASE-X物理层技术,建立了万兆以太网10GBASE-X物理层点到点并行光传输系统.该系统由10GE连接单元接口(XAUI)与10Gb介质无关接口(XGMII)转换芯片、4×3.125Gbit/s 850nm自制垂直腔面发射激光器(VCSEL)并行光发射模块与并行光接收模块构成.利用现场可编程门阵列(FPGA)实现了10GBASE-X物理层编解码子层(PCS)、物理介质连接子层(PMA)的全部功能,光互联采用2m并行12芯400MHz·km 62.5μm多模带状光纤.经逻辑分析仪(Agilent 1682A)在接收端低速IO引脚测试,在接收端恢复出发端的万兆以太网帧结构数据,逻辑功能正确. 展开更多
关键词 万兆以太网10GBASE-X物理层 10GE连接单元接口 10Gb介质无关接口 并行光传输
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基于FPGA的万兆以太网实现 被引量:3
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作者 陈卓轩 康婧 曹春霞 《电信技术研究》 2013年第3期41-46,共6页
根据IEEE802.3ae协议标准,分析万兆以太网的功能结构和特点,改进了万兆以太网的实现方案,提高了模块的灵活性和普适性。基于FPGA的可裁剪方案分为接收和发送两部分,能实现发送数据的检测、填充、CRC添加、以太封包、成帧以及接收... 根据IEEE802.3ae协议标准,分析万兆以太网的功能结构和特点,改进了万兆以太网的实现方案,提高了模块的灵活性和普适性。基于FPGA的可裁剪方案分为接收和发送两部分,能实现发送数据的检测、填充、CRC添加、以太封包、成帧以及接收数据的协议解析、解包、CRC校验、缓冲等功能。在Xilinx的XC5VSX95T器件中进行的功能与性能测试结果表明,该模块完全能够满足实际应用需求。 展开更多
关键词 万兆以太网 FPGA IEEE802 3ae xgmii CRC32 WAN
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万兆以太网物理层编码子层转换芯片研究
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作者 苗澎 王志功 《固体电子学研究与进展》 CAS CSCD 北大核心 2008年第4期549-553,共5页
研制了符合IEEE802.3ae万兆以太网10GBASE-R标准物理层编码子层转换芯片,该转换芯片采用单片FPGA进行10GBASE-R标准中万兆以太网16比特接口(XSBI)与10Gb介质无关接口(XGMII)的相互转换,实现了物理层编码子层(PCS)的全部功能,并在万兆以... 研制了符合IEEE802.3ae万兆以太网10GBASE-R标准物理层编码子层转换芯片,该转换芯片采用单片FPGA进行10GBASE-R标准中万兆以太网16比特接口(XSBI)与10Gb介质无关接口(XGMII)的相互转换,实现了物理层编码子层(PCS)的全部功能,并在万兆以太网物理层传输实验系统中进行了验证。 展开更多
关键词 万兆以太网物理层 物理编码子层 万兆以太网16比特接口 10 Gb介质无关接口 转换芯片
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Microsemi低功耗SmartFusion2 SoC FPGA开发方案
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《世界电子元器件》 2018年第2期37-42,共6页
Microsemi公司的SmartFusion2 SoC FPGA是低功耗FPGA器件,集成了第四代基于闪存FPGA架构,166MHz ARM Cortex-M3处理器和高性能通信接口,是业界最低功耗,最可靠和最高安全的可编逻辑解决方案.高速串行接口包括PCIe,10Gbps附加单元接口(XA... Microsemi公司的SmartFusion2 SoC FPGA是低功耗FPGA器件,集成了第四代基于闪存FPGA架构,166MHz ARM Cortex-M3处理器和高性能通信接口,是业界最低功耗,最可靠和最高安全的可编逻辑解决方案.高速串行接口包括PCIe,10Gbps附加单元接口(XAUI)/XGMII)以及Ser Des通信,主要用在数据安全,马达控制。 展开更多
关键词 SmartFusion2 SoC FPGA MICROSEMI 低功耗 DDR 芯片布局图 xgmii
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Lattice ECP5和ECP5-5GFPGA系列VIP处理器解决方案
7
《世界电子元器件》 2018年第5期48-54,共7页
lattice公司的ECP5/ECP5-5G FPGA系列提供了高性能特性如增强DSP架构,高速SERDES和高速源同步接口,采用40nm技术,使得器件非常适合于量大高速和低成本的应用.器件的查找表(LUT)高达48K逻辑单元,支持多达365个用户I/O,提供多达156个18x1... lattice公司的ECP5/ECP5-5G FPGA系列提供了高性能特性如增强DSP架构,高速SERDES和高速源同步接口,采用40nm技术,使得器件非常适合于量大高速和低成本的应用.器件的查找表(LUT)高达48K逻辑单元,支持多达365个用户I/O,提供多达156个18x18乘法器和各种并行I/O标准,采用可配置SRAM逻辑技术,提供基于LUT的逻辑,分布式和嵌入式存储器,锁相环(PLL),延迟锁定环(DLL)。 展开更多
关键词 处理器 xgmii LFE ECP5-5GFPGA Lattice ECP5 VIP
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Lattice ECP5-5G系列FPGA开发方案
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《世界电子元器件》 2018年第5期55-58,共4页
lattice公司的ECP5-5G系列是低成本低功耗小尺寸的FPGA系列产品,提供高性能特性如增强的DSP架构,高速SERDES和高速源同步接口,以及高达84K逻辑单元的查找表(LUT),支持高达365个用户I/O,高达156个18 x 18乘法器和各种并行I/O标准,特别适... lattice公司的ECP5-5G系列是低成本低功耗小尺寸的FPGA系列产品,提供高性能特性如增强的DSP架构,高速SERDES和高速源同步接口,以及高达84K逻辑单元的查找表(LUT),支持高达365个用户I/O,高达156个18 x 18乘法器和各种并行I/O标准,特别适合用在量大高速低成本的应用如汽车娱乐系统,小型无线基站和低功耗工业视频照相机.本文介绍了ECP5-5G主要特性,框图和ECP5-5G 展开更多
关键词 xgmii ECP Lattice ECP5-5G
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