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Verilog Testbench设计技巧和策略 被引量:7
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作者 李瑛 张盛兵 高德远 《计算机工程与应用》 CSCD 北大核心 2003年第10期128-130,共3页
仿真Testbench的设计是Top-Down流程中非常关键的一个环节,但是很多设计者却感到困难较大。实际上,verilogHDL有着较强的行为建模能力,可以方便地写出更加高效、简洁的行为模型。论文结合一个ATM测试平台的Testbench设计,讨论了Testbenc... 仿真Testbench的设计是Top-Down流程中非常关键的一个环节,但是很多设计者却感到困难较大。实际上,verilogHDL有着较强的行为建模能力,可以方便地写出更加高效、简洁的行为模型。论文结合一个ATM测试平台的Testbench设计,讨论了Testbench的结构和总线功能模型(BFM),并对使用BFM模型进行Testbench设计的策略和方法进行了探讨,希望能对广大设计者有所帮助。 展开更多
关键词 verilogtestbench C语言 程序设计 bfm模型 功能仿真 专用集成电路
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Testbench设计技巧研究
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作者 林思夏 薛毅飞 姜薇 《电脑知识与技术》 2009年第5期3560-3563,共4页
Testbench的设计是仿真和验证数字逻辑设计的标准方法也是设计过程中的必要环节,简单高效的Testbench可以帮助设计者完成复杂工作。该文主要从Testbench的功能结构入手,研究了如何将文件化分为功能模块和实现模块的设计技巧.并通过一... Testbench的设计是仿真和验证数字逻辑设计的标准方法也是设计过程中的必要环节,简单高效的Testbench可以帮助设计者完成复杂工作。该文主要从Testbench的功能结构入手,研究了如何将文件化分为功能模块和实现模块的设计技巧.并通过一个FIFO的实例将这些功能模块组合成一个完整的Testbench。 展开更多
关键词 testbench 仿真 验证 功能模块
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用于DVD伺服控制的EFM/EFM+解调器的设计
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作者 夏军 袁丽霞 邹雪城 《电子学报》 EI CAS CSCD 北大核心 2005年第1期150-153,共4页
本文介绍了一种EFM/EFM +解调器的设计和实现 .该解调器用于DVD光盘伺服控制 ,对读入的CD和DVD数据分别实现 14 - 8和 16 - 8解调 .文中通过对其工作原理和实际应用的分析 ,给出其最终实现方案 .并用Verilog硬件描述语言完成整个解调器... 本文介绍了一种EFM/EFM +解调器的设计和实现 .该解调器用于DVD光盘伺服控制 ,对读入的CD和DVD数据分别实现 14 - 8和 16 - 8解调 .文中通过对其工作原理和实际应用的分析 ,给出其最终实现方案 .并用Verilog硬件描述语言完成整个解调器的设计工作 .功能仿真和FPGA验证表明 ,设计成功 . 展开更多
关键词 EFM/EFM+ 解调器 verilog 功能仿真 FPGA验证
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基于ARM核的片上可编程系统的功能验证
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作者 金轶丰 《计算机工程》 EI CAS CSCD 北大核心 2005年第6期192-194,共3页
介绍了一种快速准确的片上系统验证方法。这种方法改善了针对当今高性能的系统设计的验证过程,从而减少了开发整个系统所需要的成本。
关键词 验证 verilog硬件描述语言 AHB 总线功能模型 测试基
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一种可重用的验证平台在核电FPGA仿真测试中的应用
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作者 董玲玲 许先音 李梦林 《自动化博览》 2019年第12期84-88,共5页
基于FPGA开发的核电数字化仪控系统(DCS)应用环境苛刻,功能性的故障可能引起误操作,进而引发灾难性的后果,因此对FPGA开发的软件功能的测试尤为重要。传统的界面仿真测试验证效率低、可重用性差,而采用验证方法学的验证平台的搭建又较... 基于FPGA开发的核电数字化仪控系统(DCS)应用环境苛刻,功能性的故障可能引起误操作,进而引发灾难性的后果,因此对FPGA开发的软件功能的测试尤为重要。传统的界面仿真测试验证效率低、可重用性差,而采用验证方法学的验证平台的搭建又较为繁琐,用时较多,不能满足项目时间的要求。本文提出一种基于System Verilog搭建的可重用的验证平台,采用虚拟端口方法模拟外部芯片接口的功能,最后采用批处理的方式开启验证平台,实现自动化的仿真测试,其接口模型、算法库及验证平台自启动的框架可在不同的项目测试中使用,实现可重用性。该平台已在公司的核电站仪控系统产品的验证中得到成功应用,缩短了测试时间,并满足安全级产品认证的要求。 展开更多
关键词 验证平台 System verilog 重用性 仿真验证
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