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题名面向互连的综合策略
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作者
马光胜
杜振军
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机构
哈尔滨工程大学计算机科学与技术学院
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出处
《贵州工业大学学报(自然科学版)》
CAS
2002年第4期8-11,共4页
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基金
国家自然科学基金资助项目 (69973 0 14 )
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文摘
VDSM (超深亚微米 )设计中互连线延迟已在电路延迟中起到决定性作用。在前期设计阶段考虑互连延迟问题已是当前研究的重要课题。建立以互连为中心的综合方法是当前的一个棘手问题 ,尚未有成熟的方法。提出一种面向互连延迟的综合策略 ,将前期设计定时规划 ,前期设计的线网规划和布局规划方法相融合 ,并在不同阶段给出了不同精度和复杂度的定时分析模型。另还给出了一个设计实例对综合策略予以了说明。
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关键词
综合策略
超深亚微米
Boole过程论
互连延迟
vdsm
设计
门电路
电路延迟
线网规划
布局规划
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Keywords
vdsm
boolean process
interconnect delay
synthesis
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分类号
TP302
[自动化与计算机技术—计算机系统结构]
TP331.
[自动化与计算机技术—计算机系统结构]
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题名面向互连的综合策略
被引量:1
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作者
马光胜
杜振军
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机构
哈尔滨工程大学计算机科学与技术学院
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出处
《计算机工程与应用》
CSCD
北大核心
2002年第20期27-29,共3页
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基金
国家自然科学基金项目资助(编号:69973014)
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文摘
VDSM(超深亚微米)设计中互连线延迟已在电路延迟中起到决定性作用。在前期设计阶段考虑互连延迟问题已是当前研究的重要课题。建立以互连为中心的综合方法是当前的一个棘手问题,尚未有成熟的方法。文章提出了一种面向互连延迟的综合策略,将前期设计定时规划,前期设计的线网规划和布局规划方法相融合,并在不同阶段给出了不同精度和复杂度的定时分析模型。文中还给出了一个设计实例对该文的综合策略予以了说明。
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关键词
综合策略
超深亚微米
Boole过程论
互连延迟
模拟电路
设计
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Keywords
vdsm,boolean process,interconnect delay,synthesis
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分类号
TN710
[电子电信—电路与系统]
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