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基于March X算法的SRAM BIST的设计 被引量:4
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作者 冯国臣 沈绪榜 刘春燕 《微电子学与计算机》 CSCD 北大核心 2005年第12期44-47,共4页
针对LS-DSP中嵌入的128kbSRAM模块,讨论了基于MarchX算法的BIST电路的设计。根据SRAM的故障模型和测试算法的故障覆盖率,讨论了测试算法的选择、数据背景的产生;完成了基于MarchX算法的BIST电路的设计。128kbSRAMBIST电路的规模约为2000... 针对LS-DSP中嵌入的128kbSRAM模块,讨论了基于MarchX算法的BIST电路的设计。根据SRAM的故障模型和测试算法的故障覆盖率,讨论了测试算法的选择、数据背景的产生;完成了基于MarchX算法的BIST电路的设计。128kbSRAMBIST电路的规模约为2000门,仅占存储器面积的1.2%,故障覆盖率高于80%。 展开更多
关键词 sram.测试 march算法 bist
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基于March C+算法的SRAM BIST设计 被引量:4
2
作者 张志超 侯立刚 吴武臣 《现代电子技术》 2011年第10期149-151,共3页
为了增加存储器测试的可控性和可观测性,减少存储器测试的时间和成本开销,在此针对LEON处理器中的32位宽的SRAM进行BIST设计。采用March C+算法,讨论了SRAM的故障模型及BIST的实现。设计的BIST电路可以与系统很好的相连,并且仅增加很少... 为了增加存储器测试的可控性和可观测性,减少存储器测试的时间和成本开销,在此针对LEON处理器中的32位宽的SRAM进行BIST设计。采用March C+算法,讨论了SRAM的故障模型及BIST的实现。设计的BIST电路可以与系统很好的相连,并且仅增加很少的输入/输出端口。仿真结果证明,BIST的电路的加入在不影响面积开销的同时,能够达到很好的故障覆盖率。 展开更多
关键词 sram bist march C+算法 故障模型
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基于March C-算法的SRAM BIST电路的设计 被引量:11
3
作者 须自明 苏彦鹏 于宗光 《半导体技术》 CAS CSCD 北大核心 2007年第3期245-247,共3页
针对某SOC中嵌入的8K SRAM模块,讨论了基于March C-算法的BIST电路的设计。根据SRAM的故障模型和测试算法的故障覆盖率,研究了测试算法的选择、数据背景的产生,并完成了基于March C-算法的BIST电路的设计。实验证明,该算法的BIST实现能... 针对某SOC中嵌入的8K SRAM模块,讨论了基于March C-算法的BIST电路的设计。根据SRAM的故障模型和测试算法的故障覆盖率,研究了测试算法的选择、数据背景的产生,并完成了基于March C-算法的BIST电路的设计。实验证明,该算法的BIST实现能大幅提高故障覆盖率。 展开更多
关键词 静态存储器 march C-算法 内建自测试
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基于March C-算法的SRAM芯片的SEU失效测试系统 被引量:2
4
作者 王鹏 李振 +1 位作者 邵伟 薛茜男 《电子器件》 CAS 北大核心 2014年第5期803-807,共5页
为实现SRAM芯片的单粒子翻转故障检测,基于LabVIEW和FPGA设计了一套存储器测试系统:故障监测端基于LabVIEW开发了可视化的测试平台,执行数据的采集、存储及结果分析任务,板卡测试端通过FPGA向参考SRAM和待测SRAM注入基于March C-算法的... 为实现SRAM芯片的单粒子翻转故障检测,基于LabVIEW和FPGA设计了一套存储器测试系统:故障监测端基于LabVIEW开发了可视化的测试平台,执行数据的采集、存储及结果分析任务,板卡测试端通过FPGA向参考SRAM和待测SRAM注入基于March C-算法的测试向量,通过NI公司的HSDIO-6548板卡采集2个SRAM的数据,根据其比较结果判定SEU故障是否发生。该系统可以实时监测故障状态及测试进程,并且具有较好的可扩展性。 展开更多
关键词 仿真测试 单粒子翻转 LabVIEW march C-算法 sram
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板级SRAM的内建自测试(BIST)设计 被引量:3
5
作者 张勇 谈恩民 《桂林电子工业学院学报》 2004年第2期60-63,共4页
板级SRAM的内建自测试的设计,是为了确保板级SRAM的可靠性。考虑到板级SRAM各种故障模型,选择使用MarchC-SOF算法,其对呆滞故障、跳变故障、开路故障、地址译码器故障和字节间组合故障有100%的故障覆盖率,优化面向"字节"的Mar... 板级SRAM的内建自测试的设计,是为了确保板级SRAM的可靠性。考虑到板级SRAM各种故障模型,选择使用MarchC-SOF算法,其对呆滞故障、跳变故障、开路故障、地址译码器故障和字节间组合故障有100%的故障覆盖率,优化面向"字节"的MarchC-SOF算法和扩展延时元素后,算法可对SRAM进行字节内组合故障和数据维持力故障测试。同时在只增加少量成本的情况下,使用FPGA构成存储器的BIST控制器,可以满足SRAM的可测性的要求。 展开更多
关键词 sram 自测试设计 march算法 故障模型 bist 可靠性
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SoC中嵌入式SRAM的BIST测试方法研究 被引量:3
6
作者 张力 罗胜钦 《电子与封装》 2007年第11期27-30,共4页
随着集成电路设计规模的不断增大,在系统芯片SoC(System on a Chip)中嵌入大量的SRAM存储器的设计方法变得越来越重要。文中介绍了SRAM的典型故障类型和几种常用的测试方法,同时详细分析了嵌入式SRAM存储器内建自测试的实现原理以及几... 随着集成电路设计规模的不断增大,在系统芯片SoC(System on a Chip)中嵌入大量的SRAM存储器的设计方法变得越来越重要。文中介绍了SRAM的典型故障类型和几种常用的测试方法,同时详细分析了嵌入式SRAM存储器内建自测试的实现原理以及几种改进的March算法,另外,以16k×32bitSRAM为例,给出了SRAM内建自测试的一种典型实现,并在Altera-EP1S25上实现。 展开更多
关键词 嵌入式sram存储器 内建自测试 march算法
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基于MARCH算法的SRAM内建自测试设计 被引量:3
7
作者 张铜 成本茂 张小锋 《计算机与现代化》 2013年第8期99-101,共3页
随着FPGA集成度和复杂性的增加,测试显得尤为重要,但是测试是FPGA设计中费用最高、难度最大的一个环节。由于片上系统的快速发展,ATE的速度及其存储量已经不能满足测试的要求,因此出现了内建自测试技术。本研究的主要目的是实现一个对3... 随着FPGA集成度和复杂性的增加,测试显得尤为重要,但是测试是FPGA设计中费用最高、难度最大的一个环节。由于片上系统的快速发展,ATE的速度及其存储量已经不能满足测试的要求,因此出现了内建自测试技术。本研究的主要目的是实现一个对32个单元、每个单元8比特大小的SRAM测试的BIST,采用的测试方法为MARCH算法。在设计中采用的是Verilog语言,用QautusⅡ9.0软件对设计进行仿真,并对仿真结果进行分析判断。 展开更多
关键词 内建自测试 march算法 QautusⅡ9 0
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嵌入式双端口SRAM可编程内建自测试结构的设计 被引量:3
8
作者 颜学龙 汤敏 《计算机测量与控制》 CSCD 2006年第7期853-854,共2页
分析了嵌入式双端口SRAM的故障模型,并在此基础上提出了一种新型的针对嵌入式双端口SRAM的BIST结构;它能够有效地测试双端口SRAM,通过使用新型的指令格式能够减少指令数据量和测试时间。
关键词 内建自测试 双端口sram测试 march算法 可编程
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基于FPGA的SRAM测试电路的设计与实现 被引量:4
9
作者 田勇 孙晓凌 申华 《电子工程师》 2008年第12期57-59,共3页
为了保证独立的SRAM模块或嵌入式SRAM模块功能的完整性与可靠性,必须对SRAM模块进行测试。介绍了一种基于Altera DE2开发板的面向字节的SRAM测试电路的设计与实现。测试算法采用分为字内和字间测试两部分的高故障覆盖率March C-算法;设... 为了保证独立的SRAM模块或嵌入式SRAM模块功能的完整性与可靠性,必须对SRAM模块进行测试。介绍了一种基于Altera DE2开发板的面向字节的SRAM测试电路的设计与实现。测试算法采用分为字内和字间测试两部分的高故障覆盖率March C-算法;设计的测试电路可由标准的JTAG(联合测试工作组)接口进行控制。设计的测试电路可测试独立的SRAM模块或作为BIST(内建自测试)电路测试嵌入式SRAM模块。验证结果表明该SRAM测试系统是非常高效的。 展开更多
关键词 sram(静态随机存储器) march C-算法 JTAG bist
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基于FPGA测试电路的SRAM自测试研究 被引量:1
10
作者 陈亚坤 《单片机与嵌入式系统应用》 2012年第1期8-11,共4页
SRAM是微机系统中的记忆设备,用来存放程序和数据。因此对SRAM的自测试可以有效地避免存储器工作不正常给系统带来的损害。采用硬件描述语言对FPGA电路进行编程,构造SRAM测试电路。以对各种存储器常见故障模型能够有效检测的March C-算... SRAM是微机系统中的记忆设备,用来存放程序和数据。因此对SRAM的自测试可以有效地避免存储器工作不正常给系统带来的损害。采用硬件描述语言对FPGA电路进行编程,构造SRAM测试电路。以对各种存储器常见故障模型能够有效检测的March C-算法为主要测试算法,对存储器单元进行故障测试,并将有错误的地址单元映射到备用的存储单元,以确保微机系统稳定运行。 展开更多
关键词 sram自测试 故障模型 FPGA march C-算法
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on-Chip SRAM内建自测试及其算法的研究
11
作者 刘有耀 李彬 《数字通信》 2014年第4期14-18,共5页
具体研究on-Chip SRAM的内建自测试及其算法。在引入嵌入式存储器内建自测试的基础上,详细分析on-Chip SRAM内建自测试的具体实现方法,反映出内建自测试对于简化测试程序和缩短测试时间,从而降低测试成本的重要性。详细描述在测试on-Chi... 具体研究on-Chip SRAM的内建自测试及其算法。在引入嵌入式存储器内建自测试的基础上,详细分析on-Chip SRAM内建自测试的具体实现方法,反映出内建自测试对于简化测试程序和缩短测试时间,从而降低测试成本的重要性。详细描述在测试on-Chip SRAM时常用的算法,并具体分析非传统性测试算法——Hammer算法和Retention算法。 展开更多
关键词 片上静态随机存储器 内建自测试 故障模型 测试算法
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一种Mbist新型算法March 3CL的设计 被引量:4
12
作者 陈之超 李小进 +1 位作者 丁艳芳 李玲玲 《电子测试》 2017年第11X期50-52,47,共4页
制造工艺的不断进步,嵌入式存储器在片上系统芯片中的集成度越来越大,同时存储器本身也变得愈加复杂,使得存储器出现了一系列新的故障类型,比如三单元耦合故障。存储器內建自测试技术是当今存储器测试的主流方法,研究高效率的Mbist算法... 制造工艺的不断进步,嵌入式存储器在片上系统芯片中的集成度越来越大,同时存储器本身也变得愈加复杂,使得存储器出现了一系列新的故障类型,比如三单元耦合故障。存储器內建自测试技术是当今存储器测试的主流方法,研究高效率的Mbist算法,是提高芯片成品率的必要前提。以SRAM的7种三单元耦合故障为研究对象,通过分析故障行为得到三单元耦合的72种故障原语,并且分析了地址字内耦合故障的行为,进而提出新的测试算法March 3CL。以2048X32的SRAM为待测存储器,利用EDA工具进行了算法的仿真,仿真结果表明,该算法具有故障覆盖率高、时间复杂度低等优点。 展开更多
关键词 sram 存储器內建自测试 三单元耦合故障 march算法 可测性设计
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静态随机存储器在轨自检算法 被引量:1
13
作者 吴洋 王羿 +3 位作者 于新宇 许智龙 任放 黄缙 《北京航空航天大学学报》 EI CAS CSCD 北大核心 2021年第6期1233-1240,共8页
静态随机存储器(SRAM)在轨自检应用于星载电子设备上电初始化过程中,能够在电子设备开始工作前发现存储器的故障单元,为评估电子设备健康状态提供依据。分析了SRAM的结构和常见的故障原理,针对在轨应用这一特殊背景开展研究,提出了对典... 静态随机存储器(SRAM)在轨自检应用于星载电子设备上电初始化过程中,能够在电子设备开始工作前发现存储器的故障单元,为评估电子设备健康状态提供依据。分析了SRAM的结构和常见的故障原理,针对在轨应用这一特殊背景开展研究,提出了对典型测试算法的改进方案。在完成对改进方案的分析和评价后,以8 K×8 bit存储器为例开展算法的实现,并验证了改进方案的可行性。与典型测试算法相比,所提改进方案具有资源开销少、故障覆盖率高等优点。 展开更多
关键词 静态随机存储器(sram) 在轨自检 march算法 集成电路测试 航天产品
原文传递
STT-MRAM存储器的故障测试设计
14
作者 杨真 胡伟 王文 《微电子学与计算机》 2023年第5期112-117,共6页
自旋转移矩的随机存储器(Spin Transfer Torque Magnetic Random Access Memory,STT-MRAM)以其非易失性、读写速度快、数据保持时间长、完全兼容CMOS(Complementary Metal Oxide Semiconductor)工艺等优势在新型存储器中脱颖而出.随着... 自旋转移矩的随机存储器(Spin Transfer Torque Magnetic Random Access Memory,STT-MRAM)以其非易失性、读写速度快、数据保持时间长、完全兼容CMOS(Complementary Metal Oxide Semiconductor)工艺等优势在新型存储器中脱颖而出.随着其产业化的投入暴增和应用规模的扩大,STT-MRAM存储器产品的质量和可靠性测试十分必要.当前,最常用的March测试算法在对STT-MRAM的性能进行验证时,存在测试复杂度与故障覆盖率两者不匹配的难题.针对于此,从STT-MRAM的制造缺陷形成和分类出发,将部分针孔故障的表现形式,采用March敏化的方式检测,并基于此类故障类型,提出了一种高故障覆盖率的March CM测试算法,根据此算法设计相应的内建自测试(Build-In Self-Testing,BIST)电路.仿真验证及对STT-MRAM的板级测试显示这一设计达到了兼容高复杂度和高覆盖率的测试要求. 展开更多
关键词 STT-MRAM march算法 内建自测试 新型存储器 存储器测试
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