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基于VxWorks的RapidIO-IP设计与实现
被引量：
5
1
作者
黄振中
倪明
柴小丽
《计算机工程》
CAS
CSCD
北大核心
2010年第18期243-244,249,共3页
在研究RapidIO互连标准和TCP/IP协议的基础上,设计RapidIO-IP架构,分析VxWorks操作系统中END的工作原理和SBC8641D平台上RapidIO总线的工作机制,对基于RapidIO的END驱动需要实现的几个关键技术进行攻克,成功实现了RapidIO-IP,为RapidIO...
在研究RapidIO互连标准和TCP/IP协议的基础上,设计RapidIO-IP架构,分析VxWorks操作系统中END的工作原理和SBC8641D平台上RapidIO总线的工作机制,对基于RapidIO的END驱动需要实现的几个关键技术进行攻克,成功实现了RapidIO-IP,为RapidIO协议在嵌入式系统中的应用奠定了基础。
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关键词
TCP/IP
协议
rapidio-ip
架构
END
驱动
RAPIDIO
协议
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职称材料
基于FPGA的多通路SRIO数据传输设计
被引量：
4
2
作者
任勇峰
多卉枫
武慧军
《电子测量技术》
北大核心
2022年第14期152-156,共5页
为满足航天遥测系统中多路高速数据可靠传输的需求,提出了一种基于FPGA控制器和Serial RapidIO(SRIO)协议的四通路数据传输设计方案。设计使用Xilinx A7系列FPGA,并使用4个其内部集成的SRIO IP核,设计内部逻辑,实现四路SRIO高速数据传输...
为满足航天遥测系统中多路高速数据可靠传输的需求,提出了一种基于FPGA控制器和Serial RapidIO(SRIO)协议的四通路数据传输设计方案。设计使用Xilinx A7系列FPGA,并使用4个其内部集成的SRIO IP核,设计内部逻辑,实现四路SRIO高速数据传输;使用其内部集成的吉比特收发器(GTP)以满足SRIO传输协议物理层要求。硬件电路使用4个高速收发光模块完成光电转换;并使用高质量时钟芯片产生125 MHz的差分时钟信号作为SRIO IP核的参考时钟。经测试验证四路数据传输速率可达440 MB/s,且无丢帧、误码现象,该设计已成功运用于遥测系统某地面测试台项目,可实现四路高速数据稳定传输。
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关键词
可编程逻辑器件(FPGA)
Serial
RapidIO协议
SRIO
IP核
吉比特收发器
共享逻辑
原文传递
多通道SRIO数据传输优化设计与应用
被引量：
1
3
作者
文丰
徐胜
朱振麟
《单片机与嵌入式系统应用》
2023年第12期84-87,共4页
为了满足遥测系统大容量数据高速可靠传输的需求,提出了一种基于FPGA和Serial RapidIO(SRIO)的数据传输链路优化设计,传输链路为4x模式,传输速率为2.5 Gb/s。针对测试过程中链路异常被训练成1x模式而造成数据传输异常的现象进行深入分析...
为了满足遥测系统大容量数据高速可靠传输的需求,提出了一种基于FPGA和Serial RapidIO(SRIO)的数据传输链路优化设计,传输链路为4x模式,传输速率为2.5 Gb/s。针对测试过程中链路异常被训练成1x模式而造成数据传输异常的现象进行深入分析,采用上电复位和软件复位相结合的方法对传输链路进行优化,经测试验证,优化后的链路数据传输稳定,1路SRIO数据传输速率可达585 MB/s,且无丢帧、误码现象。该设计已成功应用于遥测系统项目,实现高速数据稳定传输。
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关键词
FPGA
Serial
RapidIO协议
SRIO
IP核
4x模式
链路异常
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职称材料
RapidIO IP核的验证方法研究
被引量：
5
4
作者
王玉欢
田泽
蔡叶芳
《计算机技术与发展》
2011年第7期183-185,189,共4页
串行RapidIO是针对高性能嵌入式系统芯片间和板间互连而设计的,是未来十几年中嵌入式系统互连的最佳选择之一。在以RapidIO为接口的SoC设计中,对RapidIO IP核的验证是其基础。基于对RapidIO协议的理解,研究了RapidIO IP核功能验证的方...
串行RapidIO是针对高性能嵌入式系统芯片间和板间互连而设计的,是未来十几年中嵌入式系统互连的最佳选择之一。在以RapidIO为接口的SoC设计中,对RapidIO IP核的验证是其基础。基于对RapidIO协议的理解,研究了RapidIO IP核功能验证的方法、验证平台的搭建以及验证测试过程的实施,提出了虚拟平台验证与FPGA原型验证相结合的验证方法。该验证过程搭建了可靠的验证平台,为RapidIO IP核的可靠工作提供了保证。文中的研究工作,从验证思路和方法上对于类似设计的验证具有一定的参考价值。
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关键词
RAPIDIO
IP核
验证平台
验证
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职称材料
万兆以太网与RapidIO网络的互连与传输
被引量：
6
5
作者
左颜
柴小丽
顾燕飞
《重庆理工大学学报（自然科学）》
CAS
2017年第8期134-139,共6页
伴随着各种高性能计算系统的不断发展,所采用的数据传输方式对系统整体性能的影响越来越重要。RapidIO是基于数据包交换的互连架构体系,是能满足各种高性能嵌入式系统需求的一种开放式互连技术标准。介绍了RapidIO的一些基本概念知识以...
伴随着各种高性能计算系统的不断发展,所采用的数据传输方式对系统整体性能的影响越来越重要。RapidIO是基于数据包交换的互连架构体系,是能满足各种高性能嵌入式系统需求的一种开放式互连技术标准。介绍了RapidIO的一些基本概念知识以及万兆以太网的发展现状,分析了RapidIO网络和万兆以太网的数据传输过程。介于有些实时数据需要在万兆以太网和RapidIO网络之间进行传输,提出了一种基于万兆以太网和RapidIO网络间数据转换的网关设计。在硬件平台中,充分使用资源设计并实现了10GE-RapidIO协议转换的网关嵌入式软件系统。采用IP-over-RapidIO技术,可以将以太网数据包封装进RapidIO数据包中实现以太网数据包在RapidIO网络中传输,即实现万兆以太网和RapidIO网络的互连互通。这种方法能使用户专注于上层应用开发,不必过多关注于系统底层复杂的强实时RapidIO技术细节。最终通过搭建实验平台对该网关设计的实用性进行了验证。
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关键词
RAPIDIO
万兆以太网
IP-over-RapidIO
网关
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职称材料
一种RapidIO IP核的设计与验证
被引量：
6
6
作者
蔡叶芳
田泽
+1 位作者
李攀
何嘉文
《计算机技术与发展》
2014年第10期97-100,共4页
RapidIO总线是第三代总线的代表,是处理器之间实现互联的最佳选择。但国内对于此技术的研究尚处于起步阶段,使用者也多以购买国外成熟IP为主。文中基于RapidIO V1.3协议,介绍了一种RapidIO总线的设计和实现方法,之后对其进行了全面的虚...
RapidIO总线是第三代总线的代表,是处理器之间实现互联的最佳选择。但国内对于此技术的研究尚处于起步阶段,使用者也多以购买国外成熟IP为主。文中基于RapidIO V1.3协议,介绍了一种RapidIO总线的设计和实现方法,之后对其进行了全面的虚拟平台测试和FPGA平台测试。测试结果表明,该RapidIO总线符合RapidIO V1.3协议,且设计实现方式简单,复用性好,可以作为RapidIO接口方便地应用于FPGA和芯片设计中。
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关键词
IP核设计
验证方法
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职称材料
10GE-RapidIO网关的设计与实现
7
作者
张松岭
刘云
+1 位作者
袁浩
李锡武
《计算机与数字工程》
2012年第3期118-120,共3页
为了实现RapidIO网络和万兆以太网网络之间的高速数据通信,文章提出了10GE-RapidIO网关的设计方案,采用IP-over-RapidIO的方法即将以太网数据包封装进RapidIO数据包中实现以太网数据包在RapidIO网络中的数据传输。此网关能够高效的连接...
为了实现RapidIO网络和万兆以太网网络之间的高速数据通信,文章提出了10GE-RapidIO网关的设计方案,采用IP-over-RapidIO的方法即将以太网数据包封装进RapidIO数据包中实现以太网数据包在RapidIO网络中的数据传输。此网关能够高效的连接万兆以太网和RapidIO网络,实现RapidIO传输数据包和万兆以太网数据包的转换。
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关键词
RAPIDIO
10GE万兆以太网
网关
IP-over-RapidIO
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职称材料
一种基于FPGA的信号采集卡
被引量：
8
8
作者
吴伟乾
柴小丽
+1 位作者
尹家伟
武鑫
《电子设计工程》
2018年第23期103-107,共5页
设计了一种多通道、高可靠性的高速数据采集系统,将之应用于雷达系统上。系统利用数据采集模块采集雷达数据输入的不同频率电压信号;以Xilinx的IP核实现物理层、逻辑层的协议,将采集到的数据处理后,实现了数据的多路收发,通过存储介质...
设计了一种多通道、高可靠性的高速数据采集系统,将之应用于雷达系统上。系统利用数据采集模块采集雷达数据输入的不同频率电压信号;以Xilinx的IP核实现物理层、逻辑层的协议,将采集到的数据处理后,实现了数据的多路收发,通过存储介质实现数据存储,通过RapidIO总线传送给PC上位机,实现远程数据的采集、存储和读取。通过Xilinx的DDS IP核产生20 MHz的正弦波信号对此系统进行验证,试验表明:此系统能采集较宽频率范围的信号并能对其进行转换,通过对比转换后的信号与采集到的信号证明收发信号一致,数据能够通过链路层进行存盘和读取,具有较好的通用性、实时性和可靠性,实验表明系统技术指标处于国内领先水平。
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关键词
FPGA
DDS
IP核
AD控制
RapidIO总线
链路层
多路收发
DMA
PC上位机
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职称材料
题名
基于VxWorks的RapidIO-IP设计与实现
被引量：
5
1
作者
黄振中
倪明
柴小丽
机构
华东计算技术研究所
出处
《计算机工程》
CAS
CSCD
北大核心
2010年第18期243-244,249,共3页
文摘
在研究RapidIO互连标准和TCP/IP协议的基础上,设计RapidIO-IP架构,分析VxWorks操作系统中END的工作原理和SBC8641D平台上RapidIO总线的工作机制,对基于RapidIO的END驱动需要实现的几个关键技术进行攻克,成功实现了RapidIO-IP,为RapidIO协议在嵌入式系统中的应用奠定了基础。
关键词
TCP/IP
协议
rapidio-ip
架构
END
驱动
RAPIDIO
协议
Keywords
TCP/IP protocol
rapidio-ip
architecture
END driver
RapidIO protocol
分类号
TP316.8 [自动化与计算机技术—计算机软件与理论]
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职称材料
题名
基于FPGA的多通路SRIO数据传输设计
被引量：
4
2
作者
任勇峰
多卉枫
武慧军
机构
中北大学电子测试技术国家重点实验室
出处
《电子测量技术》
北大核心
2022年第14期152-156,共5页
文摘
为满足航天遥测系统中多路高速数据可靠传输的需求,提出了一种基于FPGA控制器和Serial RapidIO(SRIO)协议的四通路数据传输设计方案。设计使用Xilinx A7系列FPGA,并使用4个其内部集成的SRIO IP核,设计内部逻辑,实现四路SRIO高速数据传输;使用其内部集成的吉比特收发器(GTP)以满足SRIO传输协议物理层要求。硬件电路使用4个高速收发光模块完成光电转换;并使用高质量时钟芯片产生125 MHz的差分时钟信号作为SRIO IP核的参考时钟。经测试验证四路数据传输速率可达440 MB/s,且无丢帧、误码现象,该设计已成功运用于遥测系统某地面测试台项目,可实现四路高速数据稳定传输。
关键词
可编程逻辑器件(FPGA)
Serial
RapidIO协议
SRIO
IP核
吉比特收发器
共享逻辑
Keywords
FPGA
Serial RapidIO protocol
SRIO IP core
Gigabit transceiver
shared logical
分类号
TN919 [电子电信—通信与信息系统]
原文传递
题名
多通道SRIO数据传输优化设计与应用
被引量：
1
3
作者
文丰
徐胜
朱振麟
机构
中北大学电子测试技术国家重点实验室
出处
《单片机与嵌入式系统应用》
2023年第12期84-87,共4页
文摘
为了满足遥测系统大容量数据高速可靠传输的需求,提出了一种基于FPGA和Serial RapidIO(SRIO)的数据传输链路优化设计,传输链路为4x模式,传输速率为2.5 Gb/s。针对测试过程中链路异常被训练成1x模式而造成数据传输异常的现象进行深入分析,采用上电复位和软件复位相结合的方法对传输链路进行优化,经测试验证,优化后的链路数据传输稳定,1路SRIO数据传输速率可达585 MB/s,且无丢帧、误码现象。该设计已成功应用于遥测系统项目,实现高速数据稳定传输。
关键词
FPGA
Serial
RapidIO协议
SRIO
IP核
4x模式
链路异常
Keywords
FPGA
Serial RapidIO protocol
SRIO IP core
4x mode
link abnormality
分类号
TN919 [电子电信—通信与信息系统]
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职称材料
题名
RapidIO IP核的验证方法研究
被引量：
5
4
作者
王玉欢
田泽
蔡叶芳
机构
中国航空计算技术研究所
出处
《计算机技术与发展》
2011年第7期183-185,189,共4页
基金
中国航空工业集团公司技术创新基金(2009D63120)
文摘
串行RapidIO是针对高性能嵌入式系统芯片间和板间互连而设计的,是未来十几年中嵌入式系统互连的最佳选择之一。在以RapidIO为接口的SoC设计中,对RapidIO IP核的验证是其基础。基于对RapidIO协议的理解,研究了RapidIO IP核功能验证的方法、验证平台的搭建以及验证测试过程的实施,提出了虚拟平台验证与FPGA原型验证相结合的验证方法。该验证过程搭建了可靠的验证平台,为RapidIO IP核的可靠工作提供了保证。文中的研究工作,从验证思路和方法上对于类似设计的验证具有一定的参考价值。
关键词
RAPIDIO
IP核
验证平台
验证
Keywords
RapidIO IP core
testbench
verification
分类号
TP39 [自动化与计算机技术—计算机应用技术]
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职称材料
题名
万兆以太网与RapidIO网络的互连与传输
被引量：
6
5
作者
左颜
柴小丽
顾燕飞
机构
华东计算技术研究所
出处
《重庆理工大学学报（自然科学）》
CAS
2017年第8期134-139,共6页
文摘
伴随着各种高性能计算系统的不断发展,所采用的数据传输方式对系统整体性能的影响越来越重要。RapidIO是基于数据包交换的互连架构体系,是能满足各种高性能嵌入式系统需求的一种开放式互连技术标准。介绍了RapidIO的一些基本概念知识以及万兆以太网的发展现状,分析了RapidIO网络和万兆以太网的数据传输过程。介于有些实时数据需要在万兆以太网和RapidIO网络之间进行传输,提出了一种基于万兆以太网和RapidIO网络间数据转换的网关设计。在硬件平台中,充分使用资源设计并实现了10GE-RapidIO协议转换的网关嵌入式软件系统。采用IP-over-RapidIO技术,可以将以太网数据包封装进RapidIO数据包中实现以太网数据包在RapidIO网络中传输,即实现万兆以太网和RapidIO网络的互连互通。这种方法能使用户专注于上层应用开发,不必过多关注于系统底层复杂的强实时RapidIO技术细节。最终通过搭建实验平台对该网关设计的实用性进行了验证。
关键词
RAPIDIO
万兆以太网
IP-over-RapidIO
网关
Keywords
RapidIO
10 gigabit ethernet
IP-over-RapidIO
gateway
分类号
TP302.1 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
一种RapidIO IP核的设计与验证
被引量：
6
6
作者
蔡叶芳
田泽
李攀
何嘉文
机构
中国航空计算技术研究所
出处
《计算机技术与发展》
2014年第10期97-100,共4页
基金
"十二五"微电子预研(51308010601)
总装2012预研基金(9140A08010712HK61095)
中国航空工业集团公司创新基金(2010BD63111)
文摘
RapidIO总线是第三代总线的代表,是处理器之间实现互联的最佳选择。但国内对于此技术的研究尚处于起步阶段,使用者也多以购买国外成熟IP为主。文中基于RapidIO V1.3协议,介绍了一种RapidIO总线的设计和实现方法,之后对其进行了全面的虚拟平台测试和FPGA平台测试。测试结果表明,该RapidIO总线符合RapidIO V1.3协议,且设计实现方式简单,复用性好,可以作为RapidIO接口方便地应用于FPGA和芯片设计中。
关键词
IP核设计
验证方法
Keywords
RapidIO
RapidIO
IP core design
verification method
分类号
TP39 [自动化与计算机技术—计算机应用技术]
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职称材料
题名
10GE-RapidIO网关的设计与实现
7
作者
张松岭
刘云
袁浩
李锡武
机构
武汉数字工程研究所
出处
《计算机与数字工程》
2012年第3期118-120,共3页
文摘
为了实现RapidIO网络和万兆以太网网络之间的高速数据通信,文章提出了10GE-RapidIO网关的设计方案,采用IP-over-RapidIO的方法即将以太网数据包封装进RapidIO数据包中实现以太网数据包在RapidIO网络中的数据传输。此网关能够高效的连接万兆以太网和RapidIO网络,实现RapidIO传输数据包和万兆以太网数据包的转换。
关键词
RAPIDIO
10GE万兆以太网
网关
IP-over-RapidIO
Keywords
RapidIO
10Gigabit Ethernet
gateway
IP-over-RapidIO
分类号
TP393 [自动化与计算机技术—计算机应用技术]
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职称材料
题名
一种基于FPGA的信号采集卡
被引量：
8
8
作者
吴伟乾
柴小丽
尹家伟
武鑫
机构
中国电子科技集团第三十二研究所
出处
《电子设计工程》
2018年第23期103-107,共5页
文摘
设计了一种多通道、高可靠性的高速数据采集系统,将之应用于雷达系统上。系统利用数据采集模块采集雷达数据输入的不同频率电压信号;以Xilinx的IP核实现物理层、逻辑层的协议,将采集到的数据处理后,实现了数据的多路收发,通过存储介质实现数据存储,通过RapidIO总线传送给PC上位机,实现远程数据的采集、存储和读取。通过Xilinx的DDS IP核产生20 MHz的正弦波信号对此系统进行验证,试验表明:此系统能采集较宽频率范围的信号并能对其进行转换,通过对比转换后的信号与采集到的信号证明收发信号一致,数据能够通过链路层进行存盘和读取,具有较好的通用性、实时性和可靠性,实验表明系统技术指标处于国内领先水平。
关键词
FPGA
DDS
IP核
AD控制
RapidIO总线
链路层
多路收发
DMA
PC上位机
Keywords
FPGA DDS IP core
AD control
RapidIO bus
link layer
multi-channel transceiver
DMA
PC computer
分类号
TN911.73 [电子电信—通信与信息系统]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于VxWorks的RapidIO-IP设计与实现
黄振中
倪明
柴小丽
《计算机工程》
CAS
CSCD
北大核心
2010
5
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职称材料
2
基于FPGA的多通路SRIO数据传输设计
任勇峰
多卉枫
武慧军
《电子测量技术》
北大核心
2022
4
原文传递
3
多通道SRIO数据传输优化设计与应用
文丰
徐胜
朱振麟
《单片机与嵌入式系统应用》
2023
1
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职称材料
4
RapidIO IP核的验证方法研究
王玉欢
田泽
蔡叶芳
《计算机技术与发展》
2011
5
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职称材料
5
万兆以太网与RapidIO网络的互连与传输
左颜
柴小丽
顾燕飞
《重庆理工大学学报（自然科学）》
CAS
2017
6
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职称材料
6
一种RapidIO IP核的设计与验证
蔡叶芳
田泽
李攀
何嘉文
《计算机技术与发展》
2014
6
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职称材料
7
10GE-RapidIO网关的设计与实现
张松岭
刘云
袁浩
李锡武
《计算机与数字工程》
2012
0
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职称材料
8
一种基于FPGA的信号采集卡
吴伟乾
柴小丽
尹家伟
武鑫
《电子设计工程》
2018
8
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职称材料
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