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Preparation of three-dimensional interconnected mesoporous anatase TiO_2-SiO_2 nanocomposites with high photocatalytic activities 被引量:4
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作者 董维阳 姚有为 +2 位作者 孙尧俊 华伟明 庄国顺 《Chinese Journal of Catalysis》 SCIE EI CAS CSCD 北大核心 2016年第6期846-854,共9页
In this article, we report the preparation of a three-dimensional(3D) interconnected mesoporous anatase TiO2-SiO2 nanocomposite. The nanocomposite was obtained by using an ordered two-dimensional(2D) hexagonal mes... In this article, we report the preparation of a three-dimensional(3D) interconnected mesoporous anatase TiO2-SiO2 nanocomposite. The nanocomposite was obtained by using an ordered two-dimensional(2D) hexagonal mesoporous anatase 70 TiO2-30 SiO2-950 nanocomposite(crystallized at 950 °C for 2 h) as a precursor, NaO H as an etchant of SiO2 via a "creating mesopores in the pore walls" approach. Our strategy adopts mild conditions of creating pores such as diluted NaO H solution, appropriate temperature and solid/liquid ratio, etc. aiming at ensuring the integrities of mesopores architecture and anatase nanocrystals. XRD, TEM and N2 sorption techniques have been used to systematically investigate the physico-chemical properties of the nanocomposites. The results show that the intrawall mesopores are highly dense and uniform(average pore size 3.6 nm), and highly link the initial mesochannels in a 3D manner while retaining mesostructural integrity. There is no significant change to either crystallinity or size of the anatase nanocrystals before and after creating the intrawall mesopores. The photocatalytic degradation rates of rhodamine B(RhB, 0.303 min^–1) and methylene blue(MB, 0.757 min^–1) dyes on the resultant nanocomposite are very high, which are 5.1 and 5.3 times that of the precursor; even up to 16.5 and 24.1 times that of Degussa P25 photocatalyst, respectively. These results clearly demonstrate that the 3D interconnected mesopores structure plays an overwhelming role to the increments of activities. The 3D mesoporous anatase TiO2-SiO2 nanocomposite exhibits unexpected-high degradation activities to RhB and MB in the mesoporous metal oxide-based materials reported so far. Additionally, the nanocomposite is considerably stable and reusable. We believe that this method would pave the way for the preparation of other 3D highly interconnected mesoporous metal oxide-based materials with ultra-high performance. 展开更多
关键词 PREPARATION Mesoporous anatase crystal-silica nanocomposite Three dimensional interconnected mesopores architecture Photocatalytic degradation Organic pollutants
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Domain-Oriented Software Defined Computing Architecture 被引量:1
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作者 Ping Lv Qinrang Liu +1 位作者 Hongchang Chen Ting Chen 《China Communications》 SCIE CSCD 2019年第6期162-172,共11页
With the introduction of software defined hardware by DARPA Electronics Resurgence Initiative,software definition will be the basic attribute of information system.Benefiting from boundary certainty and algorithm aggr... With the introduction of software defined hardware by DARPA Electronics Resurgence Initiative,software definition will be the basic attribute of information system.Benefiting from boundary certainty and algorithm aggregation of domain applications,domain-oriented computing architecture has become the technical direction that considers the high flexibility and efficiency of information system.Aiming at the characteristics of data-intensive computing in different scenarios such as Internet of Things(IoT),big data,artificial intelligence(AI),this paper presents a domain-oriented software defined computing architecture,discusses the hierarchical interconnection structure,hybrid granularity computing element and its computational kernel extraction method,finally proves the flexibility and high efficiency of this architecture by experimental comparison. 展开更多
关键词 SOFTWARE defined HARDWARE SOFTWARE defined COMPUTING architecture hierarchical interconnectION mixed-granular COMPUTING element
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An On-chip Interconnection QoS Verification Platform of Processor of Large Data for Architectural Modeling Analysis 被引量:1
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作者 Li Qinghua Qin Jilong +2 位作者 Ding Xu Wang Endong Gong Weifeng 《国际计算机前沿大会会议论文集》 2015年第1期126-128,共3页
This paper presents introduction for a QoS verification of on-chip interconnection based on the new progress of the industry, which combined with an AMD processor chip design for big data. Some verification experience... This paper presents introduction for a QoS verification of on-chip interconnection based on the new progress of the industry, which combined with an AMD processor chip design for big data. Some verification experience in architectural modeling and simulation of on-chip interconnection is also introduced in this paper. 展开更多
关键词 interconnect QOS Verification Modeling MULTIPROCESSOR Computer architecture Big Data
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Tufting Carpet Machine Information Model Based on Object Linking and Embedding for Process Control Unified Architecture
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作者 GUO Xiang CHI Xinfu SUN Yize 《Journal of Donghua University(English Edition)》 CAS 2021年第1期43-50,共8页
In view of the lack of research on the information model of tufting carpet machine in China,an information modeling method based on Object Linking and Embedding for Process Control Unified Architecture(OPC UA)framewor... In view of the lack of research on the information model of tufting carpet machine in China,an information modeling method based on Object Linking and Embedding for Process Control Unified Architecture(OPC UA)framework was proposed to solve the problem of“information island”caused by the differentiated data interface between heterogeneous equipment and system in tufting carpet machine workshop.This paper established an information model of tufting carpet machine based on analyzing the system architecture,workshop equipment composition and information flow of the workshop,combined with the OPC UA information modeling specification.Subsequently,the OPC UA protocol is used to instantiate and map the information model,and the OPC UA server is developed.Finally,the practicability of tufting carpet machine information model under the OPC UA framework and the feasibility of realizing the information interconnection of heterogeneous devices in the tufting carpet machine digital workshop are verified.On this basis,the cloud and remote access to the underlying device data are realized.The application of this information model and information integration scheme in actual production explores and practices the application of OPC UA technology in the digital workshop of tufting carpet machine. 展开更多
关键词 tufting carpet machine digital workshop information model Object Linking and Embedding for Process Control Unified architecture(OPC UA) interconnectION
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Quantification of In Vivo Epidermal Keratinocyte Architecture Associated with the Signs of Skin Aging and the Skin Benefit Evaluation by Application of Galactomyces Ferment Filtrate (Pitera)-Containing Skin Care Product
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作者 Kukizo Miyamoto Yoko Munakata +4 位作者 Keisuke Fujii Chenlu Lei Ley Yang Suda Sudarsana Masutaka Furue 《Journal of Cosmetics, Dermatological Sciences and Applications》 2024年第1期12-28,共17页
Background: Aged skin exhibits visual alterations such as wrinkles, rough texture, pore dilation, and dull skin tone, as well as physiological aging, namely, decreased hydration and increased transepidermal water loss... Background: Aged skin exhibits visual alterations such as wrinkles, rough texture, pore dilation, and dull skin tone, as well as physiological aging, namely, decreased hydration and increased transepidermal water loss (TEWL). Recent advances in coherence tomography have also revealed that skin aging affects in vivo epidermal keratinocyte architecture. However, the interconnectivity between spatial architectural aging and visual/physiological aging parameters remains largely unknown. Purpose: To elucidate whether the tomographic keratinocyte architectural aging is correlated with visual and physiological skin aging parameters and to quantitatively evaluate the improvements of the architectural, visual, and physiological aging parameters by the daily treatment of the skin care formula containing Galactomyces Ferment Filtrate (GFF, 8X Pitera<sup>TM</sup>). Method: We measured the in vivo keratinocyte cellular architecture with two-photon stereoscopic tomography obtaining by-layer epidermal section images in 78 Asian females of various ages. Visual aging parameters were analyzed using a portable image capture system. Hydration and TEWL were also assessed. The anti-aging effects of GFF-containing skin moisturizer (SK-II LXP Cream<sup>TM</sup>) were also examined in two studies after twice-daily application for 2 (N = 35) and 4 (N = 32) weeks. Results: As for the keratinocyte cellular architecture, skin aging was significantly associated with decreased cell density and increased cell uniformity. These architectural aging parameters were significantly correlated with visual and physiological aging parameters, namely, rough texture, wrinkles, pore dilation, dull skin tone, dehydration, and increased TEWL. The strong interconnectivity allowed us to develop formulae to estimate the keratinocyte architecture from visual aging parameters. Moreover, twice-daily application of SK-II significantly improved the keratinocyte architecture associated with multiple skin aging visual and physiological parameters. Conclusion: Skin aging is a process involving mutual interconnections among epidermal keratinocyte cellular architecture, visual, and physiological parameters. The GFF-containing moisturizer SK-II effectively improves spatial architecture of keratinocytes in epidermis and these evaluated skin aging parameters in a new trajectory over the course of treatment. . 展开更多
关键词 Facial Skin Aging In Vivo Keratinocyte Cellular architecture Visual Aging Pa-rameter Dehydration interconnectIVITY New Trajectory Galactomyces Fer-ment Filtrate PiteraTM SK-II LXP CreamTM
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多芯粒大模型加速器推理协同优化方法
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作者 方娟 潘晨阳 +3 位作者 古明辉 李硕朋 陈慧杰 翟冉 《通信学报》 北大核心 2026年第2期190-208,共19页
在采用2.5D封装集成多计算芯粒与存储芯粒的大模型推理加速系统中,模型推理解码阶段跨芯粒通信具有突发性与强非均衡性,流量在拓扑中聚集到少数链路并形成热点排队,封装内网络通信常成为性能瓶颈。为缓解上述瓶颈,提出T^(2)-CHIP协同优... 在采用2.5D封装集成多计算芯粒与存储芯粒的大模型推理加速系统中,模型推理解码阶段跨芯粒通信具有突发性与强非均衡性,流量在拓扑中聚集到少数链路并形成热点排队,封装内网络通信常成为性能瓶颈。为缓解上述瓶颈,提出T^(2)-CHIP协同优化方法,通过刻画解码阶段跨芯粒通信在互连中的分布特征,识别热点链路,对带宽资源重分配,同时调整任务映射以减少热点跨芯粒交互,从而有效缓解解码阶段通信拥塞。周期精确网络仿真结果表明,该方法在提升解码阶段尾部性能与整体吞吐量的同时,降低了动态功耗,且维持了较低的实现开销。 展开更多
关键词 大语言模型 2.5D芯粒架构 芯粒间互连 异构协同优化
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新工业建筑的集约表现:以显示器件及集成电路工业项目为例
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作者 任志鸿 黄星元 畅流 《世界建筑》 2026年第3期75-79,共5页
工业产品、工艺流程、空间组合、技术美学贯穿于工业建筑设计的全过程,体现了工业建筑设计的逻辑性、集约性、人文性。本文以电子工业显示器件及集成电路项目为例,对精密制造、大尺度工业建筑的典型特征和集约表现进行了适度的诠释和探... 工业产品、工艺流程、空间组合、技术美学贯穿于工业建筑设计的全过程,体现了工业建筑设计的逻辑性、集约性、人文性。本文以电子工业显示器件及集成电路项目为例,对精密制造、大尺度工业建筑的典型特征和集约表现进行了适度的诠释和探讨。保持生产效率和工厂美学的动态平衡,注重研发生产空间的综合性和场所精神,营造集约智能、有机秩序、可持续发展的工业建筑。 展开更多
关键词 新工业建筑 工艺特征 集约联体 有机秩序 绿色低碳技术
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基于数字对象架构的能源数据互联关键技术
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作者 沈亮 余晗 +4 位作者 郭经 李井泉 张肖杰 刘冉 姜海鸥 《福建师范大学学报(自然科学版)》 北大核心 2026年第2期54-64,共11页
数字对象架构(digital object architecture,DOA)通过将能源数据封装为数字对象实现对数据的标准化抽象和描述,为能源数据跨领域互联共享提供新的解决思路。基于DOA的能源数据互联框架和关键技术,提出了能源数据互联框架和面向互联的能... 数字对象架构(digital object architecture,DOA)通过将能源数据封装为数字对象实现对数据的标准化抽象和描述,为能源数据跨领域互联共享提供新的解决思路。基于DOA的能源数据互联框架和关键技术,提出了能源数据互联框架和面向互联的能源数据模型,有助于跨领域能源数据综合分析利用。探索了面向能源数据互联的能源元数据模型,形成了能源元数据自动化提取技术。经实验证明,与基础模型和主流通用模型对比,微调大模型在能源元数据提取任务上的性能明显提升,为能源数据的跨领域共享与利用提供了基础,有助于推动能源领域的数字化转型的深入发展。 展开更多
关键词 能源数据互联 数字对象架构 元数据自动提取 能源元数据模型 数据跨域共享
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工业实时控制用容错双发射RISC-V处理器架构
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作者 王诗怡 《无线互联科技》 2026年第1期1-6,共6页
为满足工业实时控制对高性能和高可靠性的需求,文章提出一款容错型双发射RISC-V处理器。其架构采用双发射乱序流水线与轻量级向量执行单元,提高控制算法执行效率;硬件级快速中断机制将响应降低至百纳秒级,增强系统确定性。针对工业环境... 为满足工业实时控制对高性能和高可靠性的需求,文章提出一款容错型双发射RISC-V处理器。其架构采用双发射乱序流水线与轻量级向量执行单元,提高控制算法执行效率;硬件级快速中断机制将响应降低至百纳秒级,增强系统确定性。针对工业环境软错误,文章设计轻量级双模冗余(Dual-Modular Redundancy, DMR)与局部检查点机制,实现低成本容错。外设互联和模拟前端采用紧耦合与抗干扰结构,以降低访问延迟并提升数据稳定性。基于40 nm工艺实现的处理器在800 MHz下功耗不足500 mW,表现出良好的工业应用潜力。 展开更多
关键词 RISC-V 工业控制处理器 软错误容错 DMR 外设互联架构
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低空智能网联体系 被引量:12
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作者 张学军 刘法旺 +1 位作者 张祖耀 田野 《北京航空航天大学学报》 北大核心 2025年第6期1793-1815,共23页
近日,低空产业联盟对外发布《低空智能网联体系参考架构(2024版)》报告,该报告作为框架性的文件,旨在用最精确简短的内容体现低空智能网联体系的关键构成,但缺乏对体系背后隐含的科学方法、理论基础、实现途径等内容的详细描述。基于此... 近日,低空产业联盟对外发布《低空智能网联体系参考架构(2024版)》报告,该报告作为框架性的文件,旨在用最精确简短的内容体现低空智能网联体系的关键构成,但缺乏对体系背后隐含的科学方法、理论基础、实现途径等内容的详细描述。基于此,围绕该报告的内容,对低空智能网联体系发展现状、架构设计思路、关键技术等进行了全面的阐述,旨在对报告涉及的内容做进一步的分析和解读,为后续围绕低空智能网联体系的开发和建设工作提供科学的理论参考。 展开更多
关键词 低空智能网联体系运行概念 低空智能网联体系架构设计 低空智能网联应用服务系统 低空智能网联数据与服务支撑网络 低空智能网联机载终端与基础设施 低空智能网联体系关键技术
原文传递
De-blocking adaptive feedback control design for shared-buffer CIOQ switching architecture
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作者 Rui ZHENG Jianliang SHEN +4 位作者 Fan ZHANG Ping LV Peijie LI Yu SHAO Zhengbin ZHU 《ENGINEERING Information Technology & Electronic Engineering》 2026年第3期1-18,共18页
To address the issues of head-of-line(HOL)blocking at the virtual output queue(VOQ)level,packet loss,and congestion spreading caused by buffer overflow in the shared-buffer-based combined input and output queued(CIOQ)... To address the issues of head-of-line(HOL)blocking at the virtual output queue(VOQ)level,packet loss,and congestion spreading caused by buffer overflow in the shared-buffer-based combined input and output queued(CIOQ)switching architecture,while enhancing its performance and stability,we propose a de-blocking adaptive feedback control(AFC)design in this study.The introduction of the credit timeout detection mechanism(CTDM)enables the CIOQ to achieve theoretical 100%non-blocking state,effectively eliminating the impact of HOL blocking.With the combined effect of the proposed VOQ dynamic regulation algorithm(VDRA)and threshold dynamic adaptive algorithm(TDAA),it can reduce the risk of congestion spreading caused by buffer overflow and consequently improve the overall performance of the system.Both theoretical analysis and experimental results demonstrate that,under typical traffic conditions,the proposed design achieves a maximum throughput of 1499.66 Gb/s and a minimum latency of 83 ns.Additionally,the effective throughput ratio reaches 96.94%,with a data link layer packet(DLLP)loss ratio of merely 0.61%and a packet loss rate as low as 0.6%.In comparison with traditional CIOQ and input queued(IQ)switch architectures,the proposed design demonstrates improvements in throughput by 15.12%and 20.55%,and forwarding latency is reduced by 26.9%and 54.7%,respectively,and the system stability is stronger,which can fully satisfy the demand for data exchange in complex situations. 展开更多
关键词 Shared-buffer CIOQ switching architecture Head-of-line(HOL)blocking Congestion spreading Adaptive feedback control(AFC) Peripheral component interconnect express(PCIe)interconnect protocol
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芯粒互联技术综述
12
作者 王浩 王勇 +3 位作者 冯长磊 盖伟新 吴鹏 钱江 《计算机研究与发展》 北大核心 2025年第11期2651-2662,共12页
作为摩尔定律的“破局者”,芯粒(Chiplet)技术被业界寄予了厚望.芯粒技术能够将多个具有特定功能的“小芯粒”通过高速互联技术组合成一个“小芯粒”集成芯片,其技术核心是能够实现芯粒组合扩展的芯粒互联技术.从芯粒互联协议、互联架... 作为摩尔定律的“破局者”,芯粒(Chiplet)技术被业界寄予了厚望.芯粒技术能够将多个具有特定功能的“小芯粒”通过高速互联技术组合成一个“小芯粒”集成芯片,其技术核心是能够实现芯粒组合扩展的芯粒互联技术.从芯粒互联协议、互联架构、容错机制、典型互联芯粒、基于互联芯粒的可测性设计5个方面进行了分析与讨论.首先详细对比分析了国内外芯粒互联协议,给出了各协议的分层及功能.然后介绍了3种典型的芯粒互联架构,分析了各种架构的特点及优势.之后介绍了芯粒容错机制,介绍了互联接口容错编码、容错拓扑和容错路由等容错途径.接着给出了可编程互联芯粒、路径可编程互联芯粒以及专用互联芯粒3种设计方案.最后介绍了基于互联芯粒的可测试性设计与测试方案.以芯粒互联为主题,旨在帮助读者对芯粒互联技术进行系统性了解. 展开更多
关键词 芯粒 互联 互联芯粒 架构 容错机制 可测性设计
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基于可重构架构的数据中心异构加速软硬件系统级平台 被引量:2
13
作者 王彦伟 李仁刚 +1 位作者 徐冉 刘钧锴 《计算机研究与发展》 北大核心 2025年第4期963-977,共15页
构建数据中心加速服务的软硬件系统级原型平台,需要考虑高计算能力、扩展性、灵活性和低成本等因素.为了提高数据中心的能力,从软硬件协同的角度研究数据中心异构计算在云平台架构、硬件实现、高速互连和应用等方面的创新,研究设计并构... 构建数据中心加速服务的软硬件系统级原型平台,需要考虑高计算能力、扩展性、灵活性和低成本等因素.为了提高数据中心的能力,从软硬件协同的角度研究数据中心异构计算在云平台架构、硬件实现、高速互连和应用等方面的创新,研究设计并构建了一个可重构组合的软硬件加速原型系统,简化了现有以处理器为中心的系统级计算平台构建方法,实现目标软硬件设计的快速部署与系统级原型验证.针对以上目标,通过解耦的可重构架构设备虚拟化和远程映射等方法,发掘独立计算单元的潜力,构建了一套ISOF(independent system of FPGA(field programmable gate arrays))软硬件计算平台系统,可使其超越普通服务器设计所能提供的能力,实现计算单元低成本高效扩展,使客户端可灵活使用外设资源,并且为满足系统级通信挑战,设计了一套计算单元之间的通信硬件平台和交互机制.此外,为提升软硬件系统级平台的敏捷性,ISOF提供了灵活统一的调用接口.最后,通过对平台目标系统级的分析评估,验证了该平台在满足了当下计算与加速需求下,保证了高速、低延时的通信,以及良好的吞吐率和弹性扩容效率,另外在高速通信的基础上改进的拥塞避免和丢包恢复机制,满足了数据中心规模通信的稳定性需求. 展开更多
关键词 异构计算 加速平台 原型系统 高速互连 可重构架构 FPGA
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基于新型内存语义互连协议的内存池系统研究综述
14
作者 洪文韬 吴利舟 +4 位作者 张金涛 孟凡丰 欧洋 王子聪 肖侬 《计算机工程与科学》 北大核心 2025年第4期601-611,共11页
在大数据时代,AI和云计算等各种数据中心应用对于大规模数据的存储和计算需求变得越来越迫切,而海量数据的访问开销已成为限制系统性能的主要瓶颈。此外,现有数据中心架构还存在内存利用率不高和内存扩展能力受限的问题。基于新型内存... 在大数据时代,AI和云计算等各种数据中心应用对于大规模数据的存储和计算需求变得越来越迫切,而海量数据的访问开销已成为限制系统性能的主要瓶颈。此外,现有数据中心架构还存在内存利用率不高和内存扩展能力受限的问题。基于新型内存语义互连协议的内存池系统具备高带宽、低能耗、大容量和可扩展等一系列特点,为解决上述问题提供了新的思路,将对未来的数据中心架构产生重大影响。讨论并对比了OpenCAPI、Gen-Z、CCIX、NVLink和CXL 5种新型内存语义互连协议的特点和工作方式,分析了其在构建内存池系统中的作用,还进一步探讨了其在内存池系统方面的应用研究。不管是在工业界还是学术界,CXL是目前关注度最高、发展前景最好的一种内存语义互连技术,因此特别强调了CXL的特点、优势和研究现状。最后,分析了目前基于新型内存语义互连协议的内存池系统仍然面临的挑战,并对未来该方向的研究进行了展望。 展开更多
关键词 数据中心架构 内存语义互连 内存池 计算高速链路
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智能体互联网:概念、架构及关键技术 被引量:1
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作者 段晓东 孙滔 +4 位作者 陆璐 刘鹏 郭楚怡 付月霞 杜宗鹏 《电信科学》 北大核心 2025年第10期1-10,共10页
随着生成式人工智能(artificial intelligence,AI)技术的发展,基于大语言模型驱动的智能体开始涌现,智能体间的协作通信成为未来网络发展的重要方向之一。需要在当前网络上构建新的基础设施,引入新的接入和认证、组网和寻址、传输和控... 随着生成式人工智能(artificial intelligence,AI)技术的发展,基于大语言模型驱动的智能体开始涌现,智能体间的协作通信成为未来网络发展的重要方向之一。需要在当前网络上构建新的基础设施,引入新的接入和认证、组网和寻址、传输和控制等网络机制,进行跨协议层的网络技术创新,迎接面向AI发展的新通信范式变革。基于智能体通信的应用场景,分析了智能体广域互联对IP网络的需求和影响,提出了智能体互联网组网、架构及协议创新方向,支撑端到端智能体通信的实现。 展开更多
关键词 智能体互联网 组网及架构 广域互联
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智算网络发展综述 被引量:3
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作者 段晓东 程伟强 张昊 《中兴通讯技术》 北大核心 2025年第2期53-62,共10页
智算中心网络作为智算中心的连接底座,需要具备高性能、低时延的通信能力。智算中心网络体系是一个多要素融合的复杂系统,依赖于智算业务、机内/外交换芯片、网卡、网络设备等上下游产业协同创新。系统剖析了服务器/超节点内图形处理器(... 智算中心网络作为智算中心的连接底座,需要具备高性能、低时延的通信能力。智算中心网络体系是一个多要素融合的复杂系统,依赖于智算业务、机内/外交换芯片、网卡、网络设备等上下游产业协同创新。系统剖析了服务器/超节点内图形处理器(GPU)互联网络、同园区机间互联网络、跨园区智算中心互联网络三大核心领域,探讨了智算网络的需求、挑战以及业界发展态势。中国移动创新提出全向智感互联架构(OISA)、全调度以太网(GSE)技术体系、弹性以太网聚合、精细化拥塞控制、物理层安全等多项创新技术,旨在构建超大规模、超高带宽、超低时延、超高可靠的智算中心网络,助力人工智能(AI)产业发展。 展开更多
关键词 智算中心网络 全向智感互联架构 全调度以太网 智算中心互联
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AXI协议跨芯粒传输的架构设计与实现
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作者 宋朝阳 周宏伟 +5 位作者 马驰远 刘宇骢 梁杰 李焓响 周雨萱 陈志强 《集成电路与嵌入式系统》 2025年第11期71-81,共11页
随着对芯片算力和性能需求的不断提升,多芯粒集成技术已成为提升芯片集成度与算力的重要途径。芯粒互联接口是实现芯粒架构的关键,其兼容性设计,特别是支持多种互联协议的能力,是当前面临的核心挑战。鉴于AXI协议在片上系统中的广泛应用... 随着对芯片算力和性能需求的不断提升,多芯粒集成技术已成为提升芯片集成度与算力的重要途径。芯粒互联接口是实现芯粒架构的关键,其兼容性设计,特别是支持多种互联协议的能力,是当前面临的核心挑战。鉴于AXI协议在片上系统中的广泛应用,研究芯粒互联接口如何高效兼容AXI协议具有重要意义。基于课题组自主定义的芯粒互联标准,在协议层设计了一套完整的AXI协议跨芯粒传输架构电路。该架构采用基于本地代理的流控机制实现了AXI协议通道握手的跨芯粒传输。文中详细阐述了如何将AXI协议信号映射到互联接口的数据包中,从而完成AXI协议的跨芯粒传输。通过搭建UVM验证环境,验证了架构电路功能的正确性。同时,搭建FPGA验证平台对电路性能进行测试:在读/写数据位宽为1024位、对4 KB存储空间执行突发写操作的AXI事务场景下,理论上的最小延迟开销为64个周期,测得所设计实现架构下突发写事务的传输延迟为85个时钟周期。在互联接口频率为1 GHz下,互联接口的带宽利用率达到84.92%。本文研究为其他芯粒互联标准设计协议层适配AXI协议或类似协议提供了一个系统性的参考。 展开更多
关键词 芯粒 互联接口 AXI协议 跨芯粒传输架构 FPGA测试方法
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基于不同总线协议的DMA控制器研究进展 被引量:1
18
作者 任小龙 杨延飞 +4 位作者 王立涵 严登辉 张浩 李飞飞 李连碧 《半导体技术》 北大核心 2025年第2期117-126,共10页
随着计算机技术的飞速发展,对大规模数据传输和处理效率的要求越来越高。直接存取存储(DMA)控制允许设备和存储器之间直接进行高速数据传输,有效提升了数据传输效率,因而得到广泛的研究。综述了基于不同总线架构的DMA控制器的研究进展... 随着计算机技术的飞速发展,对大规模数据传输和处理效率的要求越来越高。直接存取存储(DMA)控制允许设备和存储器之间直接进行高速数据传输,有效提升了数据传输效率,因而得到广泛的研究。综述了基于不同总线架构的DMA控制器的研究进展。首先,在分析传统中央处理器(CPU)传输数据局限性的基础上,阐述了DMA控制器与总线结合的重要性。其次,重点探讨了基于高级微控制器总线架构(AMBA)和高速外设部件互连标准(PCIe)两种常用总线协议的DMA控制器的研究进展,从频率、传输速率、功耗等方面进行性能比较和分析总结,并在此基础上展望了未来基于这两种总线协议的DMA技术的发展方向。最后,介绍了基于其他总线协议的DMA控制器的研究进展,在分析其性能优势的基础上为新型DMA控制器设计提供新思路。 展开更多
关键词 直接存取存储(DMA)控制器 高级微控制器总线架构(AMBA) 高级高性能总线(AHB) 高级可拓展接口(AXI)总线 高速外设部件互连标准(PCIe)总线 CoreConnect总线 片内总线(ICB)
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处理器集成芯片架构研究进展
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作者 顾凯 方健 +2 位作者 刘同波 裴秉玺 张光达 《智能安全》 2025年第4期102-112,共11页
大数据、人工智能等技术的迅猛发展对处理器芯片的性能提出了更高的要求,随着摩尔定律的速度放缓,通过堆积硬件计算资源来提升处理器算力越来越困难。集成芯片技术能够有效扩展处理器算力,也可以突破掩膜限制,降低芯片设计生产成本,但... 大数据、人工智能等技术的迅猛发展对处理器芯片的性能提出了更高的要求,随着摩尔定律的速度放缓,通过堆积硬件计算资源来提升处理器算力越来越困难。集成芯片技术能够有效扩展处理器算力,也可以突破掩膜限制,降低芯片设计生产成本,但该技术也存在着性能开销。基于此,分析了处理器集成芯片的性能瓶颈问题,从芯粒分解与组合及芯粒互连网络两个角度分析处理器集成芯片的架构设计。提出的解决方案能有效辅助未来的处理器集成芯片设计,实现强大算力的同时,规避集成芯片的性能开销以及处理器的性能瓶颈。 展开更多
关键词 处理器 集成芯片 芯粒分解与组合 芯粒互连网络 内存墙 IO墙 架构设计
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配电网柔性互联架构与运行研究
20
作者 于洋 《光源与照明》 2025年第7期230-232,共3页
文章聚焦配电网柔性互联架构与运行优化研究,分析了配电网柔性互联架构的设计理念和原则、拓扑结构和设计方案,以及关键设备与技术。同时,进一步探讨了配电网柔性互联运行优化方法与策略,采用多目标、动态模拟与智能算法,以及混合协调... 文章聚焦配电网柔性互联架构与运行优化研究,分析了配电网柔性互联架构的设计理念和原则、拓扑结构和设计方案,以及关键设备与技术。同时,进一步探讨了配电网柔性互联运行优化方法与策略,采用多目标、动态模拟与智能算法,以及混合协调控制策略提高了电能质量和可靠性。案例分析显示,应用配电网柔性互联架构并进行运行优化后,系统损耗降低、可靠性提升,电能质量得到显著改善。 展开更多
关键词 配电网柔性互联 架构设计 智能优化方法
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