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题名高速可重构插入与抽取单元设计
被引量：2
- 1
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作者
马超
戴紫彬
常忠祥
苏伟
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机构
解放军信息工程大学电子技术学院
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出处
《计算机应用与软件》
CSCD
北大核心
2013年第10期326-330,共5页
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文摘
针对序列密码算法中延迟较大的插入与抽取操作,提出基于butterfly和inverse butterfly网络的可重构硬件实现方案,使其支持位宽为2n比特的任意插入与抽取操作。并对控制信息生成算法进行深入的研究,在简化电路硬件实现的同时,大幅度提升了插入与抽取操作的处理性能。该设计已在FPGA上完成功能验证,并在CMOS 0.13μm工艺下完成综合与优化,结果表明,可重构插入与抽取单元延时小于2.7 ns,系统时钟频率达到了450 MHz。
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关键词
插入
抽取
可重构
控制信息生成
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Keywords
insert extract reconfigurable control bits generation
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分类号
TP311
[自动化与计算机技术—计算机软件与理论]
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题名面向序列密码的抽取与插入单元可重构设计研究
被引量：9
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作者
徐建博
戴紫彬
李伟
苏阳
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机构
解放军电子技术学院
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出处
《电子技术应用》
北大核心
2011年第7期65-67,74,共4页
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文摘
研究了抽取与插入单元的基本原理,提出了一种可重构的抽取与插入硬件电路,并对核心模块控制信息生成电路进行了深入研究。可重构硬件电路通过配置能够灵活高效地实现32 bit、64 bit、128 bit、256 bit等位宽抽取与插入操作。该设计在Altera公司的FPGA上进行了功能验证,并在Synopsys公司的Design Compiler上进行了逻辑综合、优化。结果表明,在CMOS 0.13μm工艺下,可重构移位单元硬件架构核心频率可以达到350 MHz。
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关键词
抽取
插入
可重构
控制信息生成
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Keywords
extract
insert
reconfigurable
control bits generation
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分类号
TN492
[电子电信—微电子学与固体电子学]
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