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The Effect of Queuing Mechanisms First in First out (FIFO), Priority Queuing (PQ) and Weighted Fair Queuing (WFQ) on Network’s Routers and Applications 被引量:4
1
作者 Mustafa El Gili Mustafa Samani A. Talab 《Wireless Sensor Network》 2016年第5期77-84,共8页
The paper presents the simulation results of the comparison of three Queuing Mechanisms, First in First out (FIFO), Priority Queuing (PQ), and Weighted Fair Queuing (WFQ). Depending on their effects on the network’s ... The paper presents the simulation results of the comparison of three Queuing Mechanisms, First in First out (FIFO), Priority Queuing (PQ), and Weighted Fair Queuing (WFQ). Depending on their effects on the network’s Routers, the load of any algorithm of them over Router’s CPUs and memory usage, the delay occurred between routers when any algorithm has been used and the network application throughput. This comparison explains that, PQ doesn’t need high specification hardware (memory and CPU) but when used it is not fair, because it serves one application and ignore the other application and FIFO mechanism has smaller queuing delay, otherwise PQ has bigger delay. 展开更多
关键词 Queuing Mechanisms QoS first in first out (fifo) Priority Queuing (PQ) Weighted Fair Queuing (WFQ)
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FIFO(First Input First Output)先入先出
2
《现代制造》 2008年第27期43-43,共1页
FIFO表示信息存储的一种数据结构。采用FIFO方式时,信息被以所收到的次序进行传输,队列(Queue)就是基于这种性质实现的。
关键词 first 先入先出 信息存储 fifo 数据结构 队列
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Ovation系统FIRSTOUT和FIFO跳闸首出比较 被引量:1
3
作者 沈冲平 刘黎 《科技与创新》 2017年第14期54-55,共2页
对Ovation控制系统FIRSTOUT功能块进行了全面介绍,并比较了2个功能块的差异,FIFO功能块比FIRSTOUT功能块作为首出分辨率更高、记录更准确。
关键词 OVATION fifo NTRP ETS
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基于异步FIFO的Camera Link数字图像光纤传输技术 被引量:4
4
作者 张维达 崔明 张甫恺 《仪表技术与传感器》 CSCD 北大核心 2016年第7期47-50,共4页
为满足数字图像的远距离传输需求,设计用于传输Camera Link接口数字图像的光纤通讯系统。系统分为发送和接收两个部分,分别负责Camera Link数字图像到光信号的转化以及相应的逆变换过程。采用Cyclone I EP1C12 FPGA作为发送和接收板卡... 为满足数字图像的远距离传输需求,设计用于传输Camera Link接口数字图像的光纤通讯系统。系统分为发送和接收两个部分,分别负责Camera Link数字图像到光信号的转化以及相应的逆变换过程。采用Cyclone I EP1C12 FPGA作为发送和接收板卡的逻辑控制核心。在发送板卡的FPGA内设计逻辑控制模块,操纵两个异步FIFO(先入先出队列),将接收到的数字图像缓存,用本地时钟读取后再进行串行化转换。在不改变数字图像时序关系的前提下,用本地时钟替换原有的像素时钟,消除像素时钟不稳定性对后续传输影响。实验表明,利用该技术可以有效提升光纤传输系统的适应性、稳定性,改善、消除由像素时钟抖动造成的传输图像抖动现象。 展开更多
关键词 Camera Link 数字图像 fifo 光纤传输
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Camera Link接口的异步FIFO设计与实现 被引量:2
5
作者 宋振丰 李岩 王鹤淇 《电子技术应用》 北大核心 2009年第12期61-64,共4页
介绍了异步FIFO在Camera Link接口中的应用,将Camera Link接口中的帧有效信号FVAL和行有效信号LVAL引入到异步FIFO的设计中。分析了FPGA中设计异步FIFO的难点,解决了异步FIFO设计中存在的两个关键问题:一是尽量降低电路中亚稳态的出现概... 介绍了异步FIFO在Camera Link接口中的应用,将Camera Link接口中的帧有效信号FVAL和行有效信号LVAL引入到异步FIFO的设计中。分析了FPGA中设计异步FIFO的难点,解决了异步FIFO设计中存在的两个关键问题:一是尽量降低电路中亚稳态的出现概率;二是如何产生空、满等相应的控制信号。为Camera Link接口提供了稳定的视频数据及控制信号。 展开更多
关键词 CAMERA Link 异步fifo 双口RAM 亚稳态 格雷码
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采用FIFO技术Windows环境下的高速实时采集
6
作者 吴少雷 李志远 《合肥工业大学学报(自然科学版)》 CAS CSCD 2002年第2期226-229,共4页
比较了几种常见的数据采集卡的构成及其在 Windows环境下的采集方法 ,分析了各自的优缺点 ,简要介绍了 Win-dows的底层接口和 F IFO的结构原理 ,给出了采用 FIF O技术设计高速实时数据采集系统的方法。 FIF O技术的采用 ,既保证了 wind... 比较了几种常见的数据采集卡的构成及其在 Windows环境下的采集方法 ,分析了各自的优缺点 ,简要介绍了 Win-dows的底层接口和 F IFO的结构原理 ,给出了采用 FIF O技术设计高速实时数据采集系统的方法。 FIF O技术的采用 ,既保证了 windows的多任务操作系统的特点 ,又保证了数据采集的可靠性 ,使在 Windows环境下无论对高速大容量数据采集还是对单次瞬变信号的实时捕获都提供了一种行之有效的方法。 展开更多
关键词 高速实时采集 fifo WinDOWS 数据采集卡
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基于TMS320DM642与FIFO的CameraLink相机接口实现
7
作者 丁杨 《工业控制计算机》 2011年第2期31-32,34,共3页
提出了数字信号处理芯片TMS320DM642和EPM3128控制一片FIFO和ChannelLink芯片实现DSP与Camer-aLink的无缝连接。解决图像数据输出速度为40MB/S的高速图像数据采集系统中前端采集与后端输出的速度匹配问题。系统实现实时、高速的采集大... 提出了数字信号处理芯片TMS320DM642和EPM3128控制一片FIFO和ChannelLink芯片实现DSP与Camer-aLink的无缝连接。解决图像数据输出速度为40MB/S的高速图像数据采集系统中前端采集与后端输出的速度匹配问题。系统实现实时、高速的采集大量的图像数据。 展开更多
关键词 DM642 CAMERALinK 高速图像采集 EDMA EMIF fifo
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基于Vivado的Xilinx FIFO IP核应用与仿真 被引量:1
8
作者 李鹏治 《信息通信》 2019年第2期124-125,共2页
介绍了FIFO的原理,以及在FPGA数字系统设计中的应用,着重分析了Xlinx公司的FIFO IP核的构建方法与实际应用方法。通过编写Verilog代码对FIFO空间进行读写,并使用Xilinx公司的开发环境Vivado内嵌的Modelsim对FIFO IP核进行了时序仿真,结... 介绍了FIFO的原理,以及在FPGA数字系统设计中的应用,着重分析了Xlinx公司的FIFO IP核的构建方法与实际应用方法。通过编写Verilog代码对FIFO空间进行读写,并使用Xilinx公司的开发环境Vivado内嵌的Modelsim对FIFO IP核进行了时序仿真,结合仿真结果详细分析了各控制信号以及FIFO的工作机制,为基于FIFO的FPGA数字系统设计提供了参考。 展开更多
关键词 fifo FPGA IP核 VIVADO 时序仿真
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一种基于链式FIFO的雷达目标检测FPGA实现方法
9
作者 杭心齐 郭大路 +1 位作者 乔灵博 宫辉 《太赫兹科学与电子信息学报》 2025年第3期231-239,共9页
现有毫米波雷达目标检测主要基于串行处理平台实现,对大尺寸雷达图像处理的速度存在一定瓶颈。本文基于现场可编程门阵列(FPGA)提出一种以链式先进先出(FIFO)缓冲器为核心,融合图像提取思路的毫米波雷达目标快速检测结构。通过链式FIFO... 现有毫米波雷达目标检测主要基于串行处理平台实现,对大尺寸雷达图像处理的速度存在一定瓶颈。本文基于现场可编程门阵列(FPGA)提出一种以链式先进先出(FIFO)缓冲器为核心,融合图像提取思路的毫米波雷达目标快速检测结构。通过链式FIFO实现多帧数据对齐与并行输出,得到窗口边缘数据;根据自定义窗参数,将边缘数据分区求和并延时缓存,可实现对窗移动前后计算结果的复用,配合流水线式处理结构提高运算效率;对相邻子图像重叠区域合理划分,从大尺寸图像中提取出多个小尺寸子图像单独处理,大幅提升雷达目标检测算法的实现速度,并显著节省片上逻辑资源。基于92~94 GHz的调频连续波(FMCW)毫米波雷达对本文目标检测FPGA实现方法进行验证,对于1000×2000的大尺寸雷达图像可实现120 ms的快速处理,且FPGA布署算法仅消耗32个18K BRAM和6461个LUT。 展开更多
关键词 目标检测 图像提取 链式fifo 流水线
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Optimal Implementation of Two FIFO-Queues in Single-Level Memory
10
作者 Elena A. Aksenova Andrew V. Sokolov 《Applied Mathematics》 2011年第10期1297-1302,共6页
This paper presents mathematical models and optimal algorithms of two FIFO-queues control in single-level memory. These models are designed as two-dimensional random walks on the integer lattice in a rectangular area ... This paper presents mathematical models and optimal algorithms of two FIFO-queues control in single-level memory. These models are designed as two-dimensional random walks on the integer lattice in a rectangular area for consecutive implementation and a triangle area for linked list implementation. 展开更多
关键词 fifo-Queues Random WALKS MARKOV CHAinS Consecutive IMPLEMENTATION Linked List IMPLEMENTATION Paged IMPLEMENTATION
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异步FIFO的实现方案研究
11
作者 李瑶 《信息记录材料》 2025年第7期143-145,共3页
为了解决异步先进先出(FIFO)储存器设计中的亚稳态和空满状态判断问题,本文对国内外相关研究提出的设计方案进行了深入探讨和对比,并对现有已发表的异步FIFO电路实现进行了性能分析。研究的主要目的是有效实现高速数据存储和快速读取。... 为了解决异步先进先出(FIFO)储存器设计中的亚稳态和空满状态判断问题,本文对国内外相关研究提出的设计方案进行了深入探讨和对比,并对现有已发表的异步FIFO电路实现进行了性能分析。研究的主要目的是有效实现高速数据存储和快速读取。在此基础上,本文分别阐述了各设计方案的优缺点。结果表明:本文提及的四种设计方案均能够有效减少亚稳态的影响,提高数据传输的可靠性,从而显著提升系统的工作效率。 展开更多
关键词 异步先进先出(fifo) 亚稳态 空满状态 VERILOG
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使用排队论模型对FIFO深度的研究 被引量:10
12
作者 宋宇鲲 王锐 +1 位作者 胡永华 高明伦 《仪器仪表学报》 EI CAS CSCD 北大核心 2006年第z3期2485-2487,共3页
长期以来FIFO研究偏重于降低单元间传输延时,所建立的模型不能满足对其它参数研究的要求。特别是FIFO深度,一般依靠设计者经验给出,尚未有理论上的解决方案。当可重构技术应用日趋成熟,可重构系统芯片功能可由应用工程师最终确定时,FIF... 长期以来FIFO研究偏重于降低单元间传输延时,所建立的模型不能满足对其它参数研究的要求。特别是FIFO深度,一般依靠设计者经验给出,尚未有理论上的解决方案。当可重构技术应用日趋成熟,可重构系统芯片功能可由应用工程师最终确定时,FIFO深度选取问题更加突出。针对上述问题,本文提出了一种基于排队论的新型FIFO模型,使用该模型探讨了FIFO深度问题,阐述了FIFO深度的理论含义,并给出了FIFO深度理论计算公式。 展开更多
关键词 排队论 fifo深度 fifo模型 可重构系统芯片
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基于FPGA的高速数据存储系统中FIFO控制的设计 被引量:18
13
作者 于祥凤 刘学斌 +1 位作者 胡炳樑 卫翠玉 《核电子学与探测技术》 CAS CSCD 北大核心 2010年第1期59-62,共4页
介绍了一种高速CCD相机数据存储中的FIFO缓存控制的方法。利用FPGA对高速数据存储系统中的FIFO缓存器进行控制,在QuartusⅡ开发平台上进行设计仿真,结果表明数据流和IDE硬盘之间的存储速率得到匹配,数据实时存储到硬盘中,为后期的数据... 介绍了一种高速CCD相机数据存储中的FIFO缓存控制的方法。利用FPGA对高速数据存储系统中的FIFO缓存器进行控制,在QuartusⅡ开发平台上进行设计仿真,结果表明数据流和IDE硬盘之间的存储速率得到匹配,数据实时存储到硬盘中,为后期的数据处理提供了原始数据,同时也为存储系统的设计提供了参考。 展开更多
关键词 fifo FPGA VHDL数据存储
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基于FIFO技术的数据采集系统研究 被引量:8
14
作者 王英 瞿中 +2 位作者 邓亚平 唐甜甜 徐强 《计算机工程与设计》 CSCD 北大核心 2005年第3期743-745,共3页
数据采集系统[1]是工业CT[1](Industrial Computed Tomography--ICT)的重要组成部分,保证数据采集系统工作的稳定、可靠和一致性,对于研制和改进其质量和提高工业CT整体性能有着重要的意义.在Windows操作系统下,程序查询的教据传输方式... 数据采集系统[1]是工业CT[1](Industrial Computed Tomography--ICT)的重要组成部分,保证数据采集系统工作的稳定、可靠和一致性,对于研制和改进其质量和提高工业CT整体性能有着重要的意义.在Windows操作系统下,程序查询的教据传输方式会因为其它程序的中断造成数据丢失,针对这一问题,对工业CT的数据采集系统进行了设计与研究[3].将程序查询方式改为中断方式,在计数逻辑电路的数据通道前端加上FIFO缓存,从而保证了数据采集和传输的可靠和稳定性. 展开更多
关键词 数据采集系统 fifo 工业CT 数据丢失 缓存 WinDOWS操作系统 中断 前端 逻辑电路 传输
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片上网络FIFOs的内建自测试方法研究 被引量:22
15
作者 赵建武 师奕兵 王志刚 《仪器仪表学报》 EI CAS CSCD 北大核心 2009年第8期1768-1772,共5页
片上网络是对微系统芯片的传统片上互连结构的统一和发展,一种新的集成电路设计技术只有在它的测试技术发展完善后才能被广泛使用。首先建立了片上网络路由器FIFOs的功能模型,在此基础上,提出了一种基于可测性设计技术并且具有线性计算... 片上网络是对微系统芯片的传统片上互连结构的统一和发展,一种新的集成电路设计技术只有在它的测试技术发展完善后才能被广泛使用。首先建立了片上网络路由器FIFOs的功能模型,在此基础上,提出了一种基于可测性设计技术并且具有线性计算复杂度O(n)的FIFOs测试算法,论述了一种新颖的复用片上网络、共享内建自测试(BIST)结构对片上网络路由器FIFOs并行测试的方法。实验数据分析表明这种测试方法具有较高的故障覆盖率、较小的测试时间和片上资源开销。 展开更多
关键词 微系统芯片 片上网络 fifos 内建自测试 可测性设计
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异步FIFO状态判断的研究与设计 被引量:9
16
作者 刘洪波 龙娟 +1 位作者 郝晓莉 沈绪榜 《微电子学与计算机》 CSCD 北大核心 2007年第3期81-84,共4页
研究了异步FIFO状态判断的问题,提出了一种能快速准确判断异步FIFO空、满和半满状态的方案,设计了状态判断的逻辑电路并给出了物理实现。
关键词 fifo 状态 异步
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基于DDR2 SDRAM的高速大容量异步FIFO的设计与实现 被引量:14
17
作者 徐欣 周舟 +1 位作者 李楠 孙兆林 《中国测试》 CAS 2009年第6期34-37,共4页
为了解决高速实时系统中海量数据的缓存问题,提出了一种基于DDR2 SDRAM的高速大容量异步FIFO设计方案。首先介绍了DDR2 SDRAM控制器和片上FIFO的原理与实现方法,基于DDR2 SDRAM的高带宽和分时复用技术设计了FIFO控制器的工作机制,最后... 为了解决高速实时系统中海量数据的缓存问题,提出了一种基于DDR2 SDRAM的高速大容量异步FIFO设计方案。首先介绍了DDR2 SDRAM控制器和片上FIFO的原理与实现方法,基于DDR2 SDRAM的高带宽和分时复用技术设计了FIFO控制器的工作机制,最后深入分析了FIFO控制器各部分的工作原理并对其进行了实验。经过测试,基于DDR2 SDRAM的FIFO实现了最高475MHz的总线速率,8~256位的总线位宽,2GB最大数据容量。该FIFO可以解决高速海量数据缓存的问题,在工程应用中有显著的参考价值。 展开更多
关键词 高速海量数据缓存 fifo存储器 DDR2 SDRAM技术 FPGA技术 分时复用
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基于FPGA异步FIFO的研究与实现 被引量:51
18
作者 于海 樊晓桠 《微电子学与计算机》 CSCD 北大核心 2007年第3期210-213,216,共5页
通过分析异步FIFO的结构和关键技术,以减少电路中亚稳态出现概率为主要目的,提出了一种有效实现异步FIFO的设计新方法。结合FPGA对设计的异步FIFO进行了验证并针对两种FIFO模型做了性能比较,结果表明该设计大大提高了工作频率和资源利... 通过分析异步FIFO的结构和关键技术,以减少电路中亚稳态出现概率为主要目的,提出了一种有效实现异步FIFO的设计新方法。结合FPGA对设计的异步FIFO进行了验证并针对两种FIFO模型做了性能比较,结果表明该设计大大提高了工作频率和资源利用率。 展开更多
关键词 异步fifo 亚稳态 格雷码 FPGA
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基于FPGA视频和图像处理系统的FIFO缓存技术 被引量:24
19
作者 向厚振 张志杰 王鹏 《电视技术》 北大核心 2012年第9期41-43,共3页
通过研究视频图像处理和视频图像帧格式以及FIFO缓存技术,提出了基于FPGA的视频图像处理系统设计。该设计运用帧间差分法、同步FIFO缓存设计,有效避免了图像处理系统设计中亚稳态和异步信号处理等时序性难题,实现了视频图像序列的动态... 通过研究视频图像处理和视频图像帧格式以及FIFO缓存技术,提出了基于FPGA的视频图像处理系统设计。该设计运用帧间差分法、同步FIFO缓存设计,有效避免了图像处理系统设计中亚稳态和异步信号处理等时序性难题,实现了视频图像序列的动态目标检测系统设计。ChipScope在线逻辑分析结果表明,所设计的系统具有实时的视频图像处理性能,与基于外接存储器缓存的系统设计相比较,稳定性更高,实时性更好,功耗更低。 展开更多
关键词 FPGA 图像处理 帧差法 fifo 动态目标检测 ChipScope
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基于FPGA和FIFO技术的多串口系统设计与实现 被引量:13
20
作者 陈标龙 王保成 周江华 《计算机测量与控制》 北大核心 2013年第10期2835-2837,共3页
为了同时与多路外设进行串口通信并且提高通信效率,提出了一种基于FPGA和FIFO技术的多串口系统方案;利用一种新的结构框架,可以根据实际工程需要灵活扩展多路串口;该系统由接口模块、寄存器读写模块以及2路内置16字节FIFO的UART模块组成... 为了同时与多路外设进行串口通信并且提高通信效率,提出了一种基于FPGA和FIFO技术的多串口系统方案;利用一种新的结构框架,可以根据实际工程需要灵活扩展多路串口;该系统由接口模块、寄存器读写模块以及2路内置16字节FIFO的UART模块组成,使用Xilinx ISE开发平台和verilog语言实现;通过软件仿真和实际测试验证了扩展的2路串口均能正常工作,FIFO的使用减少了MCU的中断开销,提高了MCU与外设的通信效率。 展开更多
关键词 fifo 串口扩展 UART FPGA VERILOG
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