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一种12位5.5 MS/s同步FLASH-SAR ADC的设计
1
作者 朱朝峰 汪东 +2 位作者 邓欢 龙睿 唐金波 《电子设计工程》 2023年第22期67-72,共6页
该文设计了一款12位5.5 MS/s同步全并行-逐次逼近模数转换器(FLASH-SAR ADC)。提出了一种新型单端-差分混合DAC电容阵列,将差分的优势融合到单端SAR ADC中,同时采用分段结构,降低电路面积和功耗。设计了一款跨电压域动态比较器,并采用... 该文设计了一款12位5.5 MS/s同步全并行-逐次逼近模数转换器(FLASH-SAR ADC)。提出了一种新型单端-差分混合DAC电容阵列,将差分的优势融合到单端SAR ADC中,同时采用分段结构,降低电路面积和功耗。设计了一款跨电压域动态比较器,并采用输出失调校准技术,消除比较器失调电压。根据FLASH ADC和SAR ADC转换的结果进行编码设计,解决了高位和低位输出码组合的问题,并快速处理冗余位,得到最终结果。该设计采用55 nm CMOS工艺实现,在3.3 V模拟电源和1.2 V数字电源下,FLASH-SAR ADC的后仿真有效位达到11.82 bit,信噪失真比为73.12 dB,无散杂动态范围为80.07 dB,总谐波失真为86.22 dB。 展开更多
关键词 flash-sar ADC 电容阵列 跨电压域比较器 有效位
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12 bit 100 MS/s Flash-SAR混合型模数转换器的设计与实现 被引量：1
2
作者 张章 吴宵 解光军 《合肥工业大学学报（自然科学版）》 CAS 北大核心 2020年第2期216-223,共8页
文章设计了一款Flash-SAR混合型模数转换器(analog-to-digital converter,ADC),结合了快闪型(flash)ADC与逐次逼近型(successive approximation register,SAR)ADC的优点,具有高速、高精度和低功耗的特点;提出了一种带冗余位数字校准算法... 文章设计了一款Flash-SAR混合型模数转换器(analog-to-digital converter,ADC),结合了快闪型(flash)ADC与逐次逼近型(successive approximation register,SAR)ADC的优点,具有高速、高精度和低功耗的特点;提出了一种带冗余位数字校准算法,该算法在SAR ADC中添加1 bit冗余位,当第1级Flash ADC带来的误差小于一定的失调电压限度,第2级SAR ADC中的数字校正电路能够将误差校准回来,最终得到正确的数字输出。该ADC采用"3+10"的2级流水线结构,在SMIC 0.18μm互补金属氧化物半导体(complementary metal-oxide-semiconductor,CMOS)混合信号工艺下进行仿真,当电源电压为1.8 V,采样频率为100 MHz,输入信号接近Nyquist频率时,通过数字校准,ADC有效位(effective number of bits,ENOB)为10.990,信噪比为67.973 dB,无杂散波动态范围为95.381 dB,仿真结果证明了该算法能够有效提升ADC系统性能。 展开更多
关键词 快闪型模数转换器 逐次逼近型模数转换器 冗余位数字校准
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模数转换技术的分析与应用 被引量：3
3
作者 蒋臻 《电子与封装》 2007年第3期38-42,共5页
从市场角度入手分析了ADC在电子技术发展中的重要性及其特殊性;然后分析ADC不同的算法组合,如并行比较型、逐次逼近型、积分型、∑-Δ型、流水线型ADC,详细比较各种算法的优缺点及主要用途;最后结合工艺的发展,展望了ADC的发展趋势和存... 从市场角度入手分析了ADC在电子技术发展中的重要性及其特殊性;然后分析ADC不同的算法组合,如并行比较型、逐次逼近型、积分型、∑-Δ型、流水线型ADC,详细比较各种算法的优缺点及主要用途;最后结合工艺的发展,展望了ADC的发展趋势和存在困难。并指出在选用ADC时,不仅要考虑应用的精度、速度等主要指标,还要考虑输入信号的形式、输入信号范围、输入通道类型和数量、工作电源等多种具体功能上的差异。 展开更多
关键词 ∑-Δ ADC 流水线型ADC 逐次逼近型ADC 并行比较ADC
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ADC的结构方案概述
4
作者 张森 《中国集成电路》 2017年第1期42-46,51,共6页
本文介绍了并行结构、流水线结构、SAR结构和sigma-delta结构四种体系ADC的设计技术和优缺点。不同的应用中,关注的ADC指标不同,所以要在性能、功耗和成本之间折衷考量,选取最合适的技术方案。
关键词 ADC 并行结构 流水线 SAR SIGMA-DELTA
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