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片上网络FIFOs的内建自测试方法研究 被引量:22
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作者 赵建武 师奕兵 王志刚 《仪器仪表学报》 EI CAS CSCD 北大核心 2009年第8期1768-1772,共5页
片上网络是对微系统芯片的传统片上互连结构的统一和发展,一种新的集成电路设计技术只有在它的测试技术发展完善后才能被广泛使用。首先建立了片上网络路由器FIFOs的功能模型,在此基础上,提出了一种基于可测性设计技术并且具有线性计算... 片上网络是对微系统芯片的传统片上互连结构的统一和发展,一种新的集成电路设计技术只有在它的测试技术发展完善后才能被广泛使用。首先建立了片上网络路由器FIFOs的功能模型,在此基础上,提出了一种基于可测性设计技术并且具有线性计算复杂度O(n)的FIFOs测试算法,论述了一种新颖的复用片上网络、共享内建自测试(BIST)结构对片上网络路由器FIFOs并行测试的方法。实验数据分析表明这种测试方法具有较高的故障覆盖率、较小的测试时间和片上资源开销。 展开更多
关键词 微系统芯片 片上网络 fifos 内建自测试 可测性设计
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一种基于链式FIFO的雷达目标检测FPGA实现方法
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作者 杭心齐 郭大路 +1 位作者 乔灵博 宫辉 《太赫兹科学与电子信息学报》 2025年第3期231-239,共9页
现有毫米波雷达目标检测主要基于串行处理平台实现,对大尺寸雷达图像处理的速度存在一定瓶颈。本文基于现场可编程门阵列(FPGA)提出一种以链式先进先出(FIFO)缓冲器为核心,融合图像提取思路的毫米波雷达目标快速检测结构。通过链式FIFO... 现有毫米波雷达目标检测主要基于串行处理平台实现,对大尺寸雷达图像处理的速度存在一定瓶颈。本文基于现场可编程门阵列(FPGA)提出一种以链式先进先出(FIFO)缓冲器为核心,融合图像提取思路的毫米波雷达目标快速检测结构。通过链式FIFO实现多帧数据对齐与并行输出,得到窗口边缘数据;根据自定义窗参数,将边缘数据分区求和并延时缓存,可实现对窗移动前后计算结果的复用,配合流水线式处理结构提高运算效率;对相邻子图像重叠区域合理划分,从大尺寸图像中提取出多个小尺寸子图像单独处理,大幅提升雷达目标检测算法的实现速度,并显著节省片上逻辑资源。基于92~94 GHz的调频连续波(FMCW)毫米波雷达对本文目标检测FPGA实现方法进行验证,对于1000×2000的大尺寸雷达图像可实现120 ms的快速处理,且FPGA布署算法仅消耗32个18K BRAM和6461个LUT。 展开更多
关键词 目标检测 图像提取 链式FIFO 流水线
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基于FPGA的UART串口技术研究 被引量:1
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作者 尹军茹 《电脑知识与技术》 2025年第4期76-84,共9页
针对传统UART集成电路芯片设计复杂、可移植性差、成本较高等诸多缺点,文章提出一种基于DSP+FPGA架构的UART串口设计方案。该方案利用FPGA资源实现高性能、低成本的通用化UART驱动,具有高可配置性、可扩容性和良好的可移植性。文章详细... 针对传统UART集成电路芯片设计复杂、可移植性差、成本较高等诸多缺点,文章提出一种基于DSP+FPGA架构的UART串口设计方案。该方案利用FPGA资源实现高性能、低成本的通用化UART驱动,具有高可配置性、可扩容性和良好的可移植性。文章详细论述了系统架构设计、FPGA软件设计和DSP软件设计,采用差错重传机制和奇偶校验,提高了数据传输的可靠性和正确性。实验结果验证了该方案实现了可靠的全双工串口通信,并具有良好的工程实用性和复用价值。 展开更多
关键词 UART FPGA DSP FIFO 串口接收 串口发送
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AGV在合成树脂车间保险杠转运中的应用
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作者 李聪 刘晶 +5 位作者 廖端 杨磊 安金华 郭江华 曹世铭 李超 《物流技术与应用》 2025年第7期106-110,共5页
随着智能制造技术的快速发展,AGV(自动引导车)在制造业物流环节的应用日益广泛。本文以某汽车主机厂合成树脂车间为研究对象,针对保险杠从注塑下挂至涂装上挂工序的物流痛点,提出基于AGV的无人化转运方案,分析其系统设计、技术实现及效... 随着智能制造技术的快速发展,AGV(自动引导车)在制造业物流环节的应用日益广泛。本文以某汽车主机厂合成树脂车间为研究对象,针对保险杠从注塑下挂至涂装上挂工序的物流痛点,提出基于AGV的无人化转运方案,分析其系统设计、技术实现及效益。实践表明,该方案使双班人力减少6人,保险杠表面划伤不良率下降0.7%,同时通过时间戳绑定确保先进先出(FIFO)原则。本研究为合成树脂车间智能化升级提供了可复用的技术路径。 展开更多
关键词 AGV 保险杠 无人化转运 FIFO 智能制造
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异步FIFO的实现方案研究
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作者 李瑶 《信息记录材料》 2025年第7期143-145,共3页
为了解决异步先进先出(FIFO)储存器设计中的亚稳态和空满状态判断问题,本文对国内外相关研究提出的设计方案进行了深入探讨和对比,并对现有已发表的异步FIFO电路实现进行了性能分析。研究的主要目的是有效实现高速数据存储和快速读取。... 为了解决异步先进先出(FIFO)储存器设计中的亚稳态和空满状态判断问题,本文对国内外相关研究提出的设计方案进行了深入探讨和对比,并对现有已发表的异步FIFO电路实现进行了性能分析。研究的主要目的是有效实现高速数据存储和快速读取。在此基础上,本文分别阐述了各设计方案的优缺点。结果表明:本文提及的四种设计方案均能够有效减少亚稳态的影响,提高数据传输的可靠性,从而显著提升系统的工作效率。 展开更多
关键词 异步先进先出(FIFO) 亚稳态 空满状态 VERILOG
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基于DDR3的大容量数据缓存与传输系统设计 被引量:1
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作者 王晨 马游春 郭鑫 《仪表技术与传感器》 CSCD 北大核心 2024年第12期71-74,79,共5页
为了解决目前数据存储系统中缓存深度不足、实用性不强等问题,设计了一种高性能数据缓存与传输系统方案。该系统以ZYNQ系列开发板AX7350作为驱动平台,设计了一种以FIFO级联+乒乓操作的大容量缓存方案,该方案增加了5.625 MB的缓存容量,... 为了解决目前数据存储系统中缓存深度不足、实用性不强等问题,设计了一种高性能数据缓存与传输系统方案。该系统以ZYNQ系列开发板AX7350作为驱动平台,设计了一种以FIFO级联+乒乓操作的大容量缓存方案,该方案增加了5.625 MB的缓存容量,极大提高了系统的缓存深度。通过UDP数据组帧的形式进行以太网数据收发,DDR3作为数据存储媒介。测试结果表明:该系统进行以太网数据传输时的平均丢包率为0.054%,该系统具有可靠性。 展开更多
关键词 DDR3 乒乓操作 以太网 ZYNQ FIFO级联 大容量缓存
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高计数率多通道时间测量与串行读出电路研制
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作者 陆伟建 千奕 +4 位作者 蒲天磊 赵红赟 孙志坤 张家瑞 刘政强 《原子能科学技术》 EI CAS CSCD 北大核心 2024年第12期2592-2600,共9页
近年来应用于中高能核物理实验的先进前端读出专用集成电路(application specific integrated circuit,ASIC)芯片呈现出越来越强的数字化趋势,可提高系统的集成度并降低功耗。论文研制了一种高计数率多通道时间测量与串行读出电路(high-... 近年来应用于中高能核物理实验的先进前端读出专用集成电路(application specific integrated circuit,ASIC)芯片呈现出越来越强的数字化趋势,可提高系统的集成度并降低功耗。论文研制了一种高计数率多通道时间测量与串行读出电路(high-count rate multi-channel time measurement and serial readout circuit,HMTRC),可实现核事件去稀疏化、去随机化的读出。该电路主要包括了基于时钟分相技术的时间数字转化器、控制器、先进先出存储器和基于令牌环逻辑的轮询读出模块。HMTRC已被集成到一款自研的16通道前端读出ASIC芯片中,可测量和储存时间信息,并利用数字驱动的前端读出架构实现时间与能量信息同步读出。测试表明,时间分辨率好于2 ns,功能符合预期。 展开更多
关键词 ASIC 探测器前端读出电子学 FIFO 时钟分相技术 轮询读出
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基于FPGA的异步FIFO缓存数据溢出控制系统 被引量:2
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作者 张伟 《兵工自动化》 北大核心 2024年第9期55-58,65,共5页
为获取更高效、稳定的缓存数据控制方法,设计基于现场可编程门阵列(field programmable gate array,FPGA)的异步FIFO缓存数据溢出控制系统。设计存储控制方案,得到基于FPGA的系统硬件;建立缓存数据存储溢出模型,得到数据节点剩余能量的... 为获取更高效、稳定的缓存数据控制方法,设计基于现场可编程门阵列(field programmable gate array,FPGA)的异步FIFO缓存数据溢出控制系统。设计存储控制方案,得到基于FPGA的系统硬件;建立缓存数据存储溢出模型,得到数据节点剩余能量的最小值最大化求解,在函数模型下判断存储数据是否溢出;设计数据溢出控制算法,得到缓存数据溢出控制系统的软件。分别对数据溢出的监测性能与控制性能进行测试。实验结果表明:使用该方法剩余的能耗较高,可见该方法对于缓存数据的监测与控制性能均较好。 展开更多
关键词 FPGA 异步FIFO存储器 缓存数据 数据溢出控制 存储控制 数据节点
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基于国产FPGA的ARINC429总线接口的设计 被引量:1
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作者 尹嘉乐 彭良福 《电脑与信息技术》 2024年第1期82-85,共4页
依据ARINC429总线的传输规范,提出了ARINC429总线接口的一种设计方案。设计采用国产FPGA芯片SL2-25E,详细描述了结构设计与软件开发,以及集成在FPGA内部的发送、接收等模块的功能。仿真测试结果表明,基于国产FPGA的ARINC429总线接口能... 依据ARINC429总线的传输规范,提出了ARINC429总线接口的一种设计方案。设计采用国产FPGA芯片SL2-25E,详细描述了结构设计与软件开发,以及集成在FPGA内部的发送、接收等模块的功能。仿真测试结果表明,基于国产FPGA的ARINC429总线接口能够完成数据无误收发,并且符合总线规范的要求,结构简单,易于扩展,对其他串行总线数据通信以及航空电子系统的发展具有借鉴意义。 展开更多
关键词 ARINC429总线 FPGA FIFO
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基于Chisel语言的异步FIFO设计及验证 被引量:1
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作者 蒋文成 黄嵩人 《电子与封装》 2024年第9期66-70,共5页
采用敏捷硬件开发语言Chisel,对数字系统设计中经常使用的异步先进先出(FIFO)进行设计,使用Chisel语言特性提高了设计效率和质量。使用ChiselTest框架对所设计的异步FIFO进行基本功能仿真验证,使用通用验证方法学(UVM)进行更加完备的功... 采用敏捷硬件开发语言Chisel,对数字系统设计中经常使用的异步先进先出(FIFO)进行设计,使用Chisel语言特性提高了设计效率和质量。使用ChiselTest框架对所设计的异步FIFO进行基本功能仿真验证,使用通用验证方法学(UVM)进行更加完备的功能仿真验证,再使用QuartusⅡ软件进行逻辑综合。对比使用Chisel语言与使用传统硬件描述语言(HDL)设计的异步FIFO综合结果,结果表明,使用传统HDL语言设计的异步FIFO消耗了50个组合逻辑单元,而使用Chisel语言设计的异步FIFO,综合后仅消耗了39个组合逻辑单元。 展开更多
关键词 Chisel语言 异步FIFO UVM 逻辑综合
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实时Linux中共享内存的实现 被引量:9
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作者 厉海燕 李新明 《计算机应用》 CSCD 北大核心 2001年第11期75-76,共2页
共享内存是进程间通信最快的途径 ,文中介绍实时Linux中共享内存的实现方法 。
关键词 共享内存 fifos LINUX 操作系统 进程
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智能电表负荷曲线存取方法分析
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作者 俞斌奇 徐京生 +4 位作者 洪晶晶 章聪 程显峰 黎周红 张宇明 《电工技术》 2024年第6期129-131,共3页
针对智能电表负荷曲线存取方法多样化情况,分析了2种负荷曲线存取方法,一种是FIFO(First in First out)读取方法,一种是扇区读取方法,并讨论了2种方法的优缺点。
关键词 FIFO 负荷曲线 扇区
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使用排队论模型对FIFO深度的研究 被引量:10
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作者 宋宇鲲 王锐 +1 位作者 胡永华 高明伦 《仪器仪表学报》 EI CAS CSCD 北大核心 2006年第z3期2485-2487,共3页
长期以来FIFO研究偏重于降低单元间传输延时,所建立的模型不能满足对其它参数研究的要求。特别是FIFO深度,一般依靠设计者经验给出,尚未有理论上的解决方案。当可重构技术应用日趋成熟,可重构系统芯片功能可由应用工程师最终确定时,FIF... 长期以来FIFO研究偏重于降低单元间传输延时,所建立的模型不能满足对其它参数研究的要求。特别是FIFO深度,一般依靠设计者经验给出,尚未有理论上的解决方案。当可重构技术应用日趋成熟,可重构系统芯片功能可由应用工程师最终确定时,FIFO深度选取问题更加突出。针对上述问题,本文提出了一种基于排队论的新型FIFO模型,使用该模型探讨了FIFO深度问题,阐述了FIFO深度的理论含义,并给出了FIFO深度理论计算公式。 展开更多
关键词 排队论 FIFO深度 FIFO模型 可重构系统芯片
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基于CCD的胶体金试纸条光电检测仪器设计及实验研究 被引量:17
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作者 汪曣 白玉洁 +1 位作者 张艳超 李宁 《传感技术学报》 CAS CSCD 北大核心 2008年第8期1370-1373,共4页
为了将农残检测的胶体金试纸条检测结果数值化,设计了基于线阵CCD的光电检测仪器,用其进行现场检测。仪器设计包括光路和电路部分,其中电路部分使用FIFO芯片进行数据缓存,有效降低了开发成本;采用自动定位插槽的定位装置,用于提... 为了将农残检测的胶体金试纸条检测结果数值化,设计了基于线阵CCD的光电检测仪器,用其进行现场检测。仪器设计包括光路和电路部分,其中电路部分使用FIFO芯片进行数据缓存,有效降低了开发成本;采用自动定位插槽的定位装置,用于提高检测目标定位的准确度。实验测定了系统的工作曲线及参数,精度可达1ng/mL,线性范围为1~20ng/mL,符合农残检测范围。 展开更多
关键词 农残检测 胶体金试纸条 光电检测 CCD FIFO
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EDMA在图像数据快速传输中的应用 被引量:8
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作者 但永平 彭红涛 +1 位作者 王东云 刘芳华 《液晶与显示》 CAS CSCD 北大核心 2013年第1期99-104,共6页
在图像处理中图像数据交换量大,图像数据传输是图像采集处理系统的关键环节。EDMA是DSP中用于实现数据快速交换的重要技术,具有独立于CPU的后台批量数据传输的能力。文章基于TI公司TMS320DM642芯片的图像采集处理系统,利用EDMA的数据传... 在图像处理中图像数据交换量大,图像数据传输是图像采集处理系统的关键环节。EDMA是DSP中用于实现数据快速交换的重要技术,具有独立于CPU的后台批量数据传输的能力。文章基于TI公司TMS320DM642芯片的图像采集处理系统,利用EDMA的数据传输方式实现视频数据信号高速实时传输。介绍了DSP的外部存储器接口与FPGA的FIFO存储器有机结合进行数据传输,分析了其设计的整体结构与逻辑控制的功能,并着重分析了基于EDMA Ping-Pong数据传输方式的原理及其应用。另外,EDMA中断服务程序调用CPU对已搬移完成的图像数据块进行处理,不仅提高了数据的传输效率,而且节约了CPU资源,使DSP的高性能得到了充分发挥,从而为视频信号处理的实时性奠定了基础。 展开更多
关键词 EDMA DSP FIFO 数据传输 Ping-Pong
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USB接口高速数据传输的实现 被引量:24
16
作者 吕超 张玉霞 王立欣 《计算机测量与控制》 CSCD 北大核心 2009年第5期1003-1005,1012,共4页
USB接口具有即插即用、安装方便、高带宽、易扩展、传输速度快等优点,尽管USB2.0规范中最高传输速度已经达到了60MB/s,但是很多USB2.0设备在实际工作时的数据传输速度却与此相差甚远,设计了一个以FPGA为主控制器、以CY7C68013为接口芯... USB接口具有即插即用、安装方便、高带宽、易扩展、传输速度快等优点,尽管USB2.0规范中最高传输速度已经达到了60MB/s,但是很多USB2.0设备在实际工作时的数据传输速度却与此相差甚远,设计了一个以FPGA为主控制器、以CY7C68013为接口芯片的数据采集系统;当接口芯片CY7C68013工作在同步的Slave FIFO模式下时,在数据的传输控制上设计了块传输同步控制信号,保证数据传输的正确性和稳定性,系统所能达到稳定的最高传输速度为31.8MB/s。 展开更多
关键词 USB FPGA CY7C68013 SLAVE FIFO
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基于FPGA的高速数据存储系统中FIFO控制的设计 被引量:18
17
作者 于祥凤 刘学斌 +1 位作者 胡炳樑 卫翠玉 《核电子学与探测技术》 CAS CSCD 北大核心 2010年第1期59-62,共4页
介绍了一种高速CCD相机数据存储中的FIFO缓存控制的方法。利用FPGA对高速数据存储系统中的FIFO缓存器进行控制,在QuartusⅡ开发平台上进行设计仿真,结果表明数据流和IDE硬盘之间的存储速率得到匹配,数据实时存储到硬盘中,为后期的数据... 介绍了一种高速CCD相机数据存储中的FIFO缓存控制的方法。利用FPGA对高速数据存储系统中的FIFO缓存器进行控制,在QuartusⅡ开发平台上进行设计仿真,结果表明数据流和IDE硬盘之间的存储速率得到匹配,数据实时存储到硬盘中,为后期的数据处理提供了原始数据,同时也为存储系统的设计提供了参考。 展开更多
关键词 FIFO FPGA VHDL数据存储
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基于DDR2 SDRAM的高速大容量异步FIFO的设计与实现 被引量:14
18
作者 徐欣 周舟 +1 位作者 李楠 孙兆林 《中国测试》 CAS 2009年第6期34-37,共4页
为了解决高速实时系统中海量数据的缓存问题,提出了一种基于DDR2 SDRAM的高速大容量异步FIFO设计方案。首先介绍了DDR2 SDRAM控制器和片上FIFO的原理与实现方法,基于DDR2 SDRAM的高带宽和分时复用技术设计了FIFO控制器的工作机制,最后... 为了解决高速实时系统中海量数据的缓存问题,提出了一种基于DDR2 SDRAM的高速大容量异步FIFO设计方案。首先介绍了DDR2 SDRAM控制器和片上FIFO的原理与实现方法,基于DDR2 SDRAM的高带宽和分时复用技术设计了FIFO控制器的工作机制,最后深入分析了FIFO控制器各部分的工作原理并对其进行了实验。经过测试,基于DDR2 SDRAM的FIFO实现了最高475MHz的总线速率,8~256位的总线位宽,2GB最大数据容量。该FIFO可以解决高速海量数据缓存的问题,在工程应用中有显著的参考价值。 展开更多
关键词 高速海量数据缓存 FIFO存储器 DDR2 SDRAM技术 FPGA技术 分时复用
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炼钢连铸系统的动态调度模型和启发式调度算法 被引量:17
19
作者 李霄峰 徐立云 +1 位作者 邵惠鹤 任德祥 《上海交通大学学报》 EI CAS CSCD 北大核心 2001年第11期1658-1662,共5页
针对炼钢连铸系统对单元设备建立了动态调度模型 ,并利用基于该模型的赋时同步有色Petri网对整个系统建立动态调度模型 .针对该模型 ,提出了一种启发式调度算法解决动态调度问题 ,并基于此实现炼钢连铸的仿真调度系统 .结果表明 ,该算... 针对炼钢连铸系统对单元设备建立了动态调度模型 ,并利用基于该模型的赋时同步有色Petri网对整个系统建立动态调度模型 .针对该模型 ,提出了一种启发式调度算法解决动态调度问题 ,并基于此实现炼钢连铸的仿真调度系统 .结果表明 ,该算法能够较好地实现多级多机 FIFO(先入先出 ) 展开更多
关键词 动态调度 PETRI网 启发式调度算法 炼钢连铸系统 多级多机Jobshop系统 FIFO
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基于FPGA的非XGA标准图像显示控制器的设计 被引量:9
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作者 蔡希昌 翟林培 +1 位作者 周九飞 王德江 《液晶与显示》 CAS CSCD 北大核心 2008年第3期301-306,共6页
针对实际应用中许多相机输出的图像数据格式不符合XGA标准,无法直接进行显示,介绍了一种对该类图像进行标准XGA格式转化的显示控制器。在分析计算的基础上实现对相机的合理控制,使相机的输出行频与XGA标准一致。对于CCD的输出数据通过... 针对实际应用中许多相机输出的图像数据格式不符合XGA标准,无法直接进行显示,介绍了一种对该类图像进行标准XGA格式转化的显示控制器。在分析计算的基础上实现对相机的合理控制,使相机的输出行频与XGA标准一致。对于CCD的输出数据通过采用缓冲和时钟切换的技术方法将其转化为符合VGA时序的图像数据。按照VGA标准时序将图像数据输出,从而实现XGA显示。该显示控制器基于FPGA实现,其关键技术在于利用FPGA内部的FIFO实现CCD数据的二级缓冲和时钟变换。一级缓冲为大容量双时钟FIFO,实现时钟的切换和数据的深度缓冲;二级缓冲为单时钟FIFO,其容量为1行,作为行显示缓冲区。该显示控制器同时利用FPGA实现XGA所需的行场同步信号及控制CCD的外行同步信号。文中的非XGA标准图像显示控制器具有实现灵活,时序稳定的优点,可作为其他相类似图像显示的参考。 展开更多
关键词 XGA 显示控制器 FIFO 行场同步 外加行同步
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