片上网络FIFOs的内建自测试方法研究 被引量：22

1

作者 赵建武 师奕兵 王志刚 《仪器仪表学报》 EI CAS CSCD 北大核心 2009年第8期1768-1772,共5页

片上网络是对微系统芯片的传统片上互连结构的统一和发展,一种新的集成电路设计技术只有在它的测试技术发展完善后才能被广泛使用。首先建立了片上网络路由器FIFOs的功能模型,在此基础上,提出了一种基于可测性设计技术并且具有线性计算... 片上网络是对微系统芯片的传统片上互连结构的统一和发展,一种新的集成电路设计技术只有在它的测试技术发展完善后才能被广泛使用。首先建立了片上网络路由器FIFOs的功能模型,在此基础上,提出了一种基于可测性设计技术并且具有线性计算复杂度O(n)的FIFOs测试算法,论述了一种新颖的复用片上网络、共享内建自测试(BIST)结构对片上网络路由器FIFOs并行测试的方法。实验数据分析表明这种测试方法具有较高的故障覆盖率、较小的测试时间和片上资源开销。 展开更多

关键词 微系统芯片 片上网络 fifos 内建自测试 可测性设计

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动态参数模型确定SoC中异步FIFO深度的方法 被引量：5

2

作者 王剑 王宏 杨志家 《电子科技大学学报》 EI CAS CSCD 北大核心 2009年第3期447-450,共4页

针对超大规模集成电路和片上系统设计中确定异步FIFO浓度的问题,根据异步FIFO运行时的属性提出FIFO动态参数模型,该模型包括FIFO饱和度、写入端和读出端数据传输率及上溢/下溢频率。在该模型的基础之上,分析异步FIFO的深度与动态参数之... 针对超大规模集成电路和片上系统设计中确定异步FIFO浓度的问题,根据异步FIFO运行时的属性提出FIFO动态参数模型,该模型包括FIFO饱和度、写入端和读出端数据传输率及上溢/下溢频率。在该模型的基础之上,分析异步FIFO的深度与动态参数之间的关系,采用功能仿真方法确定片上系统中异步模块之间数据传输所需FIFO的深度。对典型实例的分析表明,采用这种方法能够在保证系统数据通信性能的前提下,获得最小的FIFO深度,优化系统资源的使用。 展开更多

关键词 异步fifo fifo深度 片上系统 超大规模集成电路

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一种用于片上网络的异步共享FIFO设计 被引量：4

3

作者 刘炎华 孙玲 赖宗声 《微电子学与计算机》 CSCD 北大核心 2013年第7期159-162,共4页

针对片上网络(NoC),本文提出一种能被多个输入端口共享的新型异步FIFO结构.与传统FIFO结构相比,共享FIFO能提高片上网络FIFO单元的利用率.实验结果表明,采用共享FIFO结构片上网络吞吐量和平均延时较传统FIFO结构片上网络有着明显改善.

关键词 片上网络 片上路由器 共享fifo 吞吐量 平均延时

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基于FIFO共享RAM的数据采集系统

4

作者 李训铭 李仕锋 《河海大学学报（自然科学版）》 CAS CSCD 2000年第4期81-84,共4页

介绍了用于电力系统动态测辨设计的一种高速数据采集系统 .该数据采集系统采用LEM模块作为电网的电流电压输入转换模块 ,LEM模块是用磁补偿原理制作的霍耳器件新型的电流电压传感器 ,具有测量精度高、线性度好、动态性能好及隔离好等优... 介绍了用于电力系统动态测辨设计的一种高速数据采集系统 .该数据采集系统采用LEM模块作为电网的电流电压输入转换模块 ,LEM模块是用磁补偿原理制作的霍耳器件新型的电流电压传感器 ,具有测量精度高、线性度好、动态性能好及隔离好等优点 .系统的智能采集卡自带CPU和FIFO缓冲器 ,插于工控机ISA扩展槽 .智能数据采集卡通过FIFO存储器与工控系统机共享数据 ,大大提高了数据采集速度和数据缓冲容量 .在数据采集卡上设置了状态命令信箱 ,用于接受工控机系统的命令和反馈采集状态 .采集卡中 。 展开更多

关键词 数据采集 LEM模块 fifo芯片 并行通信

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基于FIFO芯片的单片机并行通信 被引量：1

5

作者 刘永强 《工业控制计算机》 2002年第10期61-63,共3页

本文介绍以FIFO芯片作为数据暂存器的单片机并行通信方法。文中给出双单片机系统和多单片机系统的通信接口设计方法。

关键词 fifo芯片 单片机 并行通信 数据暂存器 通信接口

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一种基于FIFO芯片PCI总线插卡的设计方法

6

作者 唐跃平 吴艳梅 《计算机自动测量与控制》 CSCD 2000年第5期36-37,55,共3页

FIFO芯片在众多的数据处理领域得到了广泛的应用。它在PCI总线插卡设计中的应用 ,进一步提高了数据的传输速度与效率。基于FIFO芯片来实现PCI插卡 ,从硬件上解决了数据高速交换中频繁调用系统中断的问题 ,对PCI接口的应用与推广大有益处。

关键词 fifo芯片 S5933芯片 PCI总线 插卡

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用FIFO芯片实现双单片机系统的数据传送

7

作者 刘永强 《淮海工学院学报（自然科学版）》 CAS 2000年第3期22-24,共3页

介绍一种用 FIFO芯片实现双单片机的数据传送方法。

关键词 fifo芯片 双单片机系统 数据传送

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外加FIFO与PCI总线控制器S5933接口的实现

8

作者 潘丽丽 高品贤 《测控技术》 CSCD 2002年第7期20-22,25,共4页

介绍了外加FIFO芯片在基于PCI总线的高速数据采集系统中的应用 ,实现了外加FIFO与PCI总线接口芯片S5 933的接口 ,并给出了详细的电路设计示例和程序设计概要。

关键词 控制器 S5933接口 高速数据采集系统 fifo芯片 PCI总线

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面向片上网络路由器FIFO故障的实时容错设计

9

作者 杭彦希 徐金甫 +1 位作者 陈松涛 郭朋飞 《电子技术应用》 北大核心 2017年第3期36-39,共4页

为满足对片上网络路由器FIFO故障的实时容忍需求,设计了一种可实时检测路由器FIFO故障并对故障容忍的方法。首先建立了路由器FIFO的功能模型及故障模型,在此基础上利用测试地址在线生成法,提出了一种针对于片上网络路由器FIFO的故障实... 为满足对片上网络路由器FIFO故障的实时容忍需求,设计了一种可实时检测路由器FIFO故障并对故障容忍的方法。首先建立了路由器FIFO的功能模型及故障模型,在此基础上利用测试地址在线生成法,提出了一种针对于片上网络路由器FIFO的故障实时检测算法,并提出利用FIFO重定向机制容忍FIFO故障。实验结果表明,对测试电路参数进行合理地设置,可将测试电路对路由器性能影响降到很小范围,且在故障条件下,吞吐率和延时得到较好的改善。 展开更多

关键词 片上网络 路由器 fifo 容错

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一种基于FPGA的异步FIFO设计方法 被引量：8

10

作者 黄凡 《微处理机》 2017年第1期23-26,32,共5页

设计完成了一种基于FPGA的异步FIFO,运用Verilog HDL高级可编程语言和原理图相结合的设计方法实现FIFO读、写控制算法和数据查询、存储中断模块。运用时钟同步技术,解决了FIFO设计中亚稳态和竞争冒险的难点。最后采用Quartus II9.0设计... 设计完成了一种基于FPGA的异步FIFO,运用Verilog HDL高级可编程语言和原理图相结合的设计方法实现FIFO读、写控制算法和数据查询、存储中断模块。运用时钟同步技术,解决了FIFO设计中亚稳态和竞争冒险的难点。最后采用Quartus II9.0设计仿真验证了该设计,测试结果表明该方案工作原理简单,性能稳定可靠。 展开更多

关键词 fifo设计 FPGA芯片 数据存储 数据采集 时序 时钟同步

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高速数据采集系统控制电路的设计 被引量：10

11

作者 唐颖 阮文海 《现代电子技术》 2004年第19期21-23,共3页

介绍了一种用 F PGA实现对高速 A / D转换芯片的控制电路 ,讨论了这一控制电路设计思想 ,提出了更好的解决高速 A/ D采样与较慢速的单片机数据处理间的链接方法。

关键词 高速A/D转换 单片机 fifo FPGA

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便携式数据采集器的数据传输控制系统设计 被引量：6

12

作者 钱军 《计算机测量与控制》 2018年第11期112-116,共5页

当前数据采集器在数据传输过程中,存在数据传输效率低,数据安全性得不到保障等问题;现在针对这些问题,设计了一种便携式数据采集器的数据传输控制系统;数据传输控制系统通过FPGA转换器接口对数据进行采集,将采集到的数据除杂并存储在DDR... 当前数据采集器在数据传输过程中,存在数据传输效率低,数据安全性得不到保障等问题;现在针对这些问题,设计了一种便携式数据采集器的数据传输控制系统;数据传输控制系统通过FPGA转换器接口对数据进行采集,将采集到的数据除杂并存储在DDR2SDRAM中,然后将这些数据应有核心处理的FIFO芯片进行处理,保障数据传输过程中的数据传输效率;对系统的数据传输效率与丢包率进行实验,实验结果表明,便携式数据采集器的数据传输控制系统有效减小数据丢包率,对于数据攻击的控制准确度达到98.92%。 展开更多

关键词 数据除杂 便携式数据采集器 数据传输 fifo芯片

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基于MIPS核的片上系统总线控制器设计 被引量：1

13

作者 袁丹寿 黄琼珍 戎蒙恬 《计算机工程与应用》 CSCD 北大核心 2004年第36期102-105,共4页

针对基于MIPS核的高清晰度电视(HDTV)的片上系统,设计了一种EC总线控制器。在MIPS核外采用高速缓存来提高总线效率。实现了流水线总线事件,解决了EC总线时钟与外设时钟的转换。通过MIPS总线功能模块(BFM)的时序仿真验证了该控制器的正... 针对基于MIPS核的高清晰度电视(HDTV)的片上系统,设计了一种EC总线控制器。在MIPS核外采用高速缓存来提高总线效率。实现了流水线总线事件,解决了EC总线时钟与外设时钟的转换。通过MIPS总线功能模块(BFM)的时序仿真验证了该控制器的正确性。0.25-μmCMOS工艺综合了EC总线控制器的RTL代码,总线时钟可达到149MHz。最后通过了FPGA验证。 展开更多

关键词 总线控制器 先进先出缓存器(fifo) 片上系统

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一种用于CCD器件的高速数据采集系统的设计及编程 被引量：3

14

作者 柯炜 宋文娟 赵华 《电子工程师》 2001年第6期9-11,共3页

介绍了一种满足 CCD信号采集要求的高速数据采集系统的设计 ,本设计用FIFO存储器作缓存器 ,从而无需复杂的控制电路和地址发生器。同时介绍了在

关键词 器件CCD fifo芯片 数据采集系统 程序设计

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单片机与PC机双向并行通信新方法研究 被引量：1

15

作者 金永贤 《华东交通大学学报》 2000年第2期13-16,共4页

分析了用 82 5 5 A实现双机双向并行通信的原理 ,提出了用 FIFO- RAM IDT72 0 2实现单片机与 PC机双向并行通信电路的设计方案 .

关键词 双向并行通信 先进先出 单片机 PC机

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大数据分析下的智慧交通自动化运维系统设计 被引量：2

16

作者 池葆春 《自动化与仪器仪表》 2022年第3期68-72,共5页

为实现智能交通运维自动化程度、覆盖范围等方面的提升,引入大数据分析下的智慧交通自动化运维系统。将系统架构设计为三层结构,为系统设计多个模块。在数据处理模块中,设计一种能够处理大批量数据的数据处理模块。数据采集模块能够通... 为实现智能交通运维自动化程度、覆盖范围等方面的提升,引入大数据分析下的智慧交通自动化运维系统。将系统架构设计为三层结构,为系统设计多个模块。在数据处理模块中,设计一种能够处理大批量数据的数据处理模块。数据采集模块能够通过大数据分析技术中的物联网感知技术实现数据采集。通过视频质量分析模块能够对视频源实施质量判别。运维管理模块能够实现智慧交通运维信息的管理。故障自动跟踪溯源模块能够通过挖掘和提炼采集数据对推断故障根源。通过硬件与软件相结合实现智慧交通自动化运维。测试设计系统的多个项目,测试结果为系统能够实现该市服务器等设备的完全检测以及其他设备的大面积检测;系统信号丢失检测的检测帧数可达523214帧/日;系统的外场设备链路重复告警过滤数最高可达912条/月,有着良好的重复告警过滤性能;系统的内外场设备故障溯源性能均良好。说明系统的设计对于提高智慧交通的自动化运维水平有一定意义。 展开更多

关键词 大数据分析 智慧交通 同步fifo传输 数据处理芯片 自动化运维系统

原文传递

基于增强型并行口的信号发生器的设计

17

作者 柯炜 陈家胜 殷奎喜 《仪表技术》 2001年第4期26-27,共2页

介绍一种利用增强型并行端口传送控制信号和数据信号的发生器的原理和设计方法 ,该设计充分利用计算机现有资源 ,并用FIFO存储器来实现数字波形合成 ,从而使硬件电路大大简化 ,使用起来十分方便。

关键词 信号发生器 增强型并行口 数字波形合成 fifo芯片

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基于FPGA的视频图像处理系统的研究与设计

18

作者 栗武华 茹运蕊 +1 位作者 褚成琴 王江泉 《电光系统》 2011年第2期5-6,15,共3页

详细介绍了基于FPGA技术的视频图像处理系统的原理及设计方案，首先对所有视频线路进行检测，然后在FPGA芯片控制下，将视频数据由数据接口传送到信号发生装置的存储器中，通过总线对数字视频编码芯片进行初始化，根据用户端对视频线路... 详细介绍了基于FPGA技术的视频图像处理系统的原理及设计方案，首先对所有视频线路进行检测，然后在FPGA芯片控制下，将视频数据由数据接口传送到信号发生装置的存储器中，通过总线对数字视频编码芯片进行初始化，根据用户端对视频线路的选择将存储器中选定的视频图像传送到数字视频编码芯片，编译成码，并在指定的视频线路中输出。 展开更多

关键词 FPGA 视频处理 信号发生 视频编码芯片 fifo

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基于指示信号方式实现跨时钟域数据传输的方法 被引量：4

19

作者 王良 方粮 +1 位作者 池雅庆 王之元 《计算机工程与科学》 CSCD 北大核心 2017年第12期2192-2197,共6页

随着片上系统(SoC)技术的发展,芯片内各个模块交流频繁。异步系统因功耗低、速度提升潜力大和抗干扰能力强而备受青睐,但是异步电路设计复杂,数据的跨时钟域传输是亟需解决的问题。国际上目前最流行的方式是FIFO,但随着SoC复杂度的提升... 随着片上系统(SoC)技术的发展,芯片内各个模块交流频繁。异步系统因功耗低、速度提升潜力大和抗干扰能力强而备受青睐,但是异步电路设计复杂,数据的跨时钟域传输是亟需解决的问题。国际上目前最流行的方式是FIFO,但随着SoC复杂度的提升,一个系统上集成上百个模块,利用FIFO将会占用大量的资源,产生很大的功耗。通过分析异步传输的特点,提出一种使用指示信号来实现跨时钟域数据传输的方法,该方法与FIFO相比,在性能不减的情况下大大降低了功耗及其复杂度。利用Verilog对两个模块(CPU和FPGA)的跨时钟域数据传输进行设计仿真,通过Xilinx公司的Vivado硬件验证了其可行性。最后通过与FIFO方式的设计进行对比,说明该方法比FIFO具有更好的应用价值。 展开更多

关键词 片上系统 FPGA 跨时钟域 fifo

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片内多核共享信箱的研究与设计

20

作者 刘浩 邹雪城 +1 位作者 王文敏 吉立新 《华中科技大学学报（自然科学版）》 EI CAS CSCD 北大核心 2009年第6期86-88,92,共4页

针对现代多CPU的微机保护装置中不同处理器之间的信息交互采用外置存储器,系统正常运行容易受到现场复杂电磁环境干扰的问题,采用了片内存储器实现多处理器之间的交互.以片内存储器为主体构建多核芯片的多层次存储结构,并采用基于消息... 针对现代多CPU的微机保护装置中不同处理器之间的信息交互采用外置存储器,系统正常运行容易受到现场复杂电磁环境干扰的问题,采用了片内存储器实现多处理器之间的交互.以片内存储器为主体构建多核芯片的多层次存储结构,并采用基于消息机制的共享信箱完成处理器之间的信息交互.利用排队论模型详尽地分析了共享信箱中数据FIFO的性能与需求,继而推导出适用于多任务系统中数据FIFO的深度经验公式. 展开更多

关键词 微机保护 片内存储器 多核芯片 共享信箱 消息通信 fifo深度公式

原文传递