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基于FPGA的3-DES双向数据传输高速加/解密芯片设计 被引量：2
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作者 石新峰 董蕴华 杨航 《通信技术》 2009年第5期230-232,共3页
介绍了DES和3-DES算法,并阐述了用FPGA芯片进行高速硬件加/解密的设计方法以及关键问题的解决方案,最后利用Altera公司的Cyclone Ⅱ EP2C70F896C8器件设计了一款3-DES双向数据传输加/解密芯片,从而将复杂的加/解密运算通过FPGA单芯片实... 介绍了DES和3-DES算法,并阐述了用FPGA芯片进行高速硬件加/解密的设计方法以及关键问题的解决方案,最后利用Altera公司的Cyclone Ⅱ EP2C70F896C8器件设计了一款3-DES双向数据传输加/解密芯片,从而将复杂的加/解密运算通过FPGA单芯片实现,提高了加密速度和破译难度。 展开更多
关键词 DES 3-DES FPGA CYCLONE Ⅱ ep2c70f896c8
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