基于SPEC CPU 2006的国产处理器性能测试设计与分析 被引量：2

1

作者 刘建 李晓静 +2 位作者 刘阳 张明娟 吴宸 《电子质量》 2024年第4期105-110,共6页

通过研究不同架构的国产处理器,介绍了国产处理器发展现状。基于处理器的工作过程,分析了影响处理器性能的内部与外部因素。分别设计使用不同内存容量、不同内存速率与不同版本GCC编译器的试测场景,使用国际权威的CPU性能测试工具SPEC C... 通过研究不同架构的国产处理器,介绍了国产处理器发展现状。基于处理器的工作过程,分析了影响处理器性能的内部与外部因素。分别设计使用不同内存容量、不同内存速率与不同版本GCC编译器的试测场景,使用国际权威的CPU性能测试工具SPEC CPU2006对基于ARM、X86架构的国产处理器的计算速度性能和吞吐量性能进行了测试,并对比基准程序的得分情况,分析不同配置对测试结果的影响。结果显示,内存容量大、速率高对处理器的计算速度性能影响不大,但吞吐量性能表现更好;GCC编译器版本越高,处理器吞吐量性能测试得分越高。 展开更多

关键词 国产处理器 SPEC cpu2006 性能测试 内存容量 速度 计算速度 吞吐量

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信创CPU与Intel CPU在NUMA架构方面的调优实践

2

作者 徐光龙 金鹰 《计算机应用文摘》 2024年第3期35-37,共3页

通过选取具有代表性的基准测试工具,文章对比了信创CPU和IntelCPU在多核性能方面的表现。同时,针对NUMA架构的特点进行了调优实验,并通过分析性能数据得出了调优前后的性能差异。结果表明,通过NUMA调优可以有效提高处理器的性能。

关键词 NUMA调优 信创cpu Intelcpu 性能对比测试 基准测试工具 处理器性能

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基于Power BI的电商企业数据仓库可视化平台设计与应用 被引量：2

3

作者 李骜成 潘建江 《无线互联科技》 2025年第3期98-101,共4页

针对电商企业数据的复杂性与管理需求,文章设计了基于Power BI的数据仓库可视化平台。首先通过高效采集和深度分析电商数据,揭示销售趋势与用户行为特征。随后,融合数据深度挖掘技术与直观可视化技术,以完成平台的整体设计。实验结果表... 针对电商企业数据的复杂性与管理需求,文章设计了基于Power BI的数据仓库可视化平台。首先通过高效采集和深度分析电商数据,揭示销售趋势与用户行为特征。随后,融合数据深度挖掘技术与直观可视化技术,以完成平台的整体设计。实验结果表明,随着线程数的增加,该平台数据处理时间从1200 s大幅缩短至380 s,存储速率则从10 MB/s提升至31 MB/s,同时库存变动监控的实时性也得到显著提升,整体应用效果较好。 展开更多

关键词 Power BI 电商企业 数据仓库 可视化 cpu处理器

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一种DSP和通用CPU一体化的处理器架构及其4核实现 被引量：3

4

作者 王志君 梁利平 +3 位作者 洪钦智 罗汉青 王昳 赵淳 《微电子学与计算机》 CSCD 北大核心 2014年第10期32-38,共7页

提出了一种DSP和通用CPU一体化的处理器架构,并完成了一款基于该架构的同构4核处理器设计和流片验证.该处理器基于VLIW结构,支持自主定义的DSP指令系统,兼容现有通用的MIPS 4KC处理器指令集,支持最大8个指令通道的并行发射.处理器在不改... 提出了一种DSP和通用CPU一体化的处理器架构,并完成了一款基于该架构的同构4核处理器设计和流片验证.该处理器基于VLIW结构,支持自主定义的DSP指令系统,兼容现有通用的MIPS 4KC处理器指令集,支持最大8个指令通道的并行发射.处理器在不改变CPU的指令编码以及执行顺序的前提下,实现了芯片结构上的DSP和CPU执行处理的一体化,适合在统一的平台上同时完成宽带通信和多媒体的信号和协议处理的嵌入式应用开发.处理器内核通过自主定义的DSP指令字中前后并行标识位和一条专用的前导paralink指令实现了DSP与CPU指令的并行发射.在4核处理器的同构架构上,采用了全局读局部写的多核间片上数据存储策略,在控制硬件开销的基础上实现片上数据的共享.仿真和流片验证结果表明,所提出的DSP和CPU一体化处理器架构可行,在宽带通信和多媒体等嵌入式应用上具有优势. 展开更多

关键词 多核处理器 DSP和cpu一体化 VLIW结构

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CPU/GPU异构混合并行的栅格数据空间分析研究——以地形因子计算为例 被引量：9

5

作者 卢敏 王金茵 +2 位作者 卢刚 陶伟东 王结臣 《计算机工程与应用》 CSCD 北大核心 2017年第1期172-177,共6页

海量数据背景下传统GIS栅格数据空间分析计算效率已经不能满足快速计算的需求,为此以地形因子计算为例,分析并测试了基于共享内存模型的CPU多核并行模式与基于流处理器模型的GPU众核并行模式的计算性能,在此基础上详细实现了负载均衡的... 海量数据背景下传统GIS栅格数据空间分析计算效率已经不能满足快速计算的需求,为此以地形因子计算为例,分析并测试了基于共享内存模型的CPU多核并行模式与基于流处理器模型的GPU众核并行模式的计算性能,在此基础上详细实现了负载均衡的设备间任务划分,进行CPU与GPU异构混合的并行技术改良研究。实验结果表明,基于相同的单机硬件环境,与多核共享内存模型或众核流处理器的单一计算平台并行方案相比,CPU/GPU异构混合并行计算方法对于栅格数据分析具有更好的加速效果。 展开更多

关键词 GIS栅格数据分析 共享内存模型 流处理器模型 cpu/GPU异构混合并行

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基于双CPU的便携式故障诊断仪的设计与开发 被引量：4

6

作者 赵艳菊 王太勇 +3 位作者 徐跃 曹康平 张攀 邓辉 《吉林大学学报（工学版）》 EI CAS CSCD 北大核心 2008年第3期557-560,共4页

针对中小型应用场合,将故障诊断技术与嵌入式技术相结合,开发了基于双CPU的便携式故障诊断仪。首先介绍了系统的硬件结构和软件设计,重点描述了硬件的双CPU结构和通信软件机制。实验结果证明,基于双CPU的便携式故障诊断仪性能稳定、成本... 针对中小型应用场合,将故障诊断技术与嵌入式技术相结合,开发了基于双CPU的便携式故障诊断仪。首先介绍了系统的硬件结构和软件设计,重点描述了硬件的双CPU结构和通信软件机制。实验结果证明,基于双CPU的便携式故障诊断仪性能稳定、成本低,集采集存储、分析和通信等功能于一体,可以广泛应用于各种设备的监测和诊断中。 展开更多

关键词 仪器仪表技术 双cpu 便携式故障诊断仪 数字信号处理器 单片机

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SMDSP浮点数字信号处理器CPU内功能单元的设计

7

作者 车德亮 刘文平 《微电子学与计算机》 CSCD 北大核心 2005年第2期183-187,共5页

SMDSP是针对专门应用开发的高性能32位浮点数字信号处理器,其CPU内有独立的ALU、乘法器、数据地址产生器和六条局部数据总线,实现了乘加运算并行,算术运算与地址运算并行,加快了数据处理速度。数据地址产生器支持顺序、倒位序、循环三... SMDSP是针对专门应用开发的高性能32位浮点数字信号处理器,其CPU内有独立的ALU、乘法器、数据地址产生器和六条局部数据总线,实现了乘加运算并行,算术运算与地址运算并行,加快了数据处理速度。数据地址产生器支持顺序、倒位序、循环三类数据地址的计算,使得SMDSP能方便高效地应用于数字信号处理系统。 展开更多

关键词 浮点数字信号处理器 cpu 加法器 乘法器 数据地址生成器

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新一代数字信号处理器TMS320C55X及其CPU结构

8

作者 邓勇 施文康 刘琪 《微处理机》 2001年第1期7-11,共5页

TMS3 2 0 C55X是一种低功耗高性能的数字信号处理器 ,本文介绍了其主要特性 ,并详细分析了 TMS3 2 0 C55X的

关键词 数字信号处理器 低功耗 cpu 数据总线 结构 TMS320C55X

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MSP430单片机与CPU卡接口函数设计

9

作者 吴叶兰 廉小亲 陈红军 《科技情报开发与经济》 2003年第8期209-211,共3页

CPU卡以其良好的安全性和规范性被日益广泛地应用于各种嵌入式系统。文章介绍了用MSP430单片机来开发CPU卡的读写操作,分析了其硬件和软件的设计。

关键词 cpu卡 MSP430单片机 ETU

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自主CPU发展道路及在航天领域应用 被引量：20

10

作者 胡伟武 《上海航天》 CSCD 2019年第1期1-9,共9页

目前,我国中央处理器(CPU)的发展主要有自主研发和引进技术两条路线。自主研发的CPU在性能和软件生态上能否赶超引进技术的CPU成为争论的焦点。首先论述了我国CPU发展不能仅着眼于单项技术瓶颈的突破和产品市场占有率的提高,还必须建立... 目前,我国中央处理器(CPU)的发展主要有自主研发和引进技术两条路线。自主研发的CPU在性能和软件生态上能否赶超引进技术的CPU成为争论的焦点。首先论述了我国CPU发展不能仅着眼于单项技术瓶颈的突破和产品市场占有率的提高,还必须建立起自主可控的信息技术与产业生态体系;然后结合龙芯CPU研发和产业化的实践,论述了只要结合应用需求进行持续改进,自主研发的CPU在性能和软件生态上就能赶超引进技术的CPU,满足我国自主信息化应用的需求;最后论述了自主抗辐照CPU的发展及在航天领域应用情况。 展开更多

关键词 中央处理器 软件生态 抗辐照 自主可控

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如何取得StrongARM处理器CPU的详细信息

11

作者 张学敏 《计算机光盘软件与应用》 2011年第24期57-58,共2页

介绍StrongARM处理器的寄存器及取得CPU类型、频率的过程；介绍在WINDOWSCE应用程序中，如何直接嵌入二进制机器指令，取得底层的寄存器中的容；介绍利用StrongARM指令参考手册中对指令的说明把取得寄存器中数据的过程翻译成机器码；另... 介绍StrongARM处理器的寄存器及取得CPU类型、频率的过程；介绍在WINDOWSCE应用程序中，如何直接嵌入二进制机器指令，取得底层的寄存器中的容；介绍利用StrongARM指令参考手册中对指令的说明把取得寄存器中数据的过程翻译成机器码；另外对从寄存器中读取CPU的类型信息、从地址端口取得CPU频率的值的过程进行了说明。 展开更多

关键词 Windows CE cpu STRONGARM emit处理器 寄存器 机器码

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如何取得Strong ARM处理器CPU的详细信息

12

作者 张学敏 《计算机光盘软件与应用》 2012年第1期73-74,共2页

介绍Strong ARM处理器的寄存器及取得CPU类型、频率的过程;介绍在WINDOWS CE应用程序中,如何直接嵌入二进制机器指令,取得底层的寄存器中的容;介绍利用Strong ARM指令参考手册中对指令的说明把取得寄存器中数据的过程翻译成机器码;另外... 介绍Strong ARM处理器的寄存器及取得CPU类型、频率的过程;介绍在WINDOWS CE应用程序中,如何直接嵌入二进制机器指令,取得底层的寄存器中的容;介绍利用Strong ARM指令参考手册中对指令的说明把取得寄存器中数据的过程翻译成机器码;另外对从寄存器中读取CPU的类型信息、从地址端口取得CPU频率的值的过程进行了说明。 展开更多

关键词 Windows CE cpu STRONG ARM emit处理器 寄存器 机器码

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某型航空发动机抗电源失效设计与试验验证 被引量：1

13

作者 李鸿基 郭海红 +1 位作者 江井跃 孙朝辉 《内燃机与配件》 2024年第11期97-100,共4页

为应对外部电源可能出现的失效问题,某航空发动机控制系统开展电子控制器储能电路设计,并选用具有零偏功能的电液伺服阀。通过改造台架电源配置、增加延时继电器,实现模拟电源短时中断50ms和完全失效功能。整机电源失效试验表明,某航空... 为应对外部电源可能出现的失效问题,某航空发动机控制系统开展电子控制器储能电路设计,并选用具有零偏功能的电液伺服阀。通过改造台架电源配置、增加延时继电器,实现模拟电源短时中断50ms和完全失效功能。整机电源失效试验表明,某航空发动机电子控制器CPU在外部电源短时中断50ms条件下可保持稳定工作,可取消配套应急电源设备;在电源完全失效情况下可通过切断关闭主燃油、调节几何角度使发动机安全停车,发动机性能和操纵性未发生变化,满足飞机使用要求。 展开更多

关键词 航空发动机 电源失效 控制系统 中央处理器 电液伺服阀 整机试验

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“计算机组成原理”课程实践教学改革探索

14

作者 李晓飞 《计算机应用文摘》 2024年第18期24-26,29,共4页

“计算机组成原理”课程复杂且抽象,为教师的实践教学带来了极大的挑战。对此,文章采用Logisim软件对“计算机组成原理”课程进行了实践设计,以单周期CPU设计为例,通过MIPS指令译码器、指令存储器及运算器设计阐述了Logisim软件设计单周... “计算机组成原理”课程复杂且抽象,为教师的实践教学带来了极大的挑战。对此,文章采用Logisim软件对“计算机组成原理”课程进行了实践设计,以单周期CPU设计为例,通过MIPS指令译码器、指令存储器及运算器设计阐述了Logisim软件设计单周期CPU设计过程,同时利用Logisim软件对指令存储器、运算器与总体结构进行了设计,整个实验逻辑性与实践性强,能很好地解决“计算机组成原理”课程的实践难点,不仅有助于学生更熟练地掌握计算机硬件设计方法,还能激发其学习主动性。 展开更多

关键词 Logisim教学实验平台 MIPS架构 多核处理器 cpu设计

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地球系统模式CESM及其在高性能计算机上的配置应用实例 被引量：14

15

作者 万修全 刘泽栋 +2 位作者 沈飙 林霄沛 吴德星 《地球科学进展》 CAS CSCD 北大核心 2014年第4期482-491,共10页

通用地球系统模式(CESM)是美国国家大气研究中心最新推出的地球系统耦合模式,对解决气候(地球)系统建模中所涉及的新挑战和新问题具有很大的帮助。首先介绍CESM模式的结构框架以及最新版本的重要更新;然后结合具体的应用实例和使用经验... 通用地球系统模式(CESM)是美国国家大气研究中心最新推出的地球系统耦合模式,对解决气候(地球)系统建模中所涉及的新挑战和新问题具有很大的帮助。首先介绍CESM模式的结构框架以及最新版本的重要更新;然后结合具体的应用实例和使用经验,重点讨论如何在高性能计算机上对模式进行移植和合理的CPU配置,并比较不同配置之间的优劣性,从而确定模式最佳负载平衡和最优效率,对模式新用户的使用具有极大的帮助;最后对模式进行一系列的稳定性测试和验证,结果表明模式具有较好的稳定性,可以进行数值模拟和科学研究。同时对地球系统耦合模式的发展进行了总结,并对模式发展中存在的问题提出了一些建议。 展开更多

关键词 CESM 高性能计算 cpu配置 最优化 稳定性

原文传递

一种面向多媒体和通信应用的处理器指令集及架构实现 被引量：4

16

作者 王志君 梁利平 +3 位作者 吴凯 王光玮 洪钦智 罗汉青 《湖南大学学报（自然科学版）》 EI CAS CSCD 北大核心 2014年第10期108-114,共7页

提出了一种面向多媒体和通信应用的CPU和DSP一体化计算的指令集架构,并设计实现了一款基于该指令集架构的VLIW DSP处理器.该CPU和DSP融合指令集架构中的CPU指令兼容已有MIPS 4KC指令集,DSP指令为自主设计.针对多媒体和通信常用算法中并... 提出了一种面向多媒体和通信应用的CPU和DSP一体化计算的指令集架构,并设计实现了一款基于该指令集架构的VLIW DSP处理器.该CPU和DSP融合指令集架构中的CPU指令兼容已有MIPS 4KC指令集,DSP指令为自主设计.针对多媒体和通信常用算法中并行度高等特点,提出了多条基于像素操作、向量操作和复数操作的DSP指令,并详细说明了实现这些指令的关键功能模块的电路实现方法.实验结果表明,在多媒体的插值、重建以及通信的滤波、FFT等算法上,采用本文提出的面对特定应用的指令集具有较明显的优势.流片测试结果证明该指令集架构可实现且有效. 展开更多

关键词 面向特定应用指令集架构 cpu和DSP一体化 处理器 通信 多媒体

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网络安全处理器的研究 被引量：6

17

作者 舒昶 吕述望 +1 位作者 张文婧 冯凯锋 《中国科学院研究生院学报》 CAS CSCD 2002年第1期97-101,共5页

对传统网络安全解决方案进行了描述,在此基础上,分析了目前改进的网络安全处理器的体系结构.两者最大的区别是后者尽量减少主CPU与外部总线的通信,为此在安全处理器中。

关键词 网络安全 网络安全处理器 主中央处理器 加密技术 报文 协议 IPSe

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数字信号处理技术在馈线自动化终端中的应用 被引量：3

18

作者 孙运全 孙玉坤 +1 位作者 杨泽斌 邵学军 《江苏大学学报（自然科学版）》 EI CAS 2004年第2期160-163,共4页

在配电自动化系统中,采用馈线自动化装置对35kV以下的变电站、开闭所和10kV馈线进行实时监控,完成一次设备的电压、电流、有功、无功及谐波的采集分析,实现自动故障分析和准确的故障定位,从而提高了电能质量 并通过适当的通信方式上报... 在配电自动化系统中,采用馈线自动化装置对35kV以下的变电站、开闭所和10kV馈线进行实时监控,完成一次设备的电压、电流、有功、无功及谐波的采集分析,实现自动故障分析和准确的故障定位,从而提高了电能质量 并通过适当的通信方式上报主站或上级子站,为电网的安全、经济运行提供原始数据 在馈线自动化终端装置中采用数字信号处理技术以及锁相环技术实现电流、电压的交流采样和计算,并运用双CPU和双通道A/D转换的运行方式,因而提高了运算速度,增加了系统的可靠性。 展开更多

关键词 配电自动化 馈线自动化装置 数字信号处理技术 双cpu 锁相环 交流采样

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异构计算平台上列存储系统的并行连接优化策略 被引量：4

19

作者 丁祥武 陈金鑫 王梅 《计算机工程与应用》 CSCD 北大核心 2017年第5期73-80,共8页

GPU以及集成式的CPU-GPU架构凭借其强大的并行处理能力和可编程流水线方式,已经成为数据库领域的研究热点。为充分利用异构平台的并行计算能力,提升列存储系统的查询性能,在研究异构平台结构特性的基础上,首先提出了GPU多线程平台上进... GPU以及集成式的CPU-GPU架构凭借其强大的并行处理能力和可编程流水线方式,已经成为数据库领域的研究热点。为充分利用异构平台的并行计算能力,提升列存储系统的查询性能,在研究异构平台结构特性的基础上,首先提出了GPU多线程平台上进行连接的数据划分策略——ICMD(Improved CMD),利用GPU流处理器并行处理各个子空间上的连接,然后利用任务评估分配模型实现查询负载的动态分配,使得查询操作能在多核CPU、GPU上高效并行执行。同时利用片上全局同步机制、局部内存重用技术优化ICMD连接算法。最后采用SSB基准测试集测试,结果表明:Intel~?HD Graphics 4600平台上并行连接查询相比于CPU版本获得了35%的性能提升,较GPU查询引擎的Ocelot性能上提升了18%。 展开更多

关键词 多核中央处理器-图形处理器(cpu-GPU) 流处理器 异构编程 列存储 改进协调模块分布(ICMD) 任务动态评估分配

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基于多核的多线程程序优化研究 被引量：17

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作者 施惠丰 袁道华 《计算机技术与发展》 2010年第6期70-73,共4页

随着主流芯片厂商的大力推广,多核处理器已经变得越来越普及。以往串行化的程序设计方法在多核环境下已经不能充分利用多核CPU的资源。怎样高效地利用多核处理器的计算性能,已经成为软件开发者面临的新的课题。文中在传统的多线程编程... 随着主流芯片厂商的大力推广,多核处理器已经变得越来越普及。以往串行化的程序设计方法在多核环境下已经不能充分利用多核CPU的资源。怎样高效地利用多核处理器的计算性能,已经成为软件开发者面临的新的课题。文中在传统的多线程编程基础上,根据Intel处理器的微架构(Microarchitecture)特点,以及Linux内核提供的CPU绑定技术,通过采用Cache优化和CPU亲和力(CPU affinity)优化,消除了多核环境下局部多线程Cache行竞争和伪共享,减少了线程的调度开销,提高了多线程程序的运行效率。 展开更多

关键词 多核处理器 多线程编程 CACHE优化 cpu亲和力

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