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题名基于SoC FPGA的加密通信装置设计
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作者
史昊晨
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机构
南京邮电大学波特兰学院
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出处
《科技视界》
2026年第7期23-26,共4页
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文摘
随着数字经济和信息技术的迅速发展,保护数据隐私、避免信息泄露显得尤为重要。本文设计并实现了一种基于SoC FPGA的加密通信装置,采用音频输入模块与输出模块,将音频模拟信号与音频数据信号转换,结合音频编解码与AES-CTR 256实时加解密,实现了从信号采集、处理、加密到无线传输的完整链路。通过高保真双声道音频实验,表明该系统能够稳定、清晰地完成音频信号的采集、加密与传输,具备良好的实时性、安全性及可扩展性。
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关键词
可编程门阵列(FPGA)
SOC芯片
加密通信
aes-ctr加解密
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分类号
TN918.4
[电子电信—通信与信息系统]
TN79
[电子电信—电路与系统]
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题名无线城域网数据加密技术研究
被引量：3
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作者
谢颖华
仇润鹤
吴怡之
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机构
东华大学信息科学与技术学院
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出处
《微型电脑应用》
2007年第9期7-9,71,共3页
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文摘
本文重点介绍了无线城域网所支持采用的三种加密技术:DES-CBC,AES-CCM和AES-CTR,进行比较分析。并用VC实现了DES-CBC算法。
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关键词
无线城域网IEEE802.16
DES-CBC
AES-CCM
aes-ctr
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Keywords
WMAN IEEE802.16 DES-CBC AES-CCM aes-ctr
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分类号
TP393.17
[自动化与计算机技术—计算机应用技术]
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题名AXI总线加密模块的设计与验证
被引量：5
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作者
贺依盟
周亚军
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机构
杭州电子科技大学自动化学院
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出处
《杭州电子科技大学学报（自然科学版）》
2016年第1期57-62,共6页
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文摘
结合信息安全的需求以及SoC技术的发展,设计了一种基于AES加解密算法的AXI总线加密IP,达到从CPU到slave的整个数据通路的加解密目的,实现SoC内部的端到端加密.其中通过内置多个FIFO,分别在读写通道缓存CPU发出的AXI Burst传输,保证CPU发出的总线传输可以被顺序的加解密处理.在AES算法实现方面,完成了ECB,CTR两种便于并行处理的加密模式.在读写通道分别加入AES实现模块,保证加解密操作的并行处理.同时构建结构化的UVM验证平台,结合APB和AXI的VIP来实现对该IP的随机约束和覆盖率分析,最终通过Synopsys的VCS仿真工具完成功能验证.
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关键词
AXI加密
aes-ctr模式
验证VIP
统一验证方法学
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Keywords
AXI encrypt
aes-ctr mode
verification VIP
universal verification methodology
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分类号
TN492
[电子电信—微电子学与固体电子学]
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