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基于DA的高性能2-D IDCT处理器设计
1
作者
陈章进
张志高
孔敏达
《微电子学与计算机》
CSCD
北大核心
2010年第7期225-228,232,共5页
为提高2-D IDCT的解码速度,文中设计了一种基于DA的2-D IDCT处理器.该处理器在算法上用1-D IDCT实现2-D IDCT,用Chen算法实现1-D IDCT,用DA实现乘加结构.通过将输入数据分成高6位和低6位两组加快了处理器的速度,通过查找表的共用及将输...
为提高2-D IDCT的解码速度,文中设计了一种基于DA的2-D IDCT处理器.该处理器在算法上用1-D IDCT实现2-D IDCT,用Chen算法实现1-D IDCT,用DA实现乘加结构.通过将输入数据分成高6位和低6位两组加快了处理器的速度,通过查找表的共用及将输入数据投影到(-1,1)的编码减少了查找表的数量及大小.通过在Q0上预存四舍五入值省去了四舍五入所需的加法运算.使用Altera的EP2C20F484C7对该处理器进行综合,时钟最高频率可达165.37MHz.
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关键词
2
-d
idct
分布式算法
视频解码
FPGA
在线阅读
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职称材料
基于FPGA和2位串行分布式算法的实时高速二维DCT/IDCT处理器研制
被引量：
2
2
作者
向晖
滕建辅
王承宁
《电子科学学刊》
CSCD
1999年第6期797-805,共9页
本文在W.Li(1991)循环斜卷积算法和分布式算法的基础上,通过软件模拟和具体硬件设计,利用FPGA完成了可用于高清晰度电视核心解码器及其它信号与信息处理系统的8×8二维DCT/IDCT处理器的全部电路设计工作。它采用一根信号线控制计算D...
本文在W.Li(1991)循环斜卷积算法和分布式算法的基础上,通过软件模拟和具体硬件设计,利用FPGA完成了可用于高清晰度电视核心解码器及其它信号与信息处理系统的8×8二维DCT/IDCT处理器的全部电路设计工作。它采用一根信号线控制计算DCT/IDCT,其输入、输出为12位,内部数据线及内部参数均为16位。
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关键词
二维DCT/
idct
处理器
分布式算法
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职称材料
一种基于FPGA的二维DCT和IDCT的新算法
3
作者
赵滨
黄大庆
《电子设计工程》
2011年第24期126-129,共4页
提出了一种新的二维DCT和IDCT的FPGA实现结构,采用行列快速算法将二维算法分解为两个一维算法实现,其中每个一维算法采用并行的流水线结构,每一个时钟处理8个数据,大大提高电路的数据吞吐率和运算速度。通过Modelsim仿真工具对该设计进...
提出了一种新的二维DCT和IDCT的FPGA实现结构,采用行列快速算法将二维算法分解为两个一维算法实现,其中每个一维算法采用并行的流水线结构,每一个时钟处理8个数据,大大提高电路的数据吞吐率和运算速度。通过Modelsim仿真工具对该设计进行仿真,证明该算法的功能的正确性,进行一次8*8的分块二维DCT变换仅仅需要16个时钟,满足图像以及视频实时性的要求。
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关键词
二维DCT算法
二维
idct
算法
流水线
FPGA
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职称材料
题名
基于DA的高性能2-D IDCT处理器设计
1
作者
陈章进
张志高
孔敏达
机构
上海大学微电子中心
出处
《微电子学与计算机》
CSCD
北大核心
2010年第7期225-228,232,共5页
基金
国家自然科学基金项目(60773081
6077018)
+2 种基金
上海市科委项目(08706201800
09ZR1412000)
上海市教委项目(07ZZ08)
文摘
为提高2-D IDCT的解码速度,文中设计了一种基于DA的2-D IDCT处理器.该处理器在算法上用1-D IDCT实现2-D IDCT,用Chen算法实现1-D IDCT,用DA实现乘加结构.通过将输入数据分成高6位和低6位两组加快了处理器的速度,通过查找表的共用及将输入数据投影到(-1,1)的编码减少了查找表的数量及大小.通过在Q0上预存四舍五入值省去了四舍五入所需的加法运算.使用Altera的EP2C20F484C7对该处理器进行综合,时钟最高频率可达165.37MHz.
关键词
2
-d
idct
分布式算法
视频解码
FPGA
Keywords
2-d idct
distribute arithmetic
video decoding
FPGA
分类号
TP31 [自动化与计算机技术—计算机软件与理论]
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职称材料
题名
基于FPGA和2位串行分布式算法的实时高速二维DCT/IDCT处理器研制
被引量：
2
2
作者
向晖
滕建辅
王承宁
机构
天津大学电子信息工程学院
出处
《电子科学学刊》
CSCD
1999年第6期797-805,共9页
文摘
本文在W.Li(1991)循环斜卷积算法和分布式算法的基础上,通过软件模拟和具体硬件设计,利用FPGA完成了可用于高清晰度电视核心解码器及其它信号与信息处理系统的8×8二维DCT/IDCT处理器的全部电路设计工作。它采用一根信号线控制计算DCT/IDCT,其输入、输出为12位,内部数据线及内部参数均为16位。
关键词
二维DCT/
idct
处理器
分布式算法
Keywords
FPGA(Field Programmable Gate Arry),
2
-d
DCT/
idct
processor, Distributed algorithm
分类号
TP332.03 [自动化与计算机技术—计算机系统结构]
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职称材料
题名
一种基于FPGA的二维DCT和IDCT的新算法
3
作者
赵滨
黄大庆
机构
南京航空航天大学无人机研究院
出处
《电子设计工程》
2011年第24期126-129,共4页
文摘
提出了一种新的二维DCT和IDCT的FPGA实现结构,采用行列快速算法将二维算法分解为两个一维算法实现,其中每个一维算法采用并行的流水线结构,每一个时钟处理8个数据,大大提高电路的数据吞吐率和运算速度。通过Modelsim仿真工具对该设计进行仿真,证明该算法的功能的正确性,进行一次8*8的分块二维DCT变换仅仅需要16个时钟,满足图像以及视频实时性的要求。
关键词
二维DCT算法
二维
idct
算法
流水线
FPGA
Keywords
2
-d
DCT
2-d idct
pipeline
FPGA
分类号
TP391 [自动化与计算机技术—计算机应用技术]
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职称材料
题名
作者
出处
发文年
被引量
操作
1
基于DA的高性能2-D IDCT处理器设计
陈章进
张志高
孔敏达
《微电子学与计算机》
CSCD
北大核心
2010
0
在线阅读
下载PDF
职称材料
2
基于FPGA和2位串行分布式算法的实时高速二维DCT/IDCT处理器研制
向晖
滕建辅
王承宁
《电子科学学刊》
CSCD
1999
2
在线阅读
下载PDF
职称材料
3
一种基于FPGA的二维DCT和IDCT的新算法
赵滨
黄大庆
《电子设计工程》
2011
0
在线阅读
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职称材料
已选择
0
条
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参考文献
引证文献
统计分析
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