Optimized Processor for Sensor Networks Applications

1

作者 Ali Elkateeb 《通讯和计算机（中英文版）》 2012年第3期311-316,共6页

关键词 嵌入式处理器 传感器节点 网络应用 优化 节点设计 软核处理器 可重构系统 核心处理器

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基于龙芯LA132软核处理器的宇航级SoPC设计 被引量：1

2

作者 刘珍妮 安军社 胡婉如 《电讯技术》 北大核心 2024年第5期772-777,共6页

针对现有星载计算机主控系统灵活性差和在空间辐射环境中存在单粒子翻转等问题,设计了一种灵活性强、可靠性高、自主可控的宇航级片上可编程系统(System-on-Programmable-Chip,SoPC)。该系统将龙芯LA132软核处理器应用于航天领域,降低... 针对现有星载计算机主控系统灵活性差和在空间辐射环境中存在单粒子翻转等问题,设计了一种灵活性强、可靠性高、自主可控的宇航级片上可编程系统(System-on-Programmable-Chip,SoPC)。该系统将龙芯LA132软核处理器应用于航天领域,降低了星载计算机主控系统的体积。为系统存储单元设计实现了一种基于矩阵算法的RS(8,4)码,可在无延迟的情况下实现错误检测与纠正功能,增强了系统的可靠性。测试结果表明,该SoPC系统在Xilinx KCU105硬件平台上可实现单周期内对两个错误符号的检测与纠正,满足宇航级安全性与可靠性的需求,为星载计算机主控系统的小型化提供了一种新的解决方案。 展开更多

关键词 星载计算机 片上可编程系统(SoPC) 软核处理器 错误检测与纠正(EDAC)

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基于NIOSⅡ软核处理器的嵌入式测试系统软硬件设计研究 被引量：13

3

作者 张荣 黄海莹 +2 位作者 李春枝 卫剑峰 蒋宇 《计算机测量与控制》 CSCD 北大核心 2012年第2期303-306,共4页

介绍了利用NIOSⅡ软核处理器设计嵌入式测试系统的两类系统架构,详细讲述了基于NIOSⅡ软核处理器的嵌入式测试系统软硬件设计方法;最后结合EP2C8Q-208C8型FPGA芯片,利用Verilog语言描述A/D芯片的工作时序逻辑,利用NIOSⅡ软核处理器设计... 介绍了利用NIOSⅡ软核处理器设计嵌入式测试系统的两类系统架构,详细讲述了基于NIOSⅡ软核处理器的嵌入式测试系统软硬件设计方法;最后结合EP2C8Q-208C8型FPGA芯片,利用Verilog语言描述A/D芯片的工作时序逻辑,利用NIOSⅡ软核处理器设计串口处理单元,将A/D采集的数据通过串口发送到计算机显示。实践表明,利用NIOS II软核处理器设计嵌入式测试系统,具有开发周期短,系统集成度高,功能灵活多样等特点,与传统利用单片机设计嵌入式测试系统相比,具有时钟频率高、运行速度快、调试方便等特点,是一种值得推广的嵌入式测试系统设计方法。 展开更多

关键词 NIOSⅡ软核处理器 嵌入式测试系统 单片机 FPGA A/D

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一种基于Nios Ⅱ软核的嵌入式图像采集处理系统设计 被引量：10

4

作者 龚向东 刘春平 +1 位作者 黄虹宾 曾振兴 《电子测量技术》 2010年第2期75-78,94,共5页

提出了一种基于Nios Ⅱ软核处理器的嵌入式图像采集处理系统架构,在图像采集缓存区、图像处理缓存区和图像显示缓冲区之间通过Avalon总线流模式管道实现了数据的高速传输,着重介绍了该系统中组件模块的定制与设计,并给出了该系统的一个... 提出了一种基于Nios Ⅱ软核处理器的嵌入式图像采集处理系统架构,在图像采集缓存区、图像处理缓存区和图像显示缓冲区之间通过Avalon总线流模式管道实现了数据的高速传输,着重介绍了该系统中组件模块的定制与设计,并给出了该系统的一个应用实例。 展开更多

关键词 软核处理器 嵌入式系统 图像采集 图像处理 流模式管道

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基于NiosⅡ/SOPC的嵌入式数字IC测试 被引量：5

5

作者 宋跃 利剑清 胡升平 《仪表技术与传感器》 CSCD 北大核心 2009年第6期68-69,72,共3页

为实现数字IC故障检测的SOPC设计,在Altera-Cyclone EP1C6Q240中嵌入软核处理器NiosⅡ,用继电器EC2-5NW2阵列完成各引线的通用控制,在NiosⅡ控制下离线完成了对常用TTL74/54、CMOS 4000/4500系列常用数字IC芯片故障检测。文中详细介绍... 为实现数字IC故障检测的SOPC设计,在Altera-Cyclone EP1C6Q240中嵌入软核处理器NiosⅡ,用继电器EC2-5NW2阵列完成各引线的通用控制,在NiosⅡ控制下离线完成了对常用TTL74/54、CMOS 4000/4500系列常用数字IC芯片故障检测。文中详细介绍了系统结构、引脚控制,讲述了NiosⅡ-FPGA/SOPC的设计思想和实现方法。实验效果好,实践表明该设计是切实可行的。 展开更多

关键词 数字IC检测 FPGA/SOPC 软核处理器NiosⅡ 智能控制

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基于超声波技术的温度传感器设计 被引量：4

6

作者 张天恒 凌旭 张兴红 《仪表技术与传感器》 CSCD 北大核心 2014年第8期10-13,共4页

超声波检测技术的运用,使温度测量具有速度快、准确及测量范围大等优点。利用超声波在介质中的传播速度随温度变化而变化的特性,以带有NIOS软核的FPGA作为硬件电路控制核心,实现高速实时的数据采集,同时采用软件细分插补算法,实现超声... 超声波检测技术的运用,使温度测量具有速度快、准确及测量范围大等优点。利用超声波在介质中的传播速度随温度变化而变化的特性,以带有NIOS软核的FPGA作为硬件电路控制核心,实现高速实时的数据采集,同时采用软件细分插补算法,实现超声波传播时间的精确测量。经过理论推导和实验,设计的超声波温度传感器能够实现高精度高分辨率的温度测量,传播时间达到ns级,分辨率优于0.001℃. 展开更多

关键词 温度传感器 FPGA NIOS软核处理器 细分插补算法

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基于SOPC的以太网实时数据采集系统设计与实现 被引量：5

7

作者 梅大成 柴志勇 《计算机应用》 CSCD 北大核心 2009年第B12期108-109,112,共3页

设计了一个基于SOPC技术的实时数据采集系统。系统采用NiosⅡ软核处理器为主控制器,以嵌入式实时操作系统μC/OS-Ⅱ为软件运行平台,以LWIP为以太网通信协议,实现了数据采集系统的以太网传输及控制。整个系统在CycloneⅡ EP2C35开发板上... 设计了一个基于SOPC技术的实时数据采集系统。系统采用NiosⅡ软核处理器为主控制器,以嵌入式实时操作系统μC/OS-Ⅱ为软件运行平台,以LWIP为以太网通信协议,实现了数据采集系统的以太网传输及控制。整个系统在CycloneⅡ EP2C35开发板上实现并通过验证。 展开更多

关键词 NiosⅡ软核处理器 SOPC μC/OS-Ⅱ LWIP协议栈 实时数据采集

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基于NiosⅡ的学习型遥控器设计 被引量：2

8

作者 肖卫初 邓曙光 +2 位作者 朱珍奇 谭首峰 龙卫 《现代电子技术》 2010年第19期147-150,共4页

以Altera FPGA系列Cyclone EP1C12Q240C8器件为载体,通过SoPC技术构建嵌入式软核NiosⅡ处理器平台,运用Verilog HDL硬件描述语言设计等精度测量载波频率IP核、红外信号解调IP核、红外编码脉宽测量IP核和红外发送调制逻辑电路,以实现载... 以Altera FPGA系列Cyclone EP1C12Q240C8器件为载体,通过SoPC技术构建嵌入式软核NiosⅡ处理器平台,运用Verilog HDL硬件描述语言设计等精度测量载波频率IP核、红外信号解调IP核、红外编码脉宽测量IP核和红外发送调制逻辑电路,以实现载波的精确测量、红外信号解调、脉宽测量和调制功能,并给出了外围硬件电路和软件设计方案。实验表明,该遥控器解决了单片机因时钟频率低而无法对载波频率进行测量的瓶颈,实现了对任何一款普通遥控器的按键编码学习,真正完成了学习型遥控器的学习功能。 展开更多

关键词 软核处理器 等精度 遥控器 FPGA/SOPC

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基于SOPC的嵌入式WTB网络控制节点机的研制 被引量：4

9

作者 王建芳 夏清国 《计算机工程》 CAS CSCD 北大核心 2007年第22期266-268,共3页

探讨一种基于可编程片上系统的嵌入式绞线式列车总线(WTB)网络控制节点机的研制方案。该方案采用FPGA作为核心器件,将Altera的NisoII软核处理器与WTB控制逻辑集成在单片FPGA内,取代了原来的工控节点机和控制部件相组成的方案。减小了产... 探讨一种基于可编程片上系统的嵌入式绞线式列车总线(WTB)网络控制节点机的研制方案。该方案采用FPGA作为核心器件,将Altera的NisoII软核处理器与WTB控制逻辑集成在单片FPGA内,取代了原来的工控节点机和控制部件相组成的方案。减小了产品的体积和重量,降低了硬件开发成本。该文给出了系统的总体设计方案,并分析了测试结果。 展开更多

关键词 可编程片上系统 NIOSII软核处理器 绞线式列车总线 介质附件单元 FPGA

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基于游标法的高精度测频系统设计 被引量：5

10

作者 张志文 王晴 《科学技术与工程》 北大核心 2012年第31期8229-8234,8264,共7页

为了有效地改善传统测频方法精度低、误差大的问题,提出了一种基于多周期分频段测量法与双游标法相结合的高精度测频方案。可对0.1 Hz—5 MHz范围内的频率信号进行测量。系统通过在Quartus II中用VHDL语言编写脉冲计数及控制模块,并在F... 为了有效地改善传统测频方法精度低、误差大的问题,提出了一种基于多周期分频段测量法与双游标法相结合的高精度测频方案。可对0.1 Hz—5 MHz范围内的频率信号进行测量。系统通过在Quartus II中用VHDL语言编写脉冲计数及控制模块,并在FPGA芯片内植入NIOS II软核处理器作为系统的控制核心,完成对惯导组件输出的频率信号进行测量。并将测量结果传至上位机进行处理和显示。实验结果表明,系统具有较高的测量精度。同时由于采用软核处理器,大大降低了成本,具有很好的实用价值。 展开更多

关键词 频率测量 FPGA NIOSⅡ软核处理器 VHDL 双游标法 多周期分频段 精度

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基于Nios Ⅱ软核处理器的PWM控制器设计 被引量：9

11

作者 冯志华 高社生 张云安 《微处理机》 2008年第1期134-137,共4页

介绍了Altera公司最新开发的SOPC解决方案——Nios Ⅱ软核处理器,提出了基于Nios Ⅱ嵌入式软核处理器的脉宽调制PWM控制器的硬件、软件设计方法,并给出了脉宽调制PWM软件编写的程序。实验结果表明,与现有的其它方法相比,该方法具有灵活... 介绍了Altera公司最新开发的SOPC解决方案——Nios Ⅱ软核处理器,提出了基于Nios Ⅱ嵌入式软核处理器的脉宽调制PWM控制器的硬件、软件设计方法,并给出了脉宽调制PWM软件编写的程序。实验结果表明,与现有的其它方法相比,该方法具有灵活、稳定、易维护、高效率等优点。 展开更多

关键词 片上可重构系统(SOPC) 脉宽调制(PWM) NIOS Ⅱ软核处理器

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基于SOPC的FPGA NiosⅡ嵌入式等精度频率计设计 被引量：13

12

作者 井新宇 《实验室研究与探索》 CAS 北大核心 2012年第6期217-220,共4页

为了提高频率计的测量精度和系统性能,一方面对传统的等精度频率计的测量方法进行改进,另一方面采用SOPC设计技术,FPGA芯片上配置NiosⅡ嵌入式软核处理器的系统实现方案。利用FPGA高速数据处理能力实现对各参数的测量计数,软核处理器优... 为了提高频率计的测量精度和系统性能,一方面对传统的等精度频率计的测量方法进行改进,另一方面采用SOPC设计技术,FPGA芯片上配置NiosⅡ嵌入式软核处理器的系统实现方案。利用FPGA高速数据处理能力实现对各参数的测量计数,软核处理器优良的数据处理能力实现对频率、周期、脉冲宽度和占空比的计算及显示。结果表明该频率计系统性能优良、测量精度高、成本低、体积小。 展开更多

关键词 测量方法 相对误差 等精度 FPGA SOPC NiosⅡ软核处理器

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基于SoPC的嵌入式语音处理系统的设计与实现 被引量：4

13

作者 李颖宏 赵俊桃 《现代电子技术》 2009年第2期33-35,38,共4页

介绍一种基于SoPC技术实现的语音处理系统的设计方法。系统主要由CycloneⅡFPGA内嵌NiosⅡ软核处理器及音频编/解码芯片构成;通过构建嵌入式Linux操作系统来实现对音频信号的采集和回放处理。详细介绍通过SoPCBuilder配置NiosⅡ嵌入式... 介绍一种基于SoPC技术实现的语音处理系统的设计方法。系统主要由CycloneⅡFPGA内嵌NiosⅡ软核处理器及音频编/解码芯片构成;通过构建嵌入式Linux操作系统来实现对音频信号的采集和回放处理。详细介绍通过SoPCBuilder配置NiosⅡ嵌入式处理器、外围设备及接口的过程,以及嵌入式Linux操作系统在SoPC系统上的移植过程。利用SoPC系统的可裁减性以及嵌入式系统的可移植性,可使该设计作为一个子系统应用在如网络会议的视频电话中,该方法对SoPC系统的开发研究具有较高的参考价值。 展开更多

关键词 片上系统 嵌入式LINUX 音频编码 音频解码 软核处理器

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基于软核处理器的嵌入式系统设计 被引量：3

14

作者 苏智华 李校红 《自动化与仪器仪表》 2015年第9期121-122,共2页

基于MicroBlaze软核处理器设计了嵌入式系统,首先分析了MicroBlaze软核处理器的自身结构特点;然后提出了嵌入式系统的整体结构,最后详细阐述了基于EDK平台的软件和硬件的开发设计过程,构建出完善的嵌入式系统。该嵌入式系统达到了预期... 基于MicroBlaze软核处理器设计了嵌入式系统,首先分析了MicroBlaze软核处理器的自身结构特点;然后提出了嵌入式系统的整体结构,最后详细阐述了基于EDK平台的软件和硬件的开发设计过程,构建出完善的嵌入式系统。该嵌入式系统达到了预期的设计目标,体现出了MicroBlaze软核处理器的价值。 展开更多

关键词 嵌入式系统 MicroBlaze软核处理器 SOPC EDK

原文传递

基于FPGA/SOPC-NiosⅡ的频率计数器设计 被引量：4

15

作者 利剑清 宋跃 +1 位作者 林明仁 张志坚 《东莞理工学院学报》 2008年第3期53-57,共5页

本设计以Altera FPGA系列Cyclone EP1C6Q240器件为载体,通过SOPC技术构建嵌入式软核NiosⅡ处理器平台,运用VHDL语言设计计数模块,利用等精度测量技术完成对1 Hz～100 MHz周期信号的精度为8×10^(-6)的周期和频率的测量,同时采用闸... 本设计以Altera FPGA系列Cyclone EP1C6Q240器件为载体,通过SOPC技术构建嵌入式软核NiosⅡ处理器平台,运用VHDL语言设计计数模块,利用等精度测量技术完成对1 Hz～100 MHz周期信号的精度为8×10^(-6)的周期和频率的测量,同时采用闸门测量技术完成脉宽、占空比的测量,重点介绍了等精度计数模块与SOPC技术的设计与实现的方法. 展开更多

关键词 FPGA/SOPC 软核处理器Nios Ⅱ 等精度测量 频率计数器

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基于SOPC数据采集与控制系统的设计 被引量：1

16

作者 张燕 任安虎 《电子设计工程》 2012年第12期184-185,189,共3页

基于SOPC技术设计了一个综合应用系统:实现了键值数据采集、显示,并将采集到的数据通过串口送给上位机;也可以接收上位机送来的数据,控制点亮相应的二极管且将接收到的数据显示在数码管上。系统硬件由FPGA及外围电路组成,采用了性能优良... 基于SOPC技术设计了一个综合应用系统:实现了键值数据采集、显示,并将采集到的数据通过串口送给上位机;也可以接收上位机送来的数据,控制点亮相应的二极管且将接收到的数据显示在数码管上。系统硬件由FPGA及外围电路组成,采用了性能优良的Nios II软核处理器;软件在Altera公司的软件集成开发工具Nios II IDE下应用C语言编程。该系统工作可靠,在实际的应用设计中有一定的参考价值。 展开更多

关键词 数据采集 控制 软核处理器 数据 工作可靠

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基于FPGA的运动控制芯片设计 被引量：1

17

作者 郗晓田 丁彬云 +1 位作者 游林儒 庞永鹏 《机电工程技术》 2008年第1期67-69,共3页

随着新型高性能、低成本现场可编程门阵列(FPGA,Field Programmable Gate Array)的出现,基于FPGA的可编程片上系统(SOPC,System on Programmable Chip)正逐步走向实用阶段。本文介绍了一种基于Altera公司NiosII嵌入式软处理器和PCIIP核,... 随着新型高性能、低成本现场可编程门阵列(FPGA,Field Programmable Gate Array)的出现,基于FPGA的可编程片上系统(SOPC,System on Programmable Chip)正逐步走向实用阶段。本文介绍了一种基于Altera公司NiosII嵌入式软处理器和PCIIP核,在FPGA上构建的运动控制芯片。本芯片最大的优势是价格低廉,并且由于集成了PCI接口,能很容易地运用于构造基于PCI总线的运动控制系统。 展开更多

关键词 可编程片上系统(SOPC) NIOS Ⅱ软核处理器 PCI总线 现场可编程门阵列

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软核嵌入处理器MicroBlaze 被引量：14

18

作者 刘永健 《计算机与网络》 2012年第15期64-66,共3页

MicroBlaze是Xilinx的软核嵌入处理器,使用开发工具ISE/XPS和相关IP-Core,利用FPGA内的通用资源,用户可以参数化地设计CPU、总线、接口等组件,在FPGA内部实现一个完整的高性能处理器,且支持多核处理器,同时可在XPS中完成操作系统配置和... MicroBlaze是Xilinx的软核嵌入处理器,使用开发工具ISE/XPS和相关IP-Core,利用FPGA内的通用资源,用户可以参数化地设计CPU、总线、接口等组件,在FPGA内部实现一个完整的高性能处理器,且支持多核处理器,同时可在XPS中完成操作系统配置和应用软件的设计调试。软核嵌入处理器广泛适用于各个领域。文章介绍软核嵌入处理器MicroBlaze及其设计方法。 展开更多

关键词 MICROBLAZE 软核 嵌入处理器

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基于FPGA的嵌入式ASIP软核设计与实现

19

作者 李庆诚 任健 +1 位作者 刘嘉欣 黄宝贞 《微计算机信息》 北大核心 2008年第14期171-173,共3页

采用ASIP+FPGA模式设计了一款嵌入式微处理器软核,以该软核为例从体系结构和指令集设计两方面对ASIP+FPGA模式微处理器软核的设计进行了分析和验证,最后通过与传统微处理器对比验证了该设计模式的优势:指令针对性强,执行效率高;易于扩展... 采用ASIP+FPGA模式设计了一款嵌入式微处理器软核,以该软核为例从体系结构和指令集设计两方面对ASIP+FPGA模式微处理器软核的设计进行了分析和验证,最后通过与传统微处理器对比验证了该设计模式的优势:指令针对性强,执行效率高;易于扩展,适应性强。 展开更多

关键词 嵌入式系统 处理器软核 ASIP FPGA VHDL

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基于SOPC的低电压电泳芯片系统平台设计

20

作者 廖红华 于军 +2 位作者 王俊 陈建军 雷辉 《微计算机信息》 北大核心 2008年第17期129-131,共3页

探讨了一种基于SOPC(System on a Programmable Chip)的低电压电泳芯片系统平台设计方案。以基于FPGA内嵌NiosII软核处理器为系统控制模块,运用SOPC Builder定制低电压电泳芯片运动梯度电势施加控制器、Avalon流模式的电导检测的IP核,... 探讨了一种基于SOPC(System on a Programmable Chip)的低电压电泳芯片系统平台设计方案。以基于FPGA内嵌NiosII软核处理器为系统控制模块,运用SOPC Builder定制低电压电泳芯片运动梯度电势施加控制器、Avalon流模式的电导检测的IP核,实现芯片高速控制与电泳信号采集。文中具体阐述了该系统软、硬件总体结构、多CPU协调工作原理、运动梯度电势的控制原理以及电导检测采集IP核的设计。 展开更多

关键词 NiosⅡ软核处理器 SOPC 低电压毛细管电泳芯片 控制与采集

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