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逻辑锁定和时序约束在高速数据采集中的应用
被引量：
1
1
作者
王志莹
王子斌
《信息与电子工程》
2008年第3期187-190,共4页
基于Altera现场可编程门阵列的逻辑锁定设计方法可提高复杂系统设计时的效率,在设计整合时,能更好地继承各个模块的实现结果;约束编辑器提供了指导Quartus II软件对设计进行时序收敛的一种手段。介绍了如何利用这两种设计方法对数字存...
基于Altera现场可编程门阵列的逻辑锁定设计方法可提高复杂系统设计时的效率,在设计整合时,能更好地继承各个模块的实现结果;约束编辑器提供了指导Quartus II软件对设计进行时序收敛的一种手段。介绍了如何利用这两种设计方法对数字存储示波器中高速数据存储电路性能进行优化,并完成了4个相位不同,频率为250 MHz的数据通道的1 GHz数据流的存储。
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关键词
Altera现场可编程门阵列
Quartus
Ⅱ软件
逻辑锁定
约束编辑器
时序收敛
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职称材料
基于Altera系列器件的逻辑锁定方法学在FPGA设计中的应用
2
作者
秦韬
王雨
曲晶
《微计算机信息》
北大核心
2005年第09Z期148-149,108,共3页
Altera公司出品系列器件所用设计软件!!QuartusII,提供了一种其独有的优化方法:逻辑锁定(LogicLock)。本文介绍了一种在实际工程中应用逻辑锁定的方法,并加以仿真验证。
关键词
ALTERA
QuartusⅡ
FPGA
逻辑锁定
方法学应用
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职称材料
题名
逻辑锁定和时序约束在高速数据采集中的应用
被引量：
1
1
作者
王志莹
王子斌
机构
电子科技大学自动化工程学院
出处
《信息与电子工程》
2008年第3期187-190,共4页
文摘
基于Altera现场可编程门阵列的逻辑锁定设计方法可提高复杂系统设计时的效率,在设计整合时,能更好地继承各个模块的实现结果;约束编辑器提供了指导Quartus II软件对设计进行时序收敛的一种手段。介绍了如何利用这两种设计方法对数字存储示波器中高速数据存储电路性能进行优化,并完成了4个相位不同,频率为250 MHz的数据通道的1 GHz数据流的存储。
关键词
Altera现场可编程门阵列
Quartus
Ⅱ软件
逻辑锁定
约束编辑器
时序收敛
Keywords
Ahcra FPGA
Quartus Ⅱ
logiclock
Assignment Editor
timing closurc
分类号
TP274.2 [自动化与计算机技术—检测技术与自动化装置]
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职称材料
题名
基于Altera系列器件的逻辑锁定方法学在FPGA设计中的应用
2
作者
秦韬
王雨
曲晶
机构
河南郑州国家数字交换系统工程技术研究中心
出处
《微计算机信息》
北大核心
2005年第09Z期148-149,108,共3页
基金
国家863计划(2003AA103510)资助项目
文摘
Altera公司出品系列器件所用设计软件!!QuartusII,提供了一种其独有的优化方法:逻辑锁定(LogicLock)。本文介绍了一种在实际工程中应用逻辑锁定的方法,并加以仿真验证。
关键词
ALTERA
QuartusⅡ
FPGA
逻辑锁定
方法学应用
Keywords
Altera
Quartus Ⅱ
FPGA
logiclock
Methodology
Appfication
分类号
TP276 [自动化与计算机技术—检测技术与自动化装置]
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职称材料
题名
作者
出处
发文年
被引量
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1
逻辑锁定和时序约束在高速数据采集中的应用
王志莹
王子斌
《信息与电子工程》
2008
1
在线阅读
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职称材料
2
基于Altera系列器件的逻辑锁定方法学在FPGA设计中的应用
秦韬
王雨
曲晶
《微计算机信息》
北大核心
2005
0
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