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一种可重构的单精度近似浮点乘法器设计
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作者 李鹏程 黄立波 +5 位作者 陈刚 赖明澈 邓林 刘威 杨乾明 王永文 《计算机研究与发展》 北大核心 2025年第6期1581-1593,共13页
人工智能(AI)和物联网(IoT)技术的迅速发展,对计算能效提出了更高的要求,终端设备在硬件资源开销方面同样面临巨大挑战.为了应对能效问题,新型低功耗近似计算单元的设计得到了广泛研究.在数字信号处理和图像处理等应用场景中,存在大量... 人工智能(AI)和物联网(IoT)技术的迅速发展,对计算能效提出了更高的要求,终端设备在硬件资源开销方面同样面临巨大挑战.为了应对能效问题,新型低功耗近似计算单元的设计得到了广泛研究.在数字信号处理和图像处理等应用场景中,存在大量的浮点运算.这些应用消耗了大量的硬件资源,但它们具有一定的容错性,没有必要进行完全精确的计算.据此,提出了一种基于移位近似算法MTA(multiplication to shift addition)和非对称截断的单精度可重构近似浮点乘法器设计方法.首先,采用了一种低功耗的近似算法MTA,将部分操作数的乘法运算转换为移位加法.其次,为了在精度和成本之间取得平衡,设计了针对操作数高有效位的非对称截断处理,并对截断后保留的部分进行精确计算.通过采用不同位宽的MTA近似计算和改变截断后部分积阵列的行数,生成了广阔的设计空间,从而可以在精度和成本之间进行多种权衡调整.与精确浮点乘法器相比,所提出设计MTA5T5的精度损失(MRED)仅约为0.32%,功耗降低了85.80%,面积减少了79.53%.对于精度较低的MTA3T3,其精度损失约为1.92%,而功耗和面积分别降低了90.55%和85.80%.最后,进行了FIR滤波和图像处理的应用测试,结果表明所提出的设计在精度和开销方面具有显著优势. 展开更多
关键词 近似浮点乘法器 MTA 非对称截断 精度 开销
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连铸中间包塞棒水口流量特性与自动开浇控制模型研究
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作者 高琦 黄文 +3 位作者 周波 连天龙 刘庆国 郭林 《特种铸造及有色合金》 北大核心 2025年第2期201-207,共7页
基于流体力学伯努利方程推导了浸入式水口的流量计算式,基于相似理论设计了水模型试验装置,研究了中间包水头高度和塞棒开口度对水口流量的影响,确定了塞棒开口度与流量系数的关系,确认了流量系数是开口度的函数并随开口度增大而增大。... 基于流体力学伯努利方程推导了浸入式水口的流量计算式,基于相似理论设计了水模型试验装置,研究了中间包水头高度和塞棒开口度对水口流量的影响,确定了塞棒开口度与流量系数的关系,确认了流量系数是开口度的函数并随开口度增大而增大。分析某厂实际水口浇注过程实测数据,验证了其流量系数与塞棒开口度的关系,进而建立了开浇过程控制模型,得到了开浇控制曲线。通过现场开浇试验,验证了该方法的准确性。 展开更多
关键词 连铸 浸入式水口 塞棒 自动开浇 控制模型
原文传递
面向网表基础组件识别任务的数据集设计
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作者 李宗泰 杨靓 +4 位作者 李灏 娄冕 李颖琦 毛远宏 贾一鸣 《微电子学与计算机》 2025年第11期47-58,共12页
门级网表的反向工程是一种确保集成电路产品可信的检测方法。随着AI+IC的发展趋势,逐步演变为基于图神经网络的网表基础组件识别任务。当前,该任务面临的一个主要问题是不能泛化到电路功能一致但网表结构发生变化的场景。然而,目前尚未... 门级网表的反向工程是一种确保集成电路产品可信的检测方法。随着AI+IC的发展趋势,逐步演变为基于图神经网络的网表基础组件识别任务。当前,该任务面临的一个主要问题是不能泛化到电路功能一致但网表结构发生变化的场景。然而,目前尚未有电路功能一致但结构不同的公开网表数据集,给问题的研究增加了障碍。为此,研究和发布了电路功能一致但网表结构不同的10个数据集,以促进对网表基础组件任务的深入研究。具体来说,首先利用不同的标准单元库来改变网表结构,分别创建了5个数据集以验证模型在网表基础组件识别任务上的准确性、跨标准单元库的可扩展性、跨标准单元库的泛化能力;其次使用综合工具的内置命令来改变网表结构,分别创建了5个数据集以验证模型在同一标准单元库下的泛化能力。此外,网表通常不能直接作为神经网络模型的输入,为此开发了一款工具PyNetlist,以实现网表到图数据格式的自动化转换。最后,给出了一些经典的GNN模型在全部10个数据集上的表现,实验结果验证了上述问题的切实存在,同时也说明了数据集对这个问题的基础性支撑作用。PyNetlist和全部10个数据集将在期刊网站开源。 展开更多
关键词 硬件安全 反向工程 门级网表 图神经网络
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基于三维高斯溅射原理的神经渲染硬件加速器研究综述
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作者 彭嘉盈 莫霄睿 +1 位作者 年成 张春 《微电子学与计算机》 2025年第10期66-77,共12页
三维高斯溅射(3D Gaussian Splatting, 3DGS)作为一种新兴的显式三维场景渲染方法,凭借优越的图像质量与高效的渲染流程,在神经渲染领域引起了广泛关注。相较于基于多层感知机的隐式神经表示方法,3DGS采用可微分的高斯分布对场景进行建... 三维高斯溅射(3D Gaussian Splatting, 3DGS)作为一种新兴的显式三维场景渲染方法,凭借优越的图像质量与高效的渲染流程,在神经渲染领域引起了广泛关注。相较于基于多层感知机的隐式神经表示方法,3DGS采用可微分的高斯分布对场景进行建模,在无需神经网络推理的条件下实现快速体渲染,具有良好的硬件适应性。其推理核心流程包括预处理、高斯深度排序与体渲染,虽然整体计算量低于神经辐射场渲染(Neural Radiance Fields,NeRF),但仍存在高频访存、计算冗余与带宽瓶颈等问题,尤其在边缘设备上部署时对硬件资源与能效提出更高要求。为解决上述问题,近年来研究者提出了多种3DGS硬件加速方案,通过算法-架构协同优化,构建面向预处理、排序与光栅化全流程的低功耗加速器架构。在系统梳理3DGS核心原理的基础上,重点分析了当前主流加速器的设计思路,并对各方案在模块划分、数据调度与存储访问上的不同策略进行了归纳。在此基础上,讨论了当前硬件方案在流水调度灵活性、异构资源利用及系统集成方面的潜在挑战,并对未来低功耗、高并发3DGS渲染系统的发展方向提出了初步展望。 展开更多
关键词 3D高斯溅射 硬件加速 实时系统 三维重建
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面向培养创新思维的复数计算仿真实验设计
5
作者 刘博生 于雪昂 武继刚 《现代信息科技》 2025年第13期134-138,共5页
随着人工智能和大数据技术的快速发展,计算机专业课程在培养创新型人才方面发挥重要作用。然而,传统以知识传递为中心的教学模式难以激发学生的主动性和创造力。文章基于复数乘法计算数字电路设计,提出一种逐步优化型的实验教学模式,通... 随着人工智能和大数据技术的快速发展,计算机专业课程在培养创新型人才方面发挥重要作用。然而,传统以知识传递为中心的教学模式难以激发学生的主动性和创造力。文章基于复数乘法计算数字电路设计,提出一种逐步优化型的实验教学模式,通过理论与实践结合,培养学生的创新能力。该模式引导学生从基础电路设计入手,逐步优化复数乘法的实现方法,应用乘法复用等策略改进电路计算结构,并利用硬件设计工具完成功能仿真和性能评估。该教学模式能有效提升学生对理论知识的理解与应用,通过迭代设计进一步激发了学生的创新思维,为解决复杂工程问题奠定基础。 展开更多
关键词 数字电路 复数乘法 创新思维
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可重构铁电数据选择器设计及在映射中的应用
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作者 吴乾火 王伦耀 +2 位作者 查晓婧 储著飞 夏银水 《电子与信息学报》 北大核心 2025年第9期3321-3332,共12页
目前以铁电晶体管(FeFET)为基础的存算一体逻辑电路的映射以阵列为主,该文提出一种以铁电晶体管-数据选择器(FeFET-MUX)为基本电路单元存算一体逻辑电路的实现方法。该方法主要包含两方面内容:(1)提出一种可重构的Fe FET-MUX电路,该电... 目前以铁电晶体管(FeFET)为基础的存算一体逻辑电路的映射以阵列为主,该文提出一种以铁电晶体管-数据选择器(FeFET-MUX)为基本电路单元存算一体逻辑电路的实现方法。该方法主要包含两方面内容:(1)提出一种可重构的Fe FET-MUX电路,该电路具有结构共享和数据输入端可扩展的特点。(2)提出适合该Fe FET-MUX映射的逻辑函数分割方法,通过将待实现的逻辑函数表示成二元决策图(BDD),然后将BDD分割成适合FeFETMUX映射的子BDD集合,最后完成逻辑函数用FeFET-MUX的映射。该文所提FeFET-MUX电路的逻辑功能用已有的FeFET模型进行仿真验证,用于映射的BDD分割算法用C++实现。实验结果表明,相比于传统的非结构共享二选一FeFET-MUX电路的映射结果,采用所提结构共享FeFET-MUX电路结合BDD分割算法,FeFET的使用数量平均可以减少79.9%。 展开更多
关键词 逻辑电路映射 存算一体 铁电晶体管电路 数据选择器 二元决策图分割
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人工智能在教育中的应用研究热点及趋势
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作者 马华 谢敏良 +3 位作者 罗茜 唐文胜 熊超 赵文 《软件导刊》 2025年第6期205-212,共8页
近年来人工智能技术取得突破性进展,人工智能在教育模式革新和教育数字化转型中的应用研究受到广泛关注。采用文献计量法,使用CiteSpace软件对CNKI上近10年相关研究进行可视化分析,从发文量变化态势、作者—机构共现图谱、关键词共现图... 近年来人工智能技术取得突破性进展,人工智能在教育模式革新和教育数字化转型中的应用研究受到广泛关注。采用文献计量法,使用CiteSpace软件对CNKI上近10年相关研究进行可视化分析,从发文量变化态势、作者—机构共现图谱、关键词共现图谱和关键词聚类图谱等方面梳理了研究现状,并对学习环境、自适应个性化学习、认知工具、机器人和大模型等5个主题剖析了人工智能在教育中的应用热点。最后,从新型学习空间中的互动学习方法、结合大模型的教学方法、机器人辅助的新型教学模型和结合师生情感情绪改进教学方式等4个方面归纳了人工智能应用于教育的发展趋势。 展开更多
关键词 人工智能 教育信息化 研究热点 研究趋势 文献计量法
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基于改进功能点法的烟草信息化项目造价评估研究
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作者 庄昕鹏 郑相涵 +2 位作者 黄恒杰 蔡永昊 严柯寰 《计算机应用文摘》 2025年第4期187-189,共3页
在信息技术领域,如何评估信息化项目的造价成本一直是业内关注的难题。其根本原因在于软件开发前期招标、需求说明等文档的复杂性,使得软件开发成本的评估指标难以提取,从而无法建立科学统一的信息技术建设和服务成本评估标准。目前,功... 在信息技术领域,如何评估信息化项目的造价成本一直是业内关注的难题。其根本原因在于软件开发前期招标、需求说明等文档的复杂性,使得软件开发成本的评估指标难以提取,从而无法建立科学统一的信息技术建设和服务成本评估标准。目前,功能点分析法是常用的软件成本评估方法,但在烟草行业的实际项目中,传统功能点法存在人工成本较高且主观性较强的问题。针对这些问题,文章提出了一种基于基线速查表的功能点评估方法,旨在形成一套适用于烟草行业的信息化项目造价评估方法,从而解决项目最高限价指定的问题。 展开更多
关键词 项目造价评估 改进的功能点法 烟草行业信息化 基线速查
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基于改进连续时间动态系统的模拟SAT求解器 被引量:2
9
作者 赵海军 陈华月 崔梦天 《计算机应用研究》 CSCD 北大核心 2024年第1期200-205,共6页
针对布尔可满足性问题的高效求解进行了研究。首先,通过对k-SAT问题和基于耦合常微分方程形式的确定性连续时间动态系统的分析,提出了一种基于时延信息形式的改进连续时间动态系统方程,以保持集中搜索特性;然后,提出了实现该系统方程的... 针对布尔可满足性问题的高效求解进行了研究。首先,通过对k-SAT问题和基于耦合常微分方程形式的确定性连续时间动态系统的分析,提出了一种基于时延信息形式的改进连续时间动态系统方程,以保持集中搜索特性;然后,提出了实现该系统方程的三个主要组件即信号动态电路、辅助变量电路和数字验证电路的模拟设计。在信号动态电路的设计中,设计了一种获得更高性能、更小面积和更低功耗的模拟硬件形式;在提出的辅助变量电路和数字验证电路的模拟硬件设计中,实现了避免梯度下降搜索陷入无解和确定给定问题的解是否已经找到的目标;同时提出了降低面积和功耗的可替代辅助变量电路的两种设计方案。仿真实验结果表明,提出的新的模拟SAT求解器不仅是有效的,而且相比于单一软件算法实现的SAT求解器和其他硬件类SAT求解器具有更高的加速性能和更低的功耗。 展开更多
关键词 布尔可满足性问题 连续时间动态系统 模拟设计 辅助变量 数字验证 加速性能
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一种数字预失真和峰均比削峰法联合优化方法研究
10
作者 高浩楠 张涛 李聪颖 《计算机测量与控制》 2025年第2期278-285,共8页
现代信息通信技术飞速发展,单一数字预失真技术或峰均比抑制方法无法最大化减少信号的非线性失真,提高发射机能效;通过对数字预失真和峰均比限幅法联合算法的研究,分别优化预失真系统的功率放大器建模和限幅系统的信号处理方式,进一步... 现代信息通信技术飞速发展,单一数字预失真技术或峰均比抑制方法无法最大化减少信号的非线性失真,提高发射机能效;通过对数字预失真和峰均比限幅法联合算法的研究,分别优化预失真系统的功率放大器建模和限幅系统的信号处理方式,进一步提高功率放大器工作效率;对功放行为模型建模引入更多记忆效应特性,经实验测试归一化均方误差可降低19.87 dB;采用阈值分解技术处理输入信号并测试削峰法对信号峰均比的抑制效果,实验结果左边带ACPR值下降19.72 dBc,右边带ACPR下降17.46 dBc,峰均比下降2.54 dB,满足了精确描述信号的记忆效应的要求,降低了功率放大器非线性失真和峰均比。 展开更多
关键词 数字预失真 功率放大器 峰均比 削峰 阈值矢量分解
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基于PPO算法的逻辑综合序列优化通用框架设计
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作者 王梦可 杨朝晖 +1 位作者 查晓婧 夏银水 《宁波大学学报(理工版)》 2025年第2期78-85,共8页
逻辑综合通常采用启发式方法将逻辑优化算法组成为序列进行电路性能优化,而启发式方法难以根据电路和优化目标的差异进行序列自动化调节,影响了电路优化质量.为了在集成电路设计中提升序列的自适应生成能力,将序列优化问题建模为马尔可... 逻辑综合通常采用启发式方法将逻辑优化算法组成为序列进行电路性能优化,而启发式方法难以根据电路和优化目标的差异进行序列自动化调节,影响了电路优化质量.为了在集成电路设计中提升序列的自适应生成能力,将序列优化问题建模为马尔可夫决策过程,提出一种面向多种逻辑表示的强化学习框架,利用近端策略优化(Proximal Policy Optimization,PPO)指导智能体来探索序列优化空间,改善其生成序列的泛化能力.并将EPFL基准电路转变为与-非图(And-Inverter Graph,AIG)和异或多数图(Xor-MajorityGraph,XMG)形式,分别经由所提出的框架进行实验,AIG形式下本文方法与DRiLLS和BOiLS方法相比分别有18.66百分点和27.67百分点的性能提升;XMG形式下则可提升原始电路性能约37.34%.实验结果表明,由本文方法生成的算法序列对电路性能有较大改进. 展开更多
关键词 逻辑综合 序列优化 强化学习 近端策略优化
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基于Hyperlynx的SPI时钟信号完整性分析
12
作者 韩琳琳 邹斌阳 《电工技术》 2025年第6期177-178,181,共3页
在某精密光机部件SPI接口电路设计中,因传输环节较多,信号完整性问题不可避免。低温时钟信号幅值低于FLASH芯片门限要求,导致DSP通过SPI接口读取FLASH数据错误。通过理论分析,借助Hyperlynx仿真软件对SPI接口电路中关键的时钟信号进行... 在某精密光机部件SPI接口电路设计中,因传输环节较多,信号完整性问题不可避免。低温时钟信号幅值低于FLASH芯片门限要求,导致DSP通过SPI接口读取FLASH数据错误。通过理论分析,借助Hyperlynx仿真软件对SPI接口电路中关键的时钟信号进行了信号完整性仿真,通过在时钟信号串联280Ω电阻,有效提高了时钟信号的幅值,解决了低温下读数据错误的问题。 展开更多
关键词 信号完整性 SPI接口 Hyperlynx仿真
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晶体塑性有限元模拟2024铝合金轧制过程中织构演变
13
作者 曲阳 赵齐 马东威 《特种铸造及有色合金》 北大核心 2025年第3期371-380,共10页
将晶体塑性理论与有限元软件ABAQUS相结合,采用CPFEM模拟了2024铝合金的5种单晶体与3种多晶体在轧制过程中不同压下量时的变形行为及织构演变趋势。结果表明,晶界与晶体内部均发生了不均匀变形,单晶体应力与累计剪切应变分布多成带状,... 将晶体塑性理论与有限元软件ABAQUS相结合,采用CPFEM模拟了2024铝合金的5种单晶体与3种多晶体在轧制过程中不同压下量时的变形行为及织构演变趋势。结果表明,晶界与晶体内部均发生了不均匀变形,单晶体应力与累计剪切应变分布多成带状,但多晶体变形情况更加复杂。在不同压下量的轧制情况下,Cube取向与Goss取向单晶体不易发生累计剪切应变,晶粒取向也主要绕ND轴转动。在多晶体轧制过程中,Brass取向与Goss取向强织构中的Brass和Goss取向晶粒变形受到阻碍,极点分布更加均匀,Goss取向晶粒取向随着压下量的增加而逐渐向Brass取向转变,形成新的稳定织构。 展开更多
关键词 晶体塑性理论 应力 有限元模拟 2024铝合金
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基于FPGA的芯片功率温度多通道动态监测设计研究
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作者 徐昊 陈梦倩 +2 位作者 孟智超 冯慧玲 王敦 《电子质量》 2025年第8期30-35,共6页
随着半导体产业的快速发展,芯片测试需求持续增长。芯片集成度与功率不断提升,对老炼测试的可靠性与精度提出了更严苛的要求。现有多数通用高温老化箱存在测试功能单一、温度偏差大等问题,已难以满足当前复杂功能芯片的测试需求。基于... 随着半导体产业的快速发展,芯片测试需求持续增长。芯片集成度与功率不断提升,对老炼测试的可靠性与精度提出了更严苛的要求。现有多数通用高温老化箱存在测试功能单一、温度偏差大等问题,已难以满足当前复杂功能芯片的测试需求。基于现场可编程逻辑门阵列(FPGA)芯片,通过模拟实际芯片老练测试场景,设计多通道动态驱动板,重点研究不同环境温度下芯片功率与壳温的变化规律。通过大量功率-温度动态数据的收集与分析,揭示了功率-温度分布规律,并发现烘箱内温度分布受电路总功率影响显著,且异常工况下存在芯片过热导致PN结击穿的风险,为功率-温度动态监测驱动板设计及老炼测试方法提供了参考依据。 展开更多
关键词 芯片测试 老炼试验 驱动板设计 现场可编程逻辑门阵列 功率 温度
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一种皮秒级时序相位调整通用算法的设计
15
作者 张少伟 刘玉娇 +1 位作者 高文 丁荣伟 《飞控与探测》 2025年第4期51-58,共8页
针对多通道高速串行信号因时序延迟不一致导致的同步采集乱码问题,提出一种皮秒级时序相位调整通用算法。该算法利用FPGA内部延时单元实现皮秒级延时对齐,并通过多级延时单元级联扩展延时范围;结合布局布线约束,确保级联延时模块在物理... 针对多通道高速串行信号因时序延迟不一致导致的同步采集乱码问题,提出一种皮秒级时序相位调整通用算法。该算法利用FPGA内部延时单元实现皮秒级延时对齐,并通过多级延时单元级联扩展延时范围;结合布局布线约束,确保级联延时模块在物理空间上紧密排列,从而实现ns范围内的ps级精度延时。此外,通过调整FPGA采样时钟相位以匹配信号脉宽,在自适应字对齐算法的基础上,实现了多通道高速串行信号的正确采样。最后,通过应用实例验证了算法的有效性,结果表明,该算法在多通道高速串行信号采集中具有显著的工程应用价值。 展开更多
关键词 时序对齐 延时模块 多通道LVDS 字对齐 FPGA
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长续航双电池冗余电路在加固笔记本中的应用
16
作者 周绍祥 黄炳依 +2 位作者 江桂东 曾敏华 林诗美 《自动化应用》 2025年第18期184-188,共5页
设计了双电池冗余的电路,并利用两个同型号的锂电池和切换管理电路模块,解决了X86平台的加固笔记本因功耗大续航短的问题。首先,该方案通过引入双电池供电的策略使加固笔记本可以长续航,并提高产品可靠性。然后,该方案可在不改变电池形... 设计了双电池冗余的电路,并利用两个同型号的锂电池和切换管理电路模块,解决了X86平台的加固笔记本因功耗大续航短的问题。首先,该方案通过引入双电池供电的策略使加固笔记本可以长续航,并提高产品可靠性。然后,该方案可在不改变电池形状和容量的情况下,使加固笔记本兼容现有设计,快速消耗现有电池库存,而不需要引进更大容量或新型号的电池库存,实现降本增效的作用。最后,在使用双电池冗余设计的加固笔记本时,可以比常规单电池作业的加固笔记本拥有更长的户外作业时间。 展开更多
关键词 双电池 长续航 X86平台 降本增效
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一种用于减少T门数量的Clifford+T电路简化算法
17
作者 卜登立 《北部湾大学学报》 2025年第2期13-22,共10页
T门数量是常用评价Clifford+T电路的成本指标。为减少由混合极性多控制Toffoli(MPMCT)电路转换所得Clifford+T电路的T门数量,设计了一种使用量子电路恒等式化简Clifford+T电路的算法。使用电路验证所设计的化简算法,结果表明:化简算法... T门数量是常用评价Clifford+T电路的成本指标。为减少由混合极性多控制Toffoli(MPMCT)电路转换所得Clifford+T电路的T门数量,设计了一种使用量子电路恒等式化简Clifford+T电路的算法。使用电路验证所设计的化简算法,结果表明:化简算法能够将由MPMCT电路转换所得Clifford+T电路的T门数量平均减少14.32%,同时将T门深度平均降低4.27%。 展开更多
关键词 可逆电路 量子电路 Clifford+T电路 T门
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国产FPGA通用以太网控制器的设计与实现 被引量:3
18
作者 胡明志 尹震宇 +3 位作者 王军 张飞青 徐光远 李东吉 《小型微型计算机系统》 CSCD 北大核心 2024年第10期2529-2536,共8页
目前由于国际芯片供应链的不稳定性,我国在FPGA领域面临着重要的工程应用替代挑战,尤其是在人防工程领域,大规模的工程项目急需国产FPGA技术来满足需求.因此,本文针对实时通信领域,特别是物联网网关的以太网控制器应用,进行了国产化替... 目前由于国际芯片供应链的不稳定性,我国在FPGA领域面临着重要的工程应用替代挑战,尤其是在人防工程领域,大规模的工程项目急需国产FPGA技术来满足需求.因此,本文针对实时通信领域,特别是物联网网关的以太网控制器应用,进行了国产化替代的研究.首先,在中科亿海微国产FPGA上,设计了基于流水线处理的兼容ARP、UDP、IP、ICMP等多种协议的UDP协议栈以及基于真双端口RAM和异步FIFO的兼容三速以太网的处理模块,实现了三速以太网控制器在国产FPGA上的部署及应用.并且考虑到国产FPGA现有的IP库不全的因素,本设计只采用了常用的FIFO和RAM的IP进行设计,方便了后续移植到其他国产FPGA上的需求.最后,本设计对部分模块进行了仿真测试,仿真测试表明,该控制器可以实现UDP协议传输、主动ARP、被动ARP、ARP表查询、ping、多协议优先级仲裁等功能,足够满足物联网网关中以太网控制器的使用需求. 展开更多
关键词 物联网网关 国产FPGA 以太网控制器 UDP
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基于改进局部图结构的再认记忆脑电特征提取
19
作者 王凯 顾翔 +2 位作者 李文杰 王苏弘 邹凌 《电子测量技术》 北大核心 2024年第4期81-86,共6页
为了研究再认记忆脑电的纹理特征,以及解决垂直对称局部图结构和对称局部图结构在提取脑电纹理特征时结构不稳定的问题。基于新旧范式设计了再认记忆实验,采集医学生和非医学生(均为35名)相关脑电,并且将这些脑电分为学习医学图片阶段... 为了研究再认记忆脑电的纹理特征,以及解决垂直对称局部图结构和对称局部图结构在提取脑电纹理特征时结构不稳定的问题。基于新旧范式设计了再认记忆实验,采集医学生和非医学生(均为35名)相关脑电,并且将这些脑电分为学习医学图片阶段、学习非医学图片阶段、再认旧医学图片阶段、再认旧非医学图片阶段、再认新医学图片阶段和再认新非医学图片阶段。首先,利用二维小波变换得到每位被试脑电的三个子频带,并提出改进集成局部图结构方法对原数据和3个子频带进行特征提取,改进算法纳入了具有稳定结构的扩展对称局部图结构和复合局部图结构;然后对特征进行归一化,避免结果过拟合,使用皮尔逊相关系数筛选出相关系数在0.8~1之间的特征矩阵列。在支持向量机等分类器上验证改进前后的算法,并使用正确率、精确率、召回率和F1评分这四个指标对模型进行评估。与改进前算法相比,改进后算法在支持向量机上的分类正确率分别提升3.8%,0.4%,0.3%,1.6%,5.1%和4.2%。分类结果说明医学生和非医学生在医学图片学习再认阶段存在明显差异,新加入扩展对称局部图结构和复合局部图结构比原算法中垂直对称局部图结构和对称局部图结构具有更好的分类性能。 展开更多
关键词 脑电 再认记忆 集成局部图结构 特征提取
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基于灰度图谱分析的IP软核硬件木马检测方法
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作者 倪林 刘子辉 +2 位作者 张帅 韩久江 鲜明 《计算机工程》 CAS CSCD 北大核心 2024年第3期44-51,共8页
随着芯片设计、制造、封装等流程的分工细化,利用第三方知识产权(IP)软核进行二次开发可以明显提升设计效率,减少重复工作。但是大量非自主可控IP软核被用于加速设计时,可能导致芯片在设计阶段被植入硬件木马,使得芯片安全性难以保证。... 随着芯片设计、制造、封装等流程的分工细化,利用第三方知识产权(IP)软核进行二次开发可以明显提升设计效率,减少重复工作。但是大量非自主可控IP软核被用于加速设计时,可能导致芯片在设计阶段被植入硬件木马,使得芯片安全性难以保证。当前IP软核安全检测方法主要依赖功能测试、代码覆盖率和翻转率分析,或在语义层面进行关键字匹配,且无法对加密IP软核进行检测。在分析硬件木马结构及其在IP软核中实现特征的基础上,利用非可控IP软核与“Golden”IP软核中寄存器传输级(RTL)代码灰度图谱的特征差异,基于Trust-Hub构建“Golden”软核集,提出基于灰度图谱特征的IP软核硬件木马检测模型和算法。以功能篡改型IP软核B19-T100为实验对象,通过调整合适的成像矩阵参数,利用分块匹配对比方式实现硬件木马检测,结果表明,该算法的检测精度达97.18%。在对B19、B15、S38417等5类共18个样本进行测试时,所提算法的平均检测精度达92%以上,表明其可实现对硬件木马的有效识别,检测精度和适用性较强。 展开更多
关键词 知识产权软核 硬件木马 灰度图谱 芯片安全 特征差异
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