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基于国产DSP和FPGA的高速信号处理板硬件电路设计 被引量：2
1
作者 孙艳萍 边晨通 +1 位作者 屈文涛 宋淑军 《仪表技术与传感器》 北大核心 2025年第5期33-38,共6页
针对目前高速信号处理板多选用国外芯片,国产化程度较低的问题,文中基于DSP和FPGA芯片完成了高速信号处理板国产化设计。首先考虑高速信号处理板应用于人工智能、图像处理等领域,是一种高精度和复杂运算的场景,因此选择DSP芯片FTDOC35BB... 针对目前高速信号处理板多选用国外芯片,国产化程度较低的问题,文中基于DSP和FPGA芯片完成了高速信号处理板国产化设计。首先考虑高速信号处理板应用于人工智能、图像处理等领域,是一种高精度和复杂运算的场景,因此选择DSP芯片FTDOC35BB_FT_M6678为主设计信号处理模块,选择FPGA芯片FMQL45T900为主设计控制单元模块;然后在CANDENCE软件中进一步采用分布式设计硬件电路,完成了高速信号接口模块、DDR3存储模块、EMIF模块的电路设计;最后使用CCS5.5集成开发环境对高速信号处理板各个接口及外设进行了测试。测试指标均达到要求,证明该高速信号处理板国产化设计切实可行,加速了高速信号处理板的国产化进程。 展开更多
关键词 国产化 FPGA DSP 高速信号
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一种用于高性能FPGA的多功能I/O电路
2
作者 罗旸 刘波 +3 位作者 曹正州 谢达 张艳飞 单悦尔 《半导体技术》 北大核心 2025年第3期265-272,共8页
为了满足等效系统门数为亿门级现场可编程门阵列(FPGA)的高速率、多功能数据传输需求,设计了一种用于高性能FPGA的多功能输入输出(I/O)电路,工作电压为0.95 V,单个I/O电路的最高数据传输速率为2 Gbit/s。通过在输入逻辑电路中设计同一... 为了满足等效系统门数为亿门级现场可编程门阵列(FPGA)的高速率、多功能数据传输需求,设计了一种用于高性能FPGA的多功能输入输出(I/O)电路,工作电压为0.95 V,单个I/O电路的最高数据传输速率为2 Gbit/s。通过在输入逻辑电路中设计同一边沿流水技术的双倍数据速率(DDR)电路,可以使数据不仅能在相同的时钟沿输出,而且能在同一个时钟周期输出。通过分级采样结合时钟分频和偏移技术,仅需4个时钟周期即可完成8∶1数据的转换。另外,该I/O电路还可以对数据输入输出的延时进行调节,采用粗调和细调相结合的方式,共提供512个延时抽头,并且延时的分辨率达到4 ps。仿真和实测结果表明,该多功能I/O电路能为高性能FPGA提供灵活、多协议的高速数据传输功能。 展开更多
关键词 现场可编程门阵列(FPGA) 输入输出(I/O)电路 多电平标准 双倍数据速率(DDR) 串并转换器(SerDes)
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一种基于相位调制的低损耗1-bit透射型智能超表面设计
3
作者 程强 李苗 +4 位作者 吴利杰 刘硕 张雁茗 戴俊彦 崔铁军 《东南大学学报(自然科学版)》 北大核心 2025年第4期1182-1188,共7页
针对透射型智能超表面(RIS)在6G通信中面临的高损耗与相位调控受限问题,设计了一种低损耗、宽频带1‐bit透射型RIS,以突破现有技术中透射效率低与带宽窄的瓶颈。提出基于双PIN二极管协同调控的相位调制单元,采用H形金属贴片与抑制电磁... 针对透射型智能超表面(RIS)在6G通信中面临的高损耗与相位调控受限问题,设计了一种低损耗、宽频带1‐bit透射型RIS,以突破现有技术中透射效率低与带宽窄的瓶颈。提出基于双PIN二极管协同调控的相位调制单元,采用H形金属贴片与抑制电磁耦合的直流馈电结构,集成2个PIN二极管(MADP‐000907‐14020)构建双向导通机制,实现180°相位反转,并基于此设计10×10的超表面阵列。仿真结果表明,该超表面单元在6.00~7.23 GHz的范围内透射系数大于-3 dB,6.6 GHz处透射系数高达-0.58 dB,反射系数为-20.74 dB,实现了透射低损耗设计。测试结果表明,该超表面阵列具有波束聚焦功能,且同时可以实现0°~30°的波束扫描。在6.6 GHz实现波束聚焦增益9.14 dBi,较馈源天线提升约1 dB,3 dB波束宽度收窄至10°,角度偏差小于3°。通过双PIN调控架构与阻抗匹配优化,在透射损耗(-0.58 dB)、工作带宽(18.59%)及波束精度(偏差小于3°)方面均优于同类研究,为6G高能效中继与室内分布系统提供了硬件支撑。 展开更多
关键词 低损耗 1‐bit 透射超表面 波束聚焦 波束扫描
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基于时延估计与终端滑模的无人船跟踪控制
4
作者 刘超 叶华生 +2 位作者 沈跃 刘慧 沈亚运 《电子测量技术》 北大核心 2025年第4期91-100,共10页
针对欠驱动无人船动力学模型参数获取困难、跟踪控制易受水流及自然风等干扰的问题,本文提出了一种基于自适应时延估计与超螺旋快速终端滑模的轨迹跟踪控制方法。首先通过手部位置点坐标变换方法,对欠驱动无人船数学模型进行状态扩展重... 针对欠驱动无人船动力学模型参数获取困难、跟踪控制易受水流及自然风等干扰的问题,本文提出了一种基于自适应时延估计与超螺旋快速终端滑模的轨迹跟踪控制方法。首先通过手部位置点坐标变换方法,对欠驱动无人船数学模型进行状态扩展重新构建;然后采用自适应时延估计技术,估计无人船未知动力学模型部分及外部扰动,并设计超螺旋快速终端滑模控制策略补偿时延估计产生的误差,提高控制系统鲁棒性;最后,基于仿真分析与航行跟踪实验验证本研究控制方法可行性。在航行跟踪实验中,位置平均误差相比于PID算法、滑模算法及自适应时延估计滑模算法分别降低了35.1%、24.7%、20.8%,轨迹跟踪精度高。本文提出的控制方法不依赖动力学模型参数,可实现欠驱动无人船精准轨迹跟踪控制,且收敛速度快、鲁棒性高,为欠驱动无人船轨迹跟踪控制提供了可供借鉴的方法。 展开更多
关键词 欠驱动无人船 自适应时延估计 超螺旋快速终端滑模控制 轨迹跟踪控制
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高性能YOLOv3-tiny嵌入式硬件加速器的混合优化设计
5
作者 谭会生 肖鑫凯 卿翔 《半导体技术》 CAS 北大核心 2025年第1期55-63,共9页
为解决在嵌入式设备中部署神经网络受算法复杂度、执行速度和硬件资源约束的问题,基于Zynq异构平台,设计了一个高性能的YOLOv3-tiny网络硬件加速器。在算法优化方面,将卷积层和批归一化层融合,使用8 bit量化算法,简化了算法流程;在加速... 为解决在嵌入式设备中部署神经网络受算法复杂度、执行速度和硬件资源约束的问题,基于Zynq异构平台,设计了一个高性能的YOLOv3-tiny网络硬件加速器。在算法优化方面,将卷积层和批归一化层融合,使用8 bit量化算法,简化了算法流程;在加速器架构设计方面,设计了可动态配置的层间流水线和高效的数据传输方案,缩短了推理时间,减小了存储资源消耗;在网络前向推理方面,针对卷积计算,基于循环展开策略,设计了8通道并行流水的卷积模块;针对池化计算,采用分步计算策略实现对连续数据流的高效处理;针对上采样计算,提出了基于数据复制的2倍上采样方法。实验结果表明,前向推理时间为232 ms,功耗仅为2.29 W,系统工作频率为200 MHz,达到了23.97 GOPS的实际算力。 展开更多
关键词 YOLOv3-tiny网络 异构平台 硬件加速器 动态配置架构 硬件混合优化 数据复制上采样
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基于Multisim软件的受控电源仿真实验
6
作者 颜世玉 于清文 +1 位作者 刘冲 赵海滨 《电脑与信息技术》 2025年第4期118-121,共4页
电源可分为独立电源和受控电源。受控电源又分为受控电压源和受控电流源,其电压或电流受其他部分的电压或电流的控制。结合“电路与电子”课程中的内容,对独立电源和受控电源进行比较分析,给出了4种受控电源的仿真电路实例。采用叠加原... 电源可分为独立电源和受控电源。受控电源又分为受控电压源和受控电流源,其电压或电流受其他部分的电压或电流的控制。结合“电路与电子”课程中的内容,对独立电源和受控电源进行比较分析,给出了4种受控电源的仿真电路实例。采用叠加原理对含有受控电源的电路进行分析,并采用Multisim软件进行电路仿真,旨在为受控电源的学习和理解提供帮助。 展开更多
关键词 MULTISIM软件 受控电源 电路分析 电路教学
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“光储柔直系统”创新实验项目设计与实践
7
作者 印月 冷敏瑞 +1 位作者 徐航 周群 《实验科学与技术》 2025年第3期45-50,共6页
为推动科研成果和技术创新反哺人才培养,将光储柔直系统设计与控制领域的产业难题及已取得的科研成果引入实验教学,经过有机重构与设计,将其转化为与实验知识点相关的教学资源。设计“光储柔直系统”创新实验项目,促使本科生从电力系统... 为推动科研成果和技术创新反哺人才培养,将光储柔直系统设计与控制领域的产业难题及已取得的科研成果引入实验教学,经过有机重构与设计,将其转化为与实验知识点相关的教学资源。设计“光储柔直系统”创新实验项目,促使本科生从电力系统源侧变换器角度切入,了解新能源系统,加深对光伏接口直流-直流(DC-DC)转换器设计、储能变换器设计等前沿开关电源设计问题以及新能源控制等前沿知识的理解,拓宽学生对实际生产过程中的工程技术难题的认知。采用模块化硬件拓扑结构和控制构架开展实验教学,引导学生进行科学探索和知识拓展。同时,为学生专业知识的综合运用和解决复杂实际工程问题提供了一个功能多样、设计灵活的实验平台。 展开更多
关键词 光伏发电 储能 电子技术实验 教学模式
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基于三维混沌系统的图像加密及FPGA实现
8
作者 闫少辉 姜嘉伟 崔宇 《计算机工程与科学》 北大核心 2025年第4期686-694,共9页
提出一种基于FPGA的混沌系统实现方法,并成功将其应用在图像加密任务。基于改进的Bao混沌系统,利用改进的欧拉算法对混沌系统进行离散化,使用Verilog语言进行硬件设计;通过寄存器传输级RTL电路及ModelSim时序仿真验证混沌系统在软件设... 提出一种基于FPGA的混沌系统实现方法,并成功将其应用在图像加密任务。基于改进的Bao混沌系统,利用改进的欧拉算法对混沌系统进行离散化,使用Verilog语言进行硬件设计;通过寄存器传输级RTL电路及ModelSim时序仿真验证混沌系统在软件设计层面的准确性。利用离散化的混沌序列在FPGA中对图像进行加密和相应密钥的解密,并通过VGA正确显示,验证了加密方案的可行性。在硬件层面成功实现混沌系统及图像加解密,为混沌加密技术在FPGA中的进一步应用奠定了基础。 展开更多
关键词 混沌系统 FPGA实现 Verilog设计 图像加密
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基于74LS161的计数显示电路实验设计
9
作者 张晖 翟艳男 宋暖 《电子制作》 2025年第14期74-77,共4页
基于74LS161的计数显示电路实验以时钟脉冲模块、计数模块和译码显示模块为核心,将数字电路中的典型知识点综合运用,不仅可以培养学生理论联系实际的能力,更可以培养较强的动手能力以及分析问题、解决问题的能力,结合常用传感器,还可以... 基于74LS161的计数显示电路实验以时钟脉冲模块、计数模块和译码显示模块为核心,将数字电路中的典型知识点综合运用,不仅可以培养学生理论联系实际的能力,更可以培养较强的动手能力以及分析问题、解决问题的能力,结合常用传感器,还可以设计出很多实用的电路。 展开更多
关键词 74LS161 计数显示 创新能力
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基于数字电路的数字秒表的设计与仿真
10
作者 蔡晓艳 宋伟中 +1 位作者 肜瑶 张欣语 《黄河科技学院学报》 2025年第5期64-71,共8页
用数字电路实现了用于短时间测量的数字秒表设计,设计了清零、计时、停止3种循环工作,并对数字秒表的整体系统及各模块电路进行了详细的描述,同时运用Multisim软件进行仿真,仿真结果符合设计要求。该数字秒表的设计电路简单、计时精度... 用数字电路实现了用于短时间测量的数字秒表设计,设计了清零、计时、停止3种循环工作,并对数字秒表的整体系统及各模块电路进行了详细的描述,同时运用Multisim软件进行仿真,仿真结果符合设计要求。该数字秒表的设计电路简单、计时精度高、稳定性好,具有一定的应用价值。 展开更多
关键词 数字电路 MULTISIM 数字秒表 项目驱动法
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现场可编程门阵列标准体系现状及建设思路探析
11
作者 罗晓羽 《信息技术与标准化》 2025年第8期63-66,共4页
为推进现场可编程门阵列(FPGA)产业高质量发展,加强标准供给,梳理FPGA国外相关标准及我国标准体系现状,分析标准体系在支撑FPGA产业链建设及产品质量保证方面存在的问题与不足,提出标准体系建设主要思路及措施建议,为优化完善标准体系... 为推进现场可编程门阵列(FPGA)产业高质量发展,加强标准供给,梳理FPGA国外相关标准及我国标准体系现状,分析标准体系在支撑FPGA产业链建设及产品质量保证方面存在的问题与不足,提出标准体系建设主要思路及措施建议,为优化完善标准体系提供参考。 展开更多
关键词 现场可编程门阵列 标准体系 建设思路
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基于Modbus UDP协议与FPGA的多设备测控系统 被引量：1
12
作者 黄战华 胡朝政 +1 位作者 王康年 龙子洋 《仪表技术与传感器》 北大核心 2025年第1期56-60,84,共6页
为了满足多设备测控系统日益增长的数据吞吐率和系统高集成度、高灵活性的要求,设计了一套基于Modbus UDP协议与FPGA的系统。系统包含上位机、下位机2个子系统,通过Modbus UDP协议通讯。下位机子系统以FPGA为核心,总线架构和模块化的程... 为了满足多设备测控系统日益增长的数据吞吐率和系统高集成度、高灵活性的要求,设计了一套基于Modbus UDP协议与FPGA的系统。系统包含上位机、下位机2个子系统,通过Modbus UDP协议通讯。下位机子系统以FPGA为核心,总线架构和模块化的程序设计保证系统升级灵活性和通讯可靠性;上位机子系统软件基于PC平台,集成自动化测控功能,对采集数据进行建模展示和数据管理。实验结果表明系统通信稳定可靠。系统具有集成度高、维护便利、易升级且通信速率高的特点,为多设备测控系统提供了一套可行的解决方案。 展开更多
关键词 FPGA Modbus UDP协议 测控系统 多设备控制
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基于不同总线协议的DMA控制器研究进展 被引量：1
13
作者 任小龙 杨延飞 +4 位作者 王立涵 严登辉 张浩 李飞飞 李连碧 《半导体技术》 北大核心 2025年第2期117-126,共10页
随着计算机技术的飞速发展,对大规模数据传输和处理效率的要求越来越高。直接存取存储(DMA)控制允许设备和存储器之间直接进行高速数据传输,有效提升了数据传输效率,因而得到广泛的研究。综述了基于不同总线架构的DMA控制器的研究进展... 随着计算机技术的飞速发展,对大规模数据传输和处理效率的要求越来越高。直接存取存储(DMA)控制允许设备和存储器之间直接进行高速数据传输,有效提升了数据传输效率,因而得到广泛的研究。综述了基于不同总线架构的DMA控制器的研究进展。首先,在分析传统中央处理器(CPU)传输数据局限性的基础上,阐述了DMA控制器与总线结合的重要性。其次,重点探讨了基于高级微控制器总线架构(AMBA)和高速外设部件互连标准(PCIe)两种常用总线协议的DMA控制器的研究进展,从频率、传输速率、功耗等方面进行性能比较和分析总结,并在此基础上展望了未来基于这两种总线协议的DMA技术的发展方向。最后,介绍了基于其他总线协议的DMA控制器的研究进展,在分析其性能优势的基础上为新型DMA控制器设计提供新思路。 展开更多
关键词 直接存取存储(DMA)控制器 高级微控制器总线架构(AMBA) 高级高性能总线(AHB) 高级可拓展接口(AXI)总线 高速外设部件互连标准(PCIe)总线 CoreConnect总线 片内总线(ICB)
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一种前后台结合的Pipelined ADC校准技术
14
作者 薛颜 徐文荣 +2 位作者 于宗光 李琨 李加燊 《半导体技术》 CAS 北大核心 2025年第1期46-54,共9页
针对Pipelined模数转换器(ADC)中采样电容失配和运放增益误差带来的非线性问题,提出了一种前后台结合的Pipelined ADC校准技术。前台校准技术通过对ADC量化结果的余量分析,补偿相应流水级的量化结果,后台校准技术基于伪随机(PN)注入的方... 针对Pipelined模数转换器(ADC)中采样电容失配和运放增益误差带来的非线性问题,提出了一种前后台结合的Pipelined ADC校准技术。前台校准技术通过对ADC量化结果的余量分析,补偿相应流水级的量化结果,后台校准技术基于伪随机(PN)注入的方式,利用PN的统计特性校准增益误差。本校准技术在系统级建模和RTL级电路设计的基础上,实现了现场可编程门阵列(FPGA)验证并成功流片。测试结果显示,在1 GS/s采样速率下,校准精度为14 bit的Pipelined ADC的有效位数从9.30 bit提高到9.99 bit,信噪比提高约4 dB,无杂散动态范围提高9.5 dB,积分非线性(INL)降低约10 LSB。 展开更多
关键词 Pipelined模数转换器(ADC) 电容失配 增益误差 前台校准 后台校准
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一种使用ECO方式快速制作故障定位版本的方法 被引量：1
15
作者 章伟 王红展 《现代信息科技》 2025年第10期97-101,共5页
在FPGA工程应用中,偶尔会遇到一些疑难故障,自带维测手段无法定位,需要做在线采数版本。采用原始手段加Debug线跑版本会改变已有的布局布线,耗费时间较长,而且有可能导致故障消失。文章介绍了一种使用ECO快速制作故障定位版本的方法,即... 在FPGA工程应用中,偶尔会遇到一些疑难故障,自带维测手段无法定位,需要做在线采数版本。采用原始手段加Debug线跑版本会改变已有的布局布线,耗费时间较长,而且有可能导致故障消失。文章介绍了一种使用ECO快速制作故障定位版本的方法,即在不改变工程原有布局布线的基础上,把运行异常的信号拉到测试引脚,采用示波器进行辅助定位的方法。此方法可作为问题定位的一种快捷有效的手段,在实际工程应用场景中展现出良好的灵活性,相对于传统制作在线采数版本而言具有节省跑版本时间、不改变原有工程布局布线等优点。 展开更多
关键词 FPGA ECO 故障定位
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基于FPGA的功率器件封装缺陷实时检测
16
作者 谭会生 吴文志 张杰 《半导体技术》 北大核心 2025年第10期1048-1056,共9页
针对基于机器视觉的功率器件封装缺陷检测技术实时性差、计算资源消耗较高的问题,基于现场可编程门阵列(FPGA)设计了一种功率器件封装缺陷实时检测器。首先,提出一种基于深度可分离卷积(DSConv)的轻量化Mini-DSCNet卷积网络,使用深度卷... 针对基于机器视觉的功率器件封装缺陷检测技术实时性差、计算资源消耗较高的问题,基于现场可编程门阵列(FPGA)设计了一种功率器件封装缺陷实时检测器。首先,提出一种基于深度可分离卷积(DSConv)的轻量化Mini-DSCNet卷积网络,使用深度卷积和逐点卷积代替标准卷积。仿真结果表明,该模型的浮点运算量(FLOPs)和参数量(Params)分别约为MobileNetV1的4.375%和0.021%,准确率约为91.80%。其次,采用定点量化算法将浮点数权重量化为有符号定点数,测试结果表明,其平均误差约为0.483%。最后,采用多通道并行流水线架构优化设计,降低了系统的资源消耗,提高了系统的处理速度。实验结果显示,在100 MHz时钟频率下,该检测器的推理速度分别约为CPU的17.10倍、GPU的2.47倍,显著提升了功率器件封装缺陷检测的实时性。 展开更多
关键词 功率器件 封装缺陷检测 Mini-DSCNet卷积网络 现场可编程门阵列(FPGA) 硬件加速
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基于ZYNQ平台非制冷红外视频采集系统的设计
17
作者 郜峰 陈畅 +4 位作者 杨晓鹏 贾俊杰 杨云鹏 李奇峰 马翔云 《电子测量与仪器学报》 北大核心 2025年第7期45-53,共9页
针对非制冷红外相机图像存在背景噪声大、对比度低以及基于个人计算机的视频采集系统便携性差等问题,提出了一种基于ZYNQ全可编程片上系统平台的红外视频采集系统。该系统通过集成直方图均衡、核范数最小化以及一维引导滤波等多种图像... 针对非制冷红外相机图像存在背景噪声大、对比度低以及基于个人计算机的视频采集系统便携性差等问题,提出了一种基于ZYNQ全可编程片上系统平台的红外视频采集系统。该系统通过集成直方图均衡、核范数最小化以及一维引导滤波等多种图像处理算法,在提升图像对比度的同时有效抑制噪声。为了加快处理速度,系统采用直方图伪均衡方法优化直方图均衡的计算效率,并针对核范数最小化和一维引导滤波设计了高效的滤波模块架构,实现了两种滤波方法的高速并行处理。实验结果表明,所提出的红外视频采集系统能够将图像的粗糙度、均方根对比度和信息熵分别提升至原始图像的17.4、3.15和2.16倍,显著改善了红外图像的视觉效果和细节表现。基于ZYNQ平台的设计不仅具有高度集成化的特点,还具备较快的处理速度,能够满足实时处理的需求。与传统的PC平台相比,该系统在便携性、功耗和成本方面具有显著优势,为红外视频采集技术的实际应用提供了一种高效、可靠的解决方案。 展开更多
关键词 红外图像处理 ZYNQ 核范数最小化 一维引导滤波
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基于天通卫星的语音加密通信技术研究
18
作者 王松 张芳 +2 位作者 房利国 韩炼冰 刘鸿博 《信息安全与通信保密》 2025年第6期54-61,共8页
随着天通卫星移动通信的发展,越来越多的天通终端被广泛应用。由于天通系统采用开放的无线信道进行信息传输,其通信安全性成为一个亟待解决的问题。目前,基于天通系统的语音通信是应用最为广泛的一种天通业务,但其传输延迟长、通信速率... 随着天通卫星移动通信的发展,越来越多的天通终端被广泛应用。由于天通系统采用开放的无线信道进行信息传输,其通信安全性成为一个亟待解决的问题。目前,基于天通系统的语音通信是应用最为广泛的一种天通业务,但其传输延迟长、通信速率低、误码率高。基于此,通过对呼叫建立流程、信道误码和滑码等方面的研究,提出了实现天通语音加密通信的方法。实际测试结果表明,提出的方法可有效适应天通系统的语音通信特点,解决天通语音安全通信的问题,有较高的推广应用价值。 展开更多
关键词 天通系统 语音加密 天通语音 加密通信
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数模变换量化误差固有特性再讨论
19
作者 陆祖良 杨雁 张钟华 《计测技术》 2025年第5期1-9,共9页
为了在数模转换中准确实现预设相角,一般采用增加转换分辨力的方法,这实质上是在幅值轴方向上进行精细分割以接近原始信号,存在成本高、速度慢、功耗大等不足。针对上述问题,进一步提出在时间轴方向上进行适当分割的方法。为此论述量化... 为了在数模转换中准确实现预设相角,一般采用增加转换分辨力的方法,这实质上是在幅值轴方向上进行精细分割以接近原始信号,存在成本高、速度慢、功耗大等不足。针对上述问题,进一步提出在时间轴方向上进行适当分割的方法。为此论述量化误差包括相角量化误差和幅值量化误差的定义,阐述所研究的量化过程应满足的4个一般性条件,分析量化误差随相角变化而变化的固有特性,并开展模拟实验和真实实验进行验证,结果表明:量化误差呈现周期性分布,误差周期是信号周期的1/N(N为一个信号周期内的采样个数);在误差周期内,量化误差的分布是对称的;相角量化误差的零点具有独立性,这些零点与转换分辨力、信号幅值无关。指出调节N值使这些零点与预设相角相联系具有重要应用价值,有望推动相角标准研制和阻抗电桥技术发展,并扩展高速、低功耗、低成本数模转换器的应用。 展开更多
关键词 量化误差 相角 幅值 数模转换 周期性 对称性 独立性 零点应用
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一种被动传输剩余电压的高速SAR ADC
20
作者 李新 王扬 杨森林 《电子元件与材料》 北大核心 2025年第3期278-284,共7页
针对传统二步式逐次逼近型模数转换器(SAR ADC)的余量放大器引起的带宽和失配问题,提出了一种8bit_450MSPs的高速SAR ADC,利用基于被动传输剩余电压的二步式SAR ADC架构。第一级模数转换器(ADC)在信号的粗转换过程中直接无衰减地向第二... 针对传统二步式逐次逼近型模数转换器(SAR ADC)的余量放大器引起的带宽和失配问题,提出了一种8bit_450MSPs的高速SAR ADC,利用基于被动传输剩余电压的二步式SAR ADC架构。第一级模数转换器(ADC)在信号的粗转换过程中直接无衰减地向第二级ADC传输余量信号,避免了余量放大器的使用。节省了传统二步式结构放大剩余量信号造成的时间和功耗的浪费,解决了余量放大器失配造成的带宽失配等问题。利用两个第二级子ADC乒乓工作保证了信号转换过程的连续性。子ADC使用电容分裂式电容整列数模转换器(CDAC)和多比较器结构,进一步提高了转换速率。基于40nm BCD工艺,在1.1V电源电压下实现了450MSPs的采样率、51.8dB的信噪比(SNR)、46.5dB的信噪失真比(SNDR)、59.8dB的无杂散动态范围(SFDR),芯片整体功耗为2.44mW。 展开更多
关键词 逐次逼近型模数转换器 二步式ADC 剩余电压 电容分裂CDAC 动态比较器
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