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Qt协调国产FPGA的逻辑层动态调度图像系统
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作者 谢家兴 李东峻 +3 位作者 周欣红 莫汉东 罗洋 刘洪山 《电子测量技术》 北大核心 2026年第1期207-215,共9页
针对图像处理系统灵活性不足与智能化水平待提升的问题,本研究致力于克服国产FPGA动态重构领域存在的技术瓶颈,提出了一个逻辑层动态调度图像系统。该系统基于上海安路科技公司PH1A90 FPGA芯片与Qt框架进行开发,基于逻辑层动态调度原理... 针对图像处理系统灵活性不足与智能化水平待提升的问题,本研究致力于克服国产FPGA动态重构领域存在的技术瓶颈,提出了一个逻辑层动态调度图像系统。该系统基于上海安路科技公司PH1A90 FPGA芯片与Qt框架进行开发,基于逻辑层动态调度原理通过智能上位机控制模块可实现近似于DPR的全链路动态调度行为。实验结果表明,本研究实现了Qt上位机与PH1A90 FPGA的软硬件协同,完成了四接口异构输入、双传感器协同成像、算法处理链配置与22种ISP动态处理算法,并通过HDMI输出1080P@60 fps视频流,验证了接口、流程以及算法上的逻辑层动态调度能力与国产芯片的工业级可靠性,推动我国智能安防、工业检测等领域的自主可控进程。 展开更多
关键词 现场可编程门阵列 Qt框架 图像处理技术 逻辑层动态调度 软硬件协同 人机交互
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面向解决复杂工程问题能力培养的数字电子技术课程教学改革
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作者 任玲 聂晶 +1 位作者 李宏伟 吴延祥 《中国教育技术装备》 2026年第3期92-96,100,共6页
针对数字电子技术课程教学中存在的问题,对理论教学、课程实验教学和课外实践教学环节进行教学改革,以培养学生解决复杂工程问题能力。在理论教学环节,重构教学内容,设定“两性一度”教学目标,提出“4+2”多元化教学内容框架,构建“问题... 针对数字电子技术课程教学中存在的问题,对理论教学、课程实验教学和课外实践教学环节进行教学改革,以培养学生解决复杂工程问题能力。在理论教学环节,重构教学内容,设定“两性一度”教学目标,提出“4+2”多元化教学内容框架,构建“问题+实践+探究”教学模式,建立“线上+线下”教学组织形式;在课程实验教学环节,设置分层实验内容,采用虚实结合的实验模式;在课外实践教学环节,开展综合实践、学科竞赛、维修活动等。实践表明,这一课程教学改革取得了显著成效。 展开更多
关键词 数字电子技术课程 解决复杂工程问题能力 教学改革
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一种应用于时间交织模数转换器的低偏移分级交织器
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作者 何鹏军 林敏 田金鹏 《工业控制计算机》 2026年第2期11-13,共3页
基于时间交织(Time-Interleaved,TI)的超高速模数转换器(Analog-to-Digital Converter,ADC)是现代有线数据接收机和下一代无线射频接收机的重要组成部分。提出了一种适用于TI-ADC的低偏移(Low Skew)分级交织器(Hierarchy Interleaver),... 基于时间交织(Time-Interleaved,TI)的超高速模数转换器(Analog-to-Digital Converter,ADC)是现代有线数据接收机和下一代无线射频接收机的重要组成部分。提出了一种适用于TI-ADC的低偏移(Low Skew)分级交织器(Hierarchy Interleaver),该交织器通过采用非缓冲的分级解复用(No-Buffer-Hierarchy DeMUX)技术显著降低了时间偏移校准的复杂度,并增强了线性度。使用了低偏移的时钟生成技术,进一步降低了交织器的时间偏移。仿真结果表明,在2 GS/s的运行速率下,所提出的交织器在奈奎斯特输入频率下的有效位数(Effective Number Of Bits,ENOB)为10.11 bit,无杂散动态范围(Spurious free Dynamic Range,SFDR)为55.86 dB。在40 nm CMOS工艺中,总功耗为633μW。 展开更多
关键词 时间交织模数转换器 分级解复用 交织器 时间偏移
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多通道低延时前向纠错系统的FPGA实现
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作者 杨晨 董航 《网络新媒体技术》 2026年第1期66-74,共9页
在光网络处理速率需求持续提升与多通道混合型业务场景广泛应用的背景下,为解决光网络多通道输入数据前向纠错(FEC)处理场景中存在的数据拥塞和资源冗余问题,本文面向硬件架构优化,提出一种基于Reed-Solomon码结构特点的多层次架构。该... 在光网络处理速率需求持续提升与多通道混合型业务场景广泛应用的背景下,为解决光网络多通道输入数据前向纠错(FEC)处理场景中存在的数据拥塞和资源冗余问题,本文面向硬件架构优化,提出一种基于Reed-Solomon码结构特点的多层次架构。该架构整合高速轮询调度算法、多通道少量中间变量独立动态缓存机制与RiBM算法结构流水化,实现动态资源分配与模块高效复用,构建编译码全链路优化的低延时前向纠错系统。通过现场可编程逻辑门阵列(FPGA)的仿真综合验证表明,在16通道混合业务数据并行传输条件下,系统的FEC处理延时<0.864μs,较传统单通道编解码复用处理架构实现50%的时延压缩,同时逻辑资源消耗较全独立链路编译码方案减少90%,显著提高前向纠错处理效率。 展开更多
关键词 REED-SOLOMON码 数据拥塞 资源冗余 RiBM算法 轮询调度 独立动态缓存机制 编译码 现场可编程逻辑门阵列
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亚阈值标准单元设计及验证
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作者 闫珍珍 蔡铭嫣 +4 位作者 赵雯 马全刚 卜建辉 李博 刘海南 《半导体技术》 北大核心 2026年第2期144-156,共13页
亚阈值电压因其能降低电路功耗而在低功耗芯片领域得到了广泛关注。针对22 nm工艺标准单元库,进行亚阈值电压下的新型电路设计及验证。首先对亚阈值电压下标准单元关键电路结构参数进行识别提取,包括识别亚阈值单元二级效应、确定最优... 亚阈值电压因其能降低电路功耗而在低功耗芯片领域得到了广泛关注。针对22 nm工艺标准单元库,进行亚阈值电压下的新型电路设计及验证。首先对亚阈值电压下标准单元关键电路结构参数进行识别提取,包括识别亚阈值单元二级效应、确定最优工作电压和对单元特征结构进行预分析等。在此基础上,基于最优尺寸设计、稳定性和延时分布评估设计新型亚阈值单元,提高电路稳定性并使单元延时趋于高斯分布。最后,通过3种验证电路对亚阈值标准单元的延时、噪声容限及分布曲线进行验证。仿真结果显示,与已有商用单元相比,新型亚阈值标准单元稳定性平均增加6.9%,延时分布的离散程度平均减小20.5%,分布的对称度接近50%,延时分布的非高斯特性得到了改善。 展开更多
关键词 亚阈值 标准单元 最优尺寸设计 单元延时分布 稳定性评价
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基于FPGA的高速信号完整性测试技术研究
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作者 乔磊 李子昱 刘一粟 《消费电子》 2026年第3期59-61,共3页
随着高速数字系统信号速率的不断提升,信号完整性测试成为保障系统可靠性的关键环节。针对传统测试仪器成本高及灵活性不足的局限性,文章利用现场可编程门阵列(Field Programmable Gate Array,FPGA)的并行处理与高速输入/输出优势构建... 随着高速数字系统信号速率的不断提升,信号完整性测试成为保障系统可靠性的关键环节。针对传统测试仪器成本高及灵活性不足的局限性,文章利用现场可编程门阵列(Field Programmable Gate Array,FPGA)的并行处理与高速输入/输出优势构建一种高实时性、可定制的信号完整性测试平台,通过设计基于FPGA的高速采集架构并集成实时眼图生成、抖动分析和时域反射检测算法,实现对高速信号多维度参数提取与处理。测试结果表明,该系统能有效完成对关键信号完整性指标的精确测量,为高速数字系统的设计与验证提供低成本、高集成度的解决方案。 展开更多
关键词 信号完整性 FPGA 高速采集 眼图 时域反射
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低功耗忆阻器仿真器设计及在自动售卖系统中的状态压缩优化
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作者 刘伯旺 郭凯鑫 +1 位作者 李晴 邓朝勇 《贵州科学》 2026年第1期82-87,91,共7页
为解决传统模拟电路模型在灵活性及可重构性方面不足的问题,提出一种基于VHDL的二值阈值型忆阻器仿真器设计方案,并探讨了其在自动售卖机系统中的应用价值。该设计采用VHSIC硬件描述语言构建可配置参数模型,通过Altera QuartusⅡ开发环... 为解决传统模拟电路模型在灵活性及可重构性方面不足的问题,提出一种基于VHDL的二值阈值型忆阻器仿真器设计方案,并探讨了其在自动售卖机系统中的应用价值。该设计采用VHSIC硬件描述语言构建可配置参数模型,通过Altera QuartusⅡ开发环境进行逻辑综合与功能仿真,最终在EP2C5T144C8N系列FPGA开发板上完成了硬件验证。实验结果表明,该仿真器仅消耗242个逻辑单元和16个寄存器资源,相比同类设计降低了约92.59%的硬件资源占用。在自动售卖机系统中,基于忆阻器特性的状态存储单元设计,简化了传统状态机的状态节点,降低了状态转换条件的复杂度。验证结果证明,该仿真器具有良好的参数可调性和平台兼容性,为大规模忆阻器阵列研究提供了低资源消耗的验证平台,并在嵌入式系统和物联网设备领域展现了广阔的应用前景。研究证实,基于硬件描述语言的忆阻器建模方法在数字系统设计中具有显著优势,为新型存储计算一体化架构的开发提供了可行路径。 展开更多
关键词 忆阻器 状态存储 FPGA 售卖系统 VHDL
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基于FPGA和STM32的电网参数测量装置
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作者 刘钰琨 李琪 +1 位作者 吴娜娜 王杰铃 《电子设计工程》 2026年第1期76-80,共5页
为了保护电网的稳定可靠,对电网参数进行实时准确测量有着重要的现实意义。针对电网信号频率、幅值和谐波含量等主要参数的测量方法,以FPGA作为主处理器,STM32作为辅助处理器,设计在线测量电网参数的装置,优化各种参数测量的算法。实验... 为了保护电网的稳定可靠,对电网参数进行实时准确测量有着重要的现实意义。针对电网信号频率、幅值和谐波含量等主要参数的测量方法,以FPGA作为主处理器,STM32作为辅助处理器,设计在线测量电网参数的装置,优化各种参数测量的算法。实验表明,该装置能够实现对电网参数的有效测量,将测量数据与万用表和示波器的测量数据进行对比,误差小于5%,并且在实时性和稳定性等方面均表现出色。该装置能够满足电力系统对电网参数测量的要求。 展开更多
关键词 FPGA STM32 电网参数 参数测量 测量装置
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Prototype of front-end electronics based on FPGA-ADC for TOF PET detector applications
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作者 Song-Qing Liu Bo Wang +2 位作者 Wei-Wei Xu Xin-Sheng Wang Kun Hu 《Nuclear Science and Techniques》 2026年第2期134-142,共9页
Traditional digitizers for signal readout of PET detectors are based on commercial analog-to-digital converters(ADC).However,the cost and power consumption of an entire electronic readout system based on digitizers fo... Traditional digitizers for signal readout of PET detectors are based on commercial analog-to-digital converters(ADC).However,the cost and power consumption of an entire electronic readout system based on digitizers for a PET scanner are high.To address this problem,a soft-core ADC based on a field-programmable gate array(FPGA)was proposed.An FPGA-based ADC(FPGA-ADC)combines low loss and high performance.To achieve good performance,the FPGA-ADC requires three calibrations:time-to-digital converter(TDC)length calibration,TDC alignment calibration,and TDC-to-ADC calibration.A prototype front-end electronics based on FPGA-ADC was built to evaluate the performance of time-of-flight positron emission tomography(TOF PET)detectors.Each PET detector consists of a LYSO crystal single-ended coupled to a silicon photomultiplier(SiPM).The experimental results show that the full-width at half-maximum(FWHM)energy resolution for 511 keV gamma photons after saturation correction of the SiPM was 12.3%.The FWHM coincidence timing resolution(CTR)of the TOF PET detector with the readout of the front-end electronic prototype is 385.2 ps.FPGA-ADCbased front-end electronics are very promising for multichannel,low-cost,highly integrated,and power-efficient readout electronic systems for radiation detector applications. 展开更多
关键词 Front-end electronics Analog-to-digital converter Radiation detector PET FPGA
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基于FPGA直升机振动信号监测系统设计
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作者 王玉磊 龚强 +1 位作者 时富斌 赵雪悦 《集成电路与嵌入式系统》 2026年第1期20-25,共6页
直升机因优越的灵活性和机动性在军事、民用和民生领域得到广泛使用,并且在特定领域具有不可替代的地位。文中针对传统直升机故障检测虚警率高问题,基于EP4CE系列FPGA芯片利用12位8通道模/数转换芯片ADC128S022实现对直升机振动数据的... 直升机因优越的灵活性和机动性在军事、民用和民生领域得到广泛使用,并且在特定领域具有不可替代的地位。文中针对传统直升机故障检测虚警率高问题,基于EP4CE系列FPGA芯片利用12位8通道模/数转换芯片ADC128S022实现对直升机振动数据的实时采集,将采集数据进行快速傅里叶变换(Fast Fourier Transform,FFT)并提取特征值分析。实验结果表明,系统对直升机故障检测报警准确率高达99%以上。 展开更多
关键词 FPGA 振动数据 ADC FFT 故障检测
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基于FPGA的运动目标检测系统的设计与验证
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作者 郁梓安 《科技视界》 2026年第4期87-90,共4页
目前,汽车智能辅助驾驶、无人机、安防监控等领域对数据采集的要求越来越高。设计了一种使用毫米波雷达和激光雷达的运动目标检测系统,使用现场可编程门阵列(FPGA)搭建了精简指令集计算机V最小系统(下文简称RISC-V),协同2个雷达数据处理... 目前,汽车智能辅助驾驶、无人机、安防监控等领域对数据采集的要求越来越高。设计了一种使用毫米波雷达和激光雷达的运动目标检测系统,使用现场可编程门阵列(FPGA)搭建了精简指令集计算机V最小系统(下文简称RISC-V),协同2个雷达数据处理,得到目标运动的坐标和轨迹,并通过Python脚本使数据信息可视化。 展开更多
关键词 可编程门阵列(FPGA) 毫米波雷达 激光雷达 目标监测
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面向边缘计算的低功耗FPGA嵌入式图像识别加速架构研究
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作者 卢宏超 同航 王浩南 《电脑编程技巧与维护》 2026年第1期156-158,共3页
为提高边缘图像识别的低功耗水平、实时性与架构适配性,提出了面向边缘计算的低功耗FPGA嵌入式图像识别加速架构。该架构量化了建模边缘场景的图像识别任务特征,优化了硬件友好型算法。设计了异构计算单元、三级存储架构与动态功耗策略... 为提高边缘图像识别的低功耗水平、实时性与架构适配性,提出了面向边缘计算的低功耗FPGA嵌入式图像识别加速架构。该架构量化了建模边缘场景的图像识别任务特征,优化了硬件友好型算法。设计了异构计算单元、三级存储架构与动态功耗策略。实现了FPGA加速核与边缘嵌入式系统的深度协同。研究结果表明,该架构可有效平衡边缘场景的功耗约束与识别性能需求,为边缘端图像识别提供了高能效、高适配的加速方案。 展开更多
关键词 边缘计算 FPGA加速架构 图像识别 低功耗优化
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数字电子技术在通信网络管理系统中的应用
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作者 赵志强 司春波 +2 位作者 王力 张友涛 王英豪 《移动信息》 2026年第1期10-12,共3页
通信网络管理系统对实时状态感知、故障快速响应与控制精度提出了更高要求。数字电子技术具备信号采集快、逻辑控制强、系统集成度高等特点,适用于构建高效的管理控制机制。文中以链路状态采集、告警触发机制与控制指令下发为研究重点,... 通信网络管理系统对实时状态感知、故障快速响应与控制精度提出了更高要求。数字电子技术具备信号采集快、逻辑控制强、系统集成度高等特点,适用于构建高效的管理控制机制。文中以链路状态采集、告警触发机制与控制指令下发为研究重点,探讨了数字电路在通信管理系统中的嵌入方式与运行路径。实验结果表明,该技术显著提升了系统响应速度、故障定位准确率及控制执行稳定性。 展开更多
关键词 数字电子技术 通信网络管理 系统应用
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一种用于移动IoT的0.79~2.70μW高SNDR电平交叉噪声整形SAR ADC
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作者 牟峻萱 徐卫林 +2 位作者 莫培思 曾志伟 韦保林 《半导体技术》 北大核心 2026年第3期256-262,288,共8页
为解决传统电平交叉模数转换器(LC ADC)精度较低和噪声整形逐次逼近寄存器(NS SAR)ADC功耗较大的问题,提出了一种应用于移动物联网(IoT)随机稀疏信号采集的LC-NS SAR ADC。在NS SAR ADC前端插入8 bit的LC ADC作为输入信号活跃度的预检... 为解决传统电平交叉模数转换器(LC ADC)精度较低和噪声整形逐次逼近寄存器(NS SAR)ADC功耗较大的问题,提出了一种应用于移动物联网(IoT)随机稀疏信号采集的LC-NS SAR ADC。在NS SAR ADC前端插入8 bit的LC ADC作为输入信号活跃度的预检测电路,在电平交叉发生后开启NS SAR ADC的转换。二阶无源噪声整形电路积分过程只在事件触发后发生,从而能够根据输入信号的活跃度动态调节整体功耗。在1.8 V 180 nm CMOS工艺、采样率为40 kS/s、过采样率(OSR)为20、带宽为1 kHz下对该ADC进行仿真验证,结果表明信噪失真比(SNDR)达到87 dB,电路功耗为2.70μW,心电图信号输入时功耗仅为0.79μW,相较于传统等间隔奈奎斯特采样ADC,采样点减少了73%,在处理生物医学信号时实现了约5∶1的数据压缩比,Schreier品质因数(FoMs)和Walden品质因数(FoMw)分别为172.6 dB和67.0 fJ/conv.step。 展开更多
关键词 低功耗 电平交叉模数转换器(LC ADC) 事件驱动 物联网(IoT)应用 噪声整形
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基于国产DSP和FPGA的高速信号处理板硬件电路设计 被引量:2
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作者 孙艳萍 边晨通 +1 位作者 屈文涛 宋淑军 《仪表技术与传感器》 北大核心 2025年第5期33-38,共6页
针对目前高速信号处理板多选用国外芯片,国产化程度较低的问题,文中基于DSP和FPGA芯片完成了高速信号处理板国产化设计。首先考虑高速信号处理板应用于人工智能、图像处理等领域,是一种高精度和复杂运算的场景,因此选择DSP芯片FTDOC35BB... 针对目前高速信号处理板多选用国外芯片,国产化程度较低的问题,文中基于DSP和FPGA芯片完成了高速信号处理板国产化设计。首先考虑高速信号处理板应用于人工智能、图像处理等领域,是一种高精度和复杂运算的场景,因此选择DSP芯片FTDOC35BB_FT_M6678为主设计信号处理模块,选择FPGA芯片FMQL45T900为主设计控制单元模块;然后在CANDENCE软件中进一步采用分布式设计硬件电路,完成了高速信号接口模块、DDR3存储模块、EMIF模块的电路设计;最后使用CCS5.5集成开发环境对高速信号处理板各个接口及外设进行了测试。测试指标均达到要求,证明该高速信号处理板国产化设计切实可行,加速了高速信号处理板的国产化进程。 展开更多
关键词 国产化 FPGA DSP 高速信号
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基于先进工艺的车载芯片可靠性优化设计
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作者 梁宏玉 杨潇雨 +1 位作者 冯治华 王妍 《汽车技术》 北大核心 2026年第2期7-12,共6页
基于SMIC 12 nm鳍式场效应晶体管(FinFet)工艺,对模拟/数字(A/D)转换器前端跟踪/保持电路的谐波失真、带宽等性能指标进行了分析。通过合理选取采样开关的类型、尺寸,降低跟踪/保持开关随温度变化引入的谐波失真,提出一种新型的开关输... 基于SMIC 12 nm鳍式场效应晶体管(FinFet)工艺,对模拟/数字(A/D)转换器前端跟踪/保持电路的谐波失真、带宽等性能指标进行了分析。通过合理选取采样开关的类型、尺寸,降低跟踪/保持开关随温度变化引入的谐波失真,提出一种新型的开关输出缓冲器,提升跟踪/保持电路的线性度和A/D转换器的驱动力。试验结果表明,将N型金属氧化物半导体(NMOS)、P型金属氧化物半导体(PMOS)场效晶体管的电容和寄生电容作为采样电容,整体前端电路带宽提升至34 GHz;通过Cadence Virtuoso的仿真验证,当采样频率f_(s)=10 GHz、输入信号频率f_(in)=9.8 GHz时,无杂散动态范围(SFDR)和总谐波失真(THD)分别达到67 dB、-59.5 dB。所提出的设计方案可用于自动驾驶的内置自检安全系统,降低自动驾驶系统故障率,提升嵌入式车载芯片安全机制的可靠性。 展开更多
关键词 跟踪/保持电路 开关输出缓冲器 嵌入式车载芯片 可靠性
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基于时延估计与终端滑模的无人船跟踪控制 被引量:1
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作者 刘超 叶华生 +2 位作者 沈跃 刘慧 沈亚运 《电子测量技术》 北大核心 2025年第4期91-100,共10页
针对欠驱动无人船动力学模型参数获取困难、跟踪控制易受水流及自然风等干扰的问题,本文提出了一种基于自适应时延估计与超螺旋快速终端滑模的轨迹跟踪控制方法。首先通过手部位置点坐标变换方法,对欠驱动无人船数学模型进行状态扩展重... 针对欠驱动无人船动力学模型参数获取困难、跟踪控制易受水流及自然风等干扰的问题,本文提出了一种基于自适应时延估计与超螺旋快速终端滑模的轨迹跟踪控制方法。首先通过手部位置点坐标变换方法,对欠驱动无人船数学模型进行状态扩展重新构建;然后采用自适应时延估计技术,估计无人船未知动力学模型部分及外部扰动,并设计超螺旋快速终端滑模控制策略补偿时延估计产生的误差,提高控制系统鲁棒性;最后,基于仿真分析与航行跟踪实验验证本研究控制方法可行性。在航行跟踪实验中,位置平均误差相比于PID算法、滑模算法及自适应时延估计滑模算法分别降低了35.1%、24.7%、20.8%,轨迹跟踪精度高。本文提出的控制方法不依赖动力学模型参数,可实现欠驱动无人船精准轨迹跟踪控制,且收敛速度快、鲁棒性高,为欠驱动无人船轨迹跟踪控制提供了可供借鉴的方法。 展开更多
关键词 欠驱动无人船 自适应时延估计 超螺旋快速终端滑模控制 轨迹跟踪控制
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数智化背景下民族类院校“数字电子技术”课程混合式教学改革实践
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作者 常珊珊 宋述燕 罗伟华 《黑龙江教育(理论与实践)》 2026年第2期56-58,共3页
针对民族类院校工科教育面临的学生基础差异显著、教学与产业脱节等问题,“数字电子技术”课程团队在数智化背景下,构建了“三维融合”改革框架,并深入实施混合式教学改革。一方面,通过整合优质线上资源,引入FPGA(Field Programmable Ga... 针对民族类院校工科教育面临的学生基础差异显著、教学与产业脱节等问题,“数字电子技术”课程团队在数智化背景下,构建了“三维融合”改革框架,并深入实施混合式教学改革。一方面,通过整合优质线上资源,引入FPGA(Field Programmable Gate Array,现场可编程逻辑门阵列)先进产业技术重构课程内容;另一方面,依托数智平台实现学情追踪与差异化教学管理,系统构建了线上线下协同的教学新生态。实践表明,该混合式教学改革的实施有效提升了学生的工程实践能力与课程教学质量,为民族类院校一流本科课程建设提供了可资借鉴的实践路径。 展开更多
关键词 “数字电子技术”课程 混合式教学 民族类院校 数智化 教学改革
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高校数字电子技术课程教学改革的策略探讨
19
作者 杜振华 李媛 张爱华 《新潮电子》 2026年第1期130-132,共3页
随着信息技术的迅猛发展,数字电子技术作为电子信息类专业的基础核心课程,其教学内容与方法正面临前所未有的挑战。当前课程体系存在理论教学与实践应用脱节、传统实验设备更新滞后、学生创新能力培养不足等问题。尤其是在新工科建设背... 随着信息技术的迅猛发展,数字电子技术作为电子信息类专业的基础核心课程,其教学内容与方法正面临前所未有的挑战。当前课程体系存在理论教学与实践应用脱节、传统实验设备更新滞后、学生创新能力培养不足等问题。尤其是在新工科建设背景下,如何将FPGA技术、EDA工具等现代技术融入教学,构建“理论—仿真—实践”三位一体的教学模式,成为教学改革的关键突破口。基于此,文章首先阐述高校数字电子技术课程教学改革的重要性,随后探讨了适应智能时代需求的高校数字电子技术课程教学改革策略,旨在为培养具有工程实践能力和创新思维的复合型人才提供参考。 展开更多
关键词 高校 数字电子技术课程 教学改革
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高性能YOLOv3-tiny嵌入式硬件加速器的混合优化设计 被引量:1
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作者 谭会生 肖鑫凯 卿翔 《半导体技术》 CAS 北大核心 2025年第1期55-63,共9页
为解决在嵌入式设备中部署神经网络受算法复杂度、执行速度和硬件资源约束的问题,基于Zynq异构平台,设计了一个高性能的YOLOv3-tiny网络硬件加速器。在算法优化方面,将卷积层和批归一化层融合,使用8 bit量化算法,简化了算法流程;在加速... 为解决在嵌入式设备中部署神经网络受算法复杂度、执行速度和硬件资源约束的问题,基于Zynq异构平台,设计了一个高性能的YOLOv3-tiny网络硬件加速器。在算法优化方面,将卷积层和批归一化层融合,使用8 bit量化算法,简化了算法流程;在加速器架构设计方面,设计了可动态配置的层间流水线和高效的数据传输方案,缩短了推理时间,减小了存储资源消耗;在网络前向推理方面,针对卷积计算,基于循环展开策略,设计了8通道并行流水的卷积模块;针对池化计算,采用分步计算策略实现对连续数据流的高效处理;针对上采样计算,提出了基于数据复制的2倍上采样方法。实验结果表明,前向推理时间为232 ms,功耗仅为2.29 W,系统工作频率为200 MHz,达到了23.97 GOPS的实际算力。 展开更多
关键词 YOLOv3-tiny网络 异构平台 硬件加速器 动态配置架构 硬件混合优化 数据复制上采样
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