低功耗双边沿触发器的逻辑设计 被引量：17

1

作者 吴训威 韦健 《电子学报》 EI CAS CSCD 北大核心 1999年第5期129-131,共3页

本文从消除时钟信号冗余跳变而致的无效功耗的要求出发，提出双边沿触发器的设计思想与基于与非门的逻辑设计．用ＰＳＰＩＣＥ程序模拟证实了该种触发器具有正确的逻辑功能，能够正常地应用于时序电路的设计，并且由于时钟工作频率减半... 本文从消除时钟信号冗余跳变而致的无效功耗的要求出发，提出双边沿触发器的设计思想与基于与非门的逻辑设计．用ＰＳＰＩＣＥ程序模拟证实了该种触发器具有正确的逻辑功能，能够正常地应用于时序电路的设计，并且由于时钟工作频率减半而导致系统功耗的明显降低． 展开更多

关键词 低功耗 触发器 逻辑设计 集成电路

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一种单锁存器CMOS静态D触发器的设计 被引量：6

2

作者 莫凡 俞军 章倩苓 《Journal of Semiconductors》 EI CAS CSCD 北大核心 1999年第12期1081-1086,共6页

提出了一种只使用单锁存器的ＣＭＯＳ静态Ｄ触发器结构．由于它比普通的主从型Ｄ触发器少一个锁存器，故所需的管子数少，从而节省了面积．

关键词 D触发器 CMOS 单锁存器 设计 触发器

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任意值数触发器电路设计及其应用 被引量：4

3

作者 张德龙 张瑜 《计算机学报》 EI CSCD 北大核心 1995年第1期65-70,共6页

本文在运用ＤＹＬ集成线性“与或”门构成多值反相器的基础上，设计出可存储任意逻辑状态值的ＲＳ触发器、Ｄ触发器和ＪＫ触发器．这类任意值数触发器可作为多值逻辑器件，用于多值时序电路设计．

关键词 触发器 电路设计 多值逻辑 设计 应用

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I^2L和TTL型双边沿D触发器 被引量：7

4

作者 刘莹 方振贤 《电子科学学刊》 CSCD 1997年第3期416-419,共4页

本文首先提出双边沿D触发器的系统设计方法,代替直观设计。接着用此法设计出I^2L型和TTL型双边沿D触发器。

关键词 双极型 双边沿触发器 设计 触发器

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一种CMOS静态双沿触发器的设计 被引量：1

5

作者 莫凡 俞军 章倩苓 《半导体技术》 CAS CSCD 北大核心 1999年第4期52-57,共6页

提出一种ＣＭＯＳ静态双沿触发器结构，以单个锁存器构成记忆单元，而由一特殊的时钟模块产生控制信号，使锁存器在时钟上升和下降沿处瞬时导通，从而形成双沿触发的功能。最小的实现方案只用１４个管子，模拟证明其工作频率可达３００... 提出一种ＣＭＯＳ静态双沿触发器结构，以单个锁存器构成记忆单元，而由一特殊的时钟模块产生控制信号，使锁存器在时钟上升和下降沿处瞬时导通，从而形成双沿触发的功能。最小的实现方案只用１４个管子，模拟证明其工作频率可达３００ＭＨｚ以上。 展开更多

关键词 CMOS 静态双沿触发器 设计 触发器

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三值触发器设计及其变换 被引量：6

6

作者 方振贤 《电子学报》 EI CAS CSCD 北大核心 1993年第11期95-98,共4页

本文研究基于状态图设计三值触发器的通用方法,对称和非对称三值逻辑均适用,用一个状态图统一地导出主从结构和维持阻塞结构触发器,以及其它等效触发器。本文设计出双极性cp触发器,改进了mR和JK触发器。

关键词 三值逻辑 状态图 触发器 设计

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nMOS四值触发器的设计及其应用 被引量：1

7

作者 夏银水 吴训威 《电子科学学刊》 EI CSCD 1997年第5期669-676,共8页

本文应用限幅电压开关理论设计了两种主从型nMOS四值触发器。这砦触发器具有双端预置能力和双轨互补输出。通过采用JKLM型触发器对十六进制加法计数器和十进制加法计数器的设计实例证明了这些触发器能有效地用于四值时序电路的设计。

关键词 开关理论 NMOS 四值逻辑 触发器 设计

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基于集成门电路的三值单稳态触发器研究 被引量：1

8

作者 汪鹏君 夏银水 吴训威 《电路与系统学报》 CSCD 1999年第4期91-94,共4页

通过对二值单稳态触发器设计原理的重新归纳，本文从三值三稳态触发器的正确设计出发，提出了二种三值单稳态触发器的设计方案。以RC微分电路为定时电路的设计已用PSPICE程序进行计算机验证。结果表明所设计的二种三值单稳态触发器具有... 通过对二值单稳态触发器设计原理的重新归纳，本文从三值三稳态触发器的正确设计出发，提出了二种三值单稳态触发器的设计方案。以RC微分电路为定时电路的设计已用PSPICE程序进行计算机验证。结果表明所设计的二种三值单稳态触发器具有正确的功能。与二值单稳态触发器相比，它们具有更强的功能并能在实用设计中获得更广泛的应用。 展开更多

关键词 单稳态触发器 电路设计 数字电路

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一种设计同步时序电路的新方法 被引量：2

9

作者 成立 《微电子学》 CAS CSCD 北大核心 1999年第1期39-43,53,共6页

介绍了一种设计同步时序逻辑电路的新方法。该方法之关键在于直接从时序电路的状态转换图（ＳＴＤ）获得Ｊ－Ｋ、Ｄ和Ｔ触发器的激励方程式。采用该方法设计了几个实例，并由此验证了其正确性和有效性。

关键词 触发器 时序电路 状态转换图 卡诺图 激励方程式

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闭环控制晶闸管数字触发电路设计 被引量：4

10

作者 黄河 刘霞 车育生 《移动电源与车辆》 2001年第1期1-3,21,共4页

用单片机组成晶闸管数字触发器 ,并结合PID调节技术 ,对晶闸管变流、调压装置进行闭环控制 ,实现输出电流、电压无差调节。叙述了其控制过程 ,给出了实际触发器电路 ;此触发器实时控制精度高 ,具有较理想的动态性能 ,是一种理想的控制... 用单片机组成晶闸管数字触发器 ,并结合PID调节技术 ,对晶闸管变流、调压装置进行闭环控制 ,实现输出电流、电压无差调节。叙述了其控制过程 ,给出了实际触发器电路 ;此触发器实时控制精度高 ,具有较理想的动态性能 ,是一种理想的控制电路。 展开更多

关键词 数字触发器 数字触发电路 晶闸管 闭环控制 设计

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全数字触发器60°分段方式的新设计

11

作者 曹承志 曲红梅 +1 位作者 路战红 杨晓波 《沈阳工业大学学报》 EI CAS 2001年第1期49-51,共3页

介绍一种新型的全数字触发器，它突破 8位单片机位数的局限，提出的三个 32位的 FIFO寄存器，与同步中断信号有机配合，降低了对硬件的要求，又减少了移相定时过程占用 CPU的时间 .经实验运行表明，该触发器结构简单，算法快捷，运行可... 介绍一种新型的全数字触发器，它突破 8位单片机位数的局限，提出的三个 32位的 FIFO寄存器，与同步中断信号有机配合，降低了对硬件的要求，又减少了移相定时过程占用 CPU的时间 .经实验运行表明，该触发器结构简单，算法快捷，运行可靠，可满足高精度晶闸管变流系统的要求 . 展开更多

关键词 数字触发器 分段方式 FIFO寄存器 晶闸管变流系统

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部分扫描可测性设计的最优实现

12

作者 叶波 韦和民 郑增钰 《半导体技术》 CAS CSCD 北大核心 1997年第1期58-60,共3页

提出了部分扫描可测性设计的最优实现方法，包括扫描触发器的选取、组合功能块的划分。

关键词 可则性设计 扫描触发器 测试码 触发器

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可编程控制晶闸管数字触发器设计 被引量：1

13

作者 黄河 冯中社 《移动电源与车辆》 2000年第3期1-2,14,共3页

采用数字集成电路构成数字移相触发器 ,电路简单 ,性能稳定 ,输出触发脉冲对称性好 ,工作安全可靠 ,是一种理想的晶闸管触发控制电路。

关键词 晶闸管 数字移相 可编程控制 数字触发器 设计

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一种新型准静态D─触发器设计

14

作者 李伟华 蔡世俊 《电子器件》 CAS 1994年第4期50-54,共5页

本文将介绍一种新型的ＣＭＯＳ准静态Ｄ─触发器的结构，这种新结构结合了ＮＭＯＳ结构和ＣＭＯＳ结构的优点。在这篇论文中将这种新型结构与ＮＭＯＳ传输门Ｄ─触发器、普通ＣＭＯＳ传输门Ｄ─触发器在结构、功能、集成度和特性等方面... 本文将介绍一种新型的ＣＭＯＳ准静态Ｄ─触发器的结构，这种新结构结合了ＮＭＯＳ结构和ＣＭＯＳ结构的优点。在这篇论文中将这种新型结构与ＮＭＯＳ传输门Ｄ─触发器、普通ＣＭＯＳ传输门Ｄ─触发器在结构、功能、集成度和特性等方面进行了比较，讨论这种新结构中ＭＯＳ管尺寸的设计，并且通过电路模拟软件ＳＰＩＣＥ对电路进行特性分析和比较。 展开更多

关键词 触发器 准静态 D-触发器 设计

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一种新型的可逆电路数字触发器设计

15

作者 孙德辉 李忠庆 《基础自动化》 CSCD 1996年第2期31-33,共3页

介绍一种由8031单片机实现的适于三相零式反并联可逆电路的新型全数字触发器。其结构简单，编程容易，实用可靠。

关键词 单片机 数字触发器 触发器

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通过时序调整优化同步时钟系统

16

作者 柳进 《系统工程与电子技术》 EI CSCD 1997年第9期58-60,共3页

本文针对同步时钟系统中出现的时钟歪斜现象，分析了同步时序电路正常运行的物理量和限定条件，提出了时序调整方法，运用线性规划方法解决了同步时序电路优化问题，为同步时钟系统中时序正常的运行提供了最佳方案。

关键词 时序电路 数学模型 触发器 线性规划

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软件开发中的触发器设计

17

作者 陈思国 殷巍 《计算机应用研究》 CSCD 1995年第3期95-95,38,共2页

ＳＱＬ＊ＦＯＲＭ是ＯＲＡＣＬＥ关系数据库提供的软件生成工具。本文介绍的触发器设计是ＳＱＬ＊ＦＯＲＭ的精华之所在。正确使用和设计触发器，从而得到一个完美的ＦＯＲＭ，对于一个应用软件系统的开发是至关重要的。

关键词 软件开发 触发器 设计 数据库

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完善三值维持阻塞触发器

18

作者 张炳德 徐方 茹国宝 《武汉纺织工学院学报》 1997年第4期69-71,94,共4页

对三值维持阻塞D型和T型触发器的设计进行了改进，使它们具有完善的预置功能。

关键词 多值逻辑 三值触发器 触发器 多值逻辑 设计

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基于模代数的三值维持阻塞触发器及其应用 被引量：5

19

作者 张迎 韦健 吴训威 《电路与系统学报》 CSCD 1999年第1期12-17,共6页

本文给出了基于模代数理论的三值维持阻塞触发器，并将其应用到时序逻辑电路设Ｈ中。由’Ｊ‘多值模代数中的两个基本运算的作用对象和运算结果均为多值信号，所以它的应用避免了以往在采用基｝ＰＯＯＩ代数的三值触发器时，由于输入、... 本文给出了基于模代数理论的三值维持阻塞触发器，并将其应用到时序逻辑电路设Ｈ中。由’Ｊ‘多值模代数中的两个基本运算的作用对象和运算结果均为多值信号，所以它的应用避免了以往在采用基｝ＰＯＯＩ代数的三值触发器时，由于输入、输出信号不匹配而必须增加附加编码电路的问题。设计实例表明，该触发器具会更强的逻辑功能，它使得移位寄存器类的时序电路设计得以显著简化。 展开更多

关键词 模代数 多值逻辑 锁存器 触发器

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扫描法可测性设计中扫描触发器的最优实现

20

作者 叶波 郑增钰 《微电子学》 CAS CSCD 1995年第6期53-55,共3页

提出了扫描法可测性设计中扫描触发器的最优实现方法。采用该方法每个触发器仅需增加２个ＭＯＳ管即可构成扫描触发器，比用传统方法减少１２个ＭＯＳ管，而增加的额外管脚数与传统方法一样。这样，即使采用全扫描设计，也仅需较小的芯... 提出了扫描法可测性设计中扫描触发器的最优实现方法。采用该方法每个触发器仅需增加２个ＭＯＳ管即可构成扫描触发器，比用传统方法减少１２个ＭＯＳ管，而增加的额外管脚数与传统方法一样。这样，即使采用全扫描设计，也仅需较小的芯片面积。 展开更多

关键词 数字集成电路 可测性设计 触发器

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