本文主要设计了基于相位控制技术的时钟恢复系统的PLL锁相环路。分别对各单元电路结构--鉴频鉴相器、电荷泵、环路滤波器、压控振荡器、分频器进行设计。采用2.5V,0.25μm First Silicon CMOS工艺来实现,并在SPICE平台下进行仿真。仿真...本文主要设计了基于相位控制技术的时钟恢复系统的PLL锁相环路。分别对各单元电路结构--鉴频鉴相器、电荷泵、环路滤波器、压控振荡器、分频器进行设计。采用2.5V,0.25μm First Silicon CMOS工艺来实现,并在SPICE平台下进行仿真。仿真结果表明,该PLL环路的锁定时间仅为2.4us,并且输出的频谱呈现出较高的纯度,具有高速、低噪声的特点。展开更多
文摘本文主要设计了基于相位控制技术的时钟恢复系统的PLL锁相环路。分别对各单元电路结构--鉴频鉴相器、电荷泵、环路滤波器、压控振荡器、分频器进行设计。采用2.5V,0.25μm First Silicon CMOS工艺来实现,并在SPICE平台下进行仿真。仿真结果表明,该PLL环路的锁定时间仅为2.4us,并且输出的频谱呈现出较高的纯度,具有高速、低噪声的特点。
